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NMIとは 意味・読み方・使い方

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意味・対訳 マスク不可能割り込み、ノンマスカブルインタラプト


「NMI」を含む例文一覧

該当件数 : 64



例文

When an NMI terminal level becomes a Low level and the input of an NMI signal is detected, the counting operation of FRC is stopped temporarily.例文帳に追加

NMI端子レベルが LowレベルとなりNMI信号の入力が検出されると、FRCのカウント動作が一旦停止される。 - 特許庁

An abnormal noise flag is set in an NMI process from the input of noises or fraudulent signals or the like to an NMI terminal.例文帳に追加

NMI端子にノイズや不正信号等が入力されたことにもとづくNMI処理で、異常ノイズフラグをセットする。 - 特許庁

A watchdog timer 2 issues NMI when overrun is detected.例文帳に追加

ウォッチドッグタイマ2は暴走を検知するとNMIを発行する。 - 特許庁

A possibility that a deadline error of a task k may occur is determined under the condition of Σ_i=1...NMi*Uk,i≤Lk.例文帳に追加

Σ_i=1...N Mi * Uk,i ≦ Lk の条件によってタスク k のデッドラインミスが発生する可能性を判定する。 - 特許庁

CPU 56 executes the process of the time of a power cut according to an inputted signal to NMI terminal.例文帳に追加

CPU56は、NMI端子への信号入力に応じて電源断時処理を実行する。 - 特許庁

In a power failure generation NMI process, CPU confirms whether a power source failure flag is already set or not.例文帳に追加

停電発生NMI処理で、CPUは、電源断フラグが既にセットされているか否か確認する。 - 特許庁

例文

On the occurrence of system event (INTR, NMI, SMI, SRESET, INIT), the assertion of STPCLK# is prohibited for a given length of time, making it operate at high speed.例文帳に追加

システムイベント(INTR,NMI,SMI,SRESET,INIT)があった場合、一定時間STPCLK#のアサートを禁止し、高速動作させる。 - 特許庁

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コンピューター用語辞典での「NMI」の意味

NMI<non-maskable interrupt>


機械工学英和和英辞典での「NMI」の意味

NMI (NASA Management Instruction)


nmi (nautical mile (1nmi=1.151miles))

海里(1ノーティカルは1.151マイル

遺伝子名称シソーラスでの「NMI」の意味

Nmi

human遺伝子名Nmi
同義語(エイリアス)N-myc and STAT interactor; N-myc-interactor; N-myc (and STAT) interactor; NMI
SWISS-PROTのIDSWISS-PROT:Q13287
EntrezGeneのIDEntrezGene:9111
その他のDBのIDHGNC:7854
mouse遺伝子名Nmi
同義語(エイリアス)N-myc and STAT interactor; N-myc-interactor; N-myc (and STAT) interactor
SWISS-PROTのIDSWISS-PROT:O35309
EntrezGeneのIDEntrezGene:64685
その他のDBのIDMGI:1928368
rat遺伝子名Nmi
同義語(エイリアス)N-myc (and STAT) interactor (predicted); N-myc (and STAT) interactor; MGC112791
SWISS-PROTのID---
EntrezGeneのIDEntrezGene:311021
その他のDBのIDRGD:1311721
zfish遺伝子名nmi
同義語(エイリアス)wu:fj02e01; fj02e01; N-myc (and STAT) interactor
SWISS-PROTのID---
EntrezGeneのIDEntrezGene:335331
その他のDBのIDZFIN:ZDB-GENE-030131-7271

本文中に表示されているデータベースの説明

SWISS-PROT
スイスバイオインフォマティクス研究所欧州バイオインフォマティクス研究所によって開発運営されているタンパク質アミノ酸配列データベース
EntrezGene
NCBIによって運営されている遺伝子データベース染色体上の位置配列発現構造機能、ホモロジーデータなどが含まれている
HGNC
HUGO遺伝子命名法委員会により運営されるヒト遺伝子に関するデータベース
MGI
様々なプロジェクトによる研究マウス遺伝的生物学的なデータを提供するデータベース
RGD
ウィスコンシン医科大学により運営されるラット遺伝子ゲノム情報データベース
ZFIN
ゼブラフィッシュ遺伝子命名法委員会により運営されている研究用の淡水魚ゼブラフィッシュ遺伝子ゲノム情報データベース

Weblio英和対訳辞書での「NMI」の意味

NMI

Weblio英和対訳辞書はプログラムで機械的に意味や英語表現を生成しているため、不適切な項目が含まれていることもあります。ご了承くださいませ。

Wiktionary英語版での「NMI」の意味

NMI

名詞

NMI (複数形 NMIs)

  1. (computing) Initialism of non-maskable interrupt.

成句

NMI

  1. Initialism of no middle initial.

アナグラム

Weblio例文辞書での「NMI」に類似した例文

nmi

Weblio例文辞書はプログラムで機械的に意味や英語表現を生成しているため、不適切な項目が含まれていることもあります。ご了承くださいませ。

「NMI」を含む例文一覧

該当件数 : 64



例文

A CPU 1 has an NMI terminal 1-1 into which non-maskable NMI signals are input, and an INT terminal 1-2 into which maskable INT signals are input.例文帳に追加

CPU1は、マスク不可のNMI信号が入力されるNMI端子1−1と、マスク可のINT信号が入力されるINT端子1−2とを有する。 - 特許庁

The NMI interruption processing of the controller 3 is executed by the strobe signal and the reception processing of the bonus ball command is executed in the NMI interruption processing.例文帳に追加

ストローブ信号によって払出制御装置3のNMI割込み処理を行わせ、該NMI割込み処理において賞球コマンドの受信処理を行う。 - 特許庁

Then, after waiting for a prescribed time, when the state of the NMI terminal level is switched from the Low level to a High level and the release of an NMI interruption request is detected, the stoppage of the FRC is released.例文帳に追加

そして、所定時間の経過を待ち、NMI端子レベルの状態がLowレベルからHighレベルに切り替わり、NMI割込要求が解除されたことが検知されると、FRCの停止が解除される。 - 特許庁

But a control circuit by a flip flop for receiving the input of the NMI signal to generate an interrupt signal does not transmit an unlawful signal except an initially inputted NMI signal to output.例文帳に追加

しかし、NMI信号を入力して割込信号を発生するフリップフロップによる規制回路は初回に入力されたNMI信号以外の不正な信号を出力に伝達しない。 - 特許庁

As a result, as the power source voltage lowers, a CPU 371 for controlling prize balls of a prize ball control board 37 undergoes the NMI interruption at the same timing as that at which the NMI interruption is applied onto a CPU 56 of the main board 31.例文帳に追加

従って、電源電圧が低下していくときに、賞球制御基板37の賞球制御用CPU371に対して、主基板31のCPU56にNMI割込がかかった時点と同じタイミングでNMI割込がかかる。 - 特許庁

As the voltage of the power source drops down steadily, a CPU 371 for controlling prize balls of a prize ball control board 37 undergoes NMI interruption at the same timing at which the NMI interruption is applied onto a CPU 56 of the main board 31.例文帳に追加

従って、電源電圧が低下していくときに、賞球制御基板37の賞球制御用CPU371に対して、主基板31のCPU56にNMI割込がかかった時点と同じタイミングでNMI割込がかかる。 - 特許庁

Thus, when a power supply voltage lowers, NMI interruption is applied to the CPU 56 of a main substrate earlier than the CPU of the other respective substrates and the CPU 56 starts an NMI interruption processing earlier.例文帳に追加

従って、電源電圧が低下していくときに、主基板のCPU56には、他の各基板のCPUよりも早めにNMI割込がかかり、CPU56は、早めにNMI割込処理を開始する。 - 特許庁

例文

The NMI interrupt processing of the put-out control device 3 is performed in response to the strobe signal, and in the NMI interrupt processing, the receiving processing of the prize ball command is performed.例文帳に追加

ストローブ信号によって払出制御装置3のNMI割込み処理を行わせ、該NMI割込み処理において賞球コマンドの受信処理を行う。 - 特許庁

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