「cache control method」に関連した英語例文の一覧と使い方(5ページ目) - Weblio英語例文検索

To provide a cache memory controller, a cache memory control method, a central processor, an information processor, and a central processing method, reducing a waiting time of a demand fetch process waiting a prefetch process.例文帳に追加

プリフェッチ処理を待つディマンドフェッチ処理の待ち時間を短縮するキャッシュメモリ制御装置、キャッシュメモリ制御方法、中央処理装置、情報処理装置、中央処理方法を提供する。 - 特許庁

To provide a cache control method and a cache control circuit that can solve a conventional technical problem and acquire a performance improving effect by a cache memory even with a program which does not guarantee locality of reference in a strict sense.例文帳に追加

従来技術の問題点を解消し、参照の局所性が厳密な意味で保証されないプログラムであっても、キャッシュメモリによる性能向上効果を得ることができるキャッシュ制御方法およびキャッシュ制御回路を提供すること。 - 特許庁

To provide a cache memory device and its control method for reducing power consumption with a low cost configuration.例文帳に追加

安価な構成で、かつ消費電力を低減できるキャッシュメモリ装置及びその制御方法を提供すること。 - 特許庁

DISK ARRAY DEVICE WITH CACHE MEMORY, ITS ERROR- CONTROLLING METHOD AND RECORDING MEDIUM WITH ITS CONTROL PROGRAM RECORDED THEREON例文帳に追加

キャッシュメモリ付きディスクアレイ装置及びそのエラー制御方法並びにその制御プログラムを記録した記録媒体 - 特許庁

To provide a memory device capable of attaining speed-up of processing by reduction in access to an auxiliary memory device and protection of data to power supply interruption, and to provide a cache control method and a cache control program.例文帳に追加

補助記憶装置へのアクセス低減による処理の高速化と、電源断に対するデータ保護を図ることができるメモリ装置、キャッシュ制御方法、およびキャッシュ制御プログラムを提供する。 - 特許庁

To provide a cache memory capable of efficiently realizing improvement in performance and reduction in power consumption in cache memory control of a mechanism capable of dynamically controlling a capacity to be operated, and a control method thereof.例文帳に追加

動作させる容量を動的に制御可能な機構のキャッシュメモリ制御において性能向上と消費電力低減を効率良く両立させたキャッシュメモリ、およびその制御方法を提供する。 - 特許庁

In this method, a ranking guideline is established by means of a writable cache replacement control array 430.例文帳に追加

本発明に係る方法では、書き込み可能なキャッシュ置き換え制御アレイ４３０を用いて順位付け指針を確立する。 - 特許庁

If set to true, the output of the method will never be displayed (because the output is used to control the cache) dontCacheWhenTheResultIsFalse 例文帳に追加

true を設定すると、メソッドの出力が表示されなくなります(キャッシュの制御用に出力が使用されるからです)。 dontCacheWhenTheResultIsFalse - PEAR

To provide a cache device, a cache control method, a program and a recording medium with the program recorded thereon that can reduce a total access cost when caching files of different access costs.例文帳に追加

アクセスコストが異なるファイルをキャッシュする場合に、総アクセスコストを低減できる、キャッシュ装置、キャッシュ制御方法及びプログラム並びに当該プログラムを記録した記録媒体の提供。 - 特許庁

To provide a cache control method for an information processing apparatus capable of suppressing deterioration of access speed, even when a control unit having low operation speed is used.例文帳に追加

演算速度が遅い制御部を用いても、アクセス速度の低下を抑制することが可能な情報処理装置のキャッシュ制御方法を提供すること。 - 特許庁

To provide a cache memory device which can smoothly freeze ≥2 ways without decreasing the throughput of a cache memory although its circuit constitution is simple and realize a cache memory function complying with needs and its control method.例文帳に追加

簡素な回路構成を備えながらも、キャッシュメモリのスループットを低下させることなく２以上のウエイを対象に円滑なフリーズ処理が実行でき、ニーズに対応したキャッシュメモリ機能が実現できるキャッシュメモリ装置及びその制御方法を提供する。 - 特許庁

To provide a data access control method by a tamper-resistant microprocessor and a cache memory mount processor without the need for a complicated hardware function wherein contents of a cache memory can be read from other programs with a secure method when a plurality of programs share one encryption key without the access limit of the cache memory and without the need for scanning all areas of the cache memory.例文帳に追加

キャッシュメモリのアクセス制限がなく、キャッシュメモリの全領域を走査する必要がなく、複数のプログラムが１つの暗号鍵を共有する際安全な方法で他のプログラムから読み出すことができ、複雑なハードウェア機能が不要な耐タンパマイクロプロセッサ及びキャッシュメモリ搭載プロセッサによるデータアクセス制御方法を提供する。 - 特許庁

A microprocessor and a control method employ an L1 cache 12 directly accessible to the CPU 11, the L2 cache 13 searchable for data required by the CPU 11 that is not present in the L1 cache 12, and a flag 14 representing whether there is initial data in the L2 cache 13.例文帳に追加

本発明のマイクロプロセッサおよびその制御方法は、ＣＰＵ１１から直接アクセスされるＬ１キャッシュ１２と、Ｌ１キャッシュ１２にＣＰＵ１１が必要とするデータが存在しない場合に、当該データが検索されるＬ２キャッシュ１３と、Ｌ２キャッシュ１３における初期データの有無を示すフラグ１４を有する。 - 特許庁

As a control mode, a mode for inhibiting the discharge of specified data held in the cache memory 11 and a mode for discharging the data held in the cache memory 11 with an ordinary method are provided.例文帳に追加

制御モードとしては、キャッシュメモリ１１で保持される特定のデータの追い出しを禁止するモードと、キャッシュメモリ１１で保持されるデータを通常の方法で追い出すモードとが設けられている。 - 特許庁

To provide a cache control method capable of suppressing deterioration of processing performance even if receiving a large amount of data, when processing the received data by writing it in a cache memory.例文帳に追加

受信したデータをキャッシュメモリに書き込んで処理を行う場合に、大量のデータを受信する状況であっても、処理性能が低下することを抑制できるキャッシュ制御方法を提供する。 - 特許庁

To provide a RAID apparatus to suppress an increase of processing time for managing a cache with a large capacity, and a RAID control program and a cache management method thereof.例文帳に追加

大容量のキャッシュを備えた場合においても、キャッシュの管理に係る処理時間の増大を抑制することができるＲＡＩＤ装置、ＲＡＩＤ制御プログラムおよびキャッシュ管理方法を提供すること。 - 特許庁

To provide a cache memory and a control method therefore which can determine stack smashing by making improvements mainly to a cache memory without significantly affecting the inner structure of a processor.例文帳に追加

プロセッサの内部構造に大きな影響を与えることなく、主にキャッシュ・メモリに対して改良を加えることでスタック・スマッシングを判別可能なキャッシュ・メモリ及びその制御方法を提供する。 - 特許庁

To provide a cache control method, a switch device and a program of high locality of data, and light load of a cache operation without changing a host device and a storage device in a storage area network.例文帳に追加

ストレージエリアネットワークについて、ホスト装置及び記憶装置を変更することなく、データの局所性が高く、且つキャッシュ動作の負荷が軽い、キャッシュ制御方法、スイッチ装置及びプログラムを提供する。 - 特許庁

To provide a memory controller and a memory control method for efficiently executing the temporary storage of write data to a cache memory.例文帳に追加

キャッシュメモリへのライトデータの一時記憶を効率的に行うことが可能なメモリ制御装置及びメモリ制御方法を提供する。 - 特許庁

To provide a method for dynamically specifying an exclusive/shared area and to always perform optimal cache coincidence control.例文帳に追加

専用・共用領域の特定を動的に行う方法を提供し、それにより、常に最適なキャッシュ一致制御を行うことにある。 - 特許庁

To provide a disc device capable of improving the hit efficiency in a cache buffer to a read request from a host device by looking only estimated data ahead and storing them in the cache buffer even in the receipt of a skip read request from the host device, and a cache control method for this device.例文帳に追加

ホストからのスキップ読出し要求があっても、予想されるデータのみを先読みしてキャッシュバッファに蓄えることで、ホスト装置からのリード要求に対するキャッシュバッファでのヒット効率を向上させるディスク装置及び同装置のキャッシュ制御方法を提供することにある。 - 特許庁

To provide a network cache device and a network cache controlling method capable of using cache control of a hit rate higher than that of an LRU for a supposed access pattern and guaranteeing the prescribed value of data volume to be faulted also for an access pattern other than the supposed access pattern.例文帳に追加

本発明の課題は、仮定したアクセスパターンに対しては、ＬＲＵよりもさらにヒット率が高く、仮定したアクセスパターン以外に対しても、フォルトするデータ量の所定値が保証されるキャッシュ制御を用いたネットワークキャッシュ装置およびネットワークキャッシュ制御手法を提供することにある。 - 特許庁

To provide a buffer control method capable of improving a cache hit rate when a non-continuous data reading request occurs in an address space.例文帳に追加

アドレス空間において非連続なデータ読み出し要求が発生する際のキャッシュヒット率を向上させるバッファ制御方法を提供する。 - 特許庁

To provide a cache memory system and a control method for WAY prediction of a cache memory, which reduce failures of WAY prediction by WAY prediction not using address matching and is capable of preventing malfunction of the system.例文帳に追加

アドレスマッチングを用いないＷＡＹ予測により、ＷＡＹ予測の失敗を減らし、システムの誤動作を防ぐことができるキャッシュメモリシステム及びキャッシュメモリのＷＡＹ予測の制御方法を提供すること。 - 特許庁

To provide a control device and method of a storage device for performing appropriate distribution not obstructing allocation of cache memories to other storage devices when cache memories are allocated by every storage device.例文帳に追加

本発明の目的は、記憶装置毎にキャッシュメモリを割り当てる時、他の記憶装置に対するキャッシュメモリの割り当てを阻害しない、適切な配分を行う記憶装置の制御装置および方法を提供することにある。 - 特許庁

This cache memory system is provided with a multiway set associative type cache memory 20, a bus load detection part 30 for detecting the load state of a bus to which the cache memory 20 is connected and outputting bus load information D2 and a replacing way control part 40 for changing a replacing method of the cache memory 20 in accordance with the bus load information D2 outputted from the bus load detection part 30.例文帳に追加

マルチウェイセットアソシアティブ方式のキャッシュメモリ２０と、キャッシュメモリ２０が接続されているバスの負荷状態を検出しバス負荷情報Ｄ２を出力するバス負荷検出部３０と、バス負荷検出部３０によるバス負荷情報Ｄ２に応じてキャッシュメモリ２０のリプレース方法を変更するリプレースウェイ制御部４０とを備える。 - 特許庁

To provide a data consistency control system which, while simplifying data consistency control, eliminates the need for a cache agent to have a buffer of sufficiently large size to prevent deadlock, and a data consistency control method.例文帳に追加

データ一貫性制御を単純なものとしつつ、キャッシュエージェントにデッドロックを防止するための十分大きなサイズのバッファを持つ必要のないデータ一貫性制御システム及びデータ一貫性制御方法を提供する。 - 特許庁

To provide an apparatus, a system, a method and a program for cache control which properly control a cache memory and prevent the deterioration of performance when collecting detection data from a detection device for transmitting the detection data intermittently and continuously and acquiring attribute information corresponding to the collected detection data from a cache memory or a database.例文帳に追加

間欠接続で検出データを送信する検出装置から検出データを収集し、収集した検出データに対応する属性情報を、キャッシュメモリ又はデータベースから取得する場合に、キャッシュメモリを適正に制御し、パフォーマンスの低下を防止するキャッシュ制御装置、キャッシュ制御システム、キャッシュ制御方法及びキャッシュ制御プログラムを提供する。 - 特許庁

To provide a second cache drive control circuit, a second cache, a RAM and a second cache drive control method, allowing reduction of unnecessary power supply without reducing processing speed of a processor, allowing suppression of a heating value, helping stable operation of the processor, realizing high reliability, and environmentally excellent by suppressing power consumption.例文帳に追加

プロセッサの処理速度の低下をもたらすことなく、不要な電力供給を削減でき、発熱量を抑え、プロセッサの安定動作を助け、高信頼性を実現するとともに、消費電力量を抑えることで環境的に優れるセカンドキャッシュ駆動制御回路、セカンドキャッシュ、ＲＡＭ、及びセカンドキャッシュ駆動制御方法を提供する。 - 特許庁

To provide a control method for a disk array apparatus for determining the apparatus state of the disk array apparatus based on a data saving possibility of a cache memory.例文帳に追加

キャッシュメモリについてのデータ退避の可否に基づいて、ディスクアレイ装置の装置状態を決定するディスクアレイ装置制御方法を提供する。 - 特許庁

In the control method for the disk array apparatus, a CPU of a first control module acquires other system state information which is decided by a battery and a nonvolatile memory of a second control module and indicates the data saving possibility of the cache memory of the second control module.例文帳に追加

ディスクアレイ装置の制御方法において、第１の制御モジュールのＣＰＵが、第２の制御モジュールのバッテリ及び不揮発性メモリによる、第２の制御モジュールのキャッシュメモリについてのデータ退避可否を示す他系状態情報を取得する。 - 特許庁

A data conversion method group 112 converts shared data stored in a shared file server 108, stores the converted data in the server 108 as a cache file, and when a data conversion control mechanism 109 judges the effectiveness of the cache file, the server 108 transmits the cache file.例文帳に追加

データ変換メソッド群１１２は、共有ファイルサーバ１０８に記憶する記憶されている共有データをデータ変換し、共有ファイルサーバ１０８にキャッシュファイルとして記憶し、データ変換制御機構１０９によって、キャッシュファイルが有効と判断された場合に、共有ファイルサーバ１０８は、キャッシュファイルを送信する。 - 特許庁

To provide an instruction cache device storing the instruction block of a non-branch instruction and the instruction block of a branch destination instruction to dedicated first and second instruction caches and surely hitting the branch destination instruction in the second instruction cache and a control method therefor.例文帳に追加

非分岐命令の命令ブロックと分岐先命令の命令ブロックとを専用の第１と第２の命令キャッシュに格納し、分岐先命令が確実に第２の命令キャッシュでヒットする命令キャッシュ装置及びその制御方法にある。 - 特許庁

To provide a memory controller and a memory control method for surely controlling the consistency of a cache even at the time of constructing a multi-processor system by using a processor which does not notify information related with cache ejection processing.例文帳に追加

キャッシュ排出処理に関する情報を通知しないプロセッサをもちいてマルチプロセッサシステムを構築した場合であっても確実にキャッシュの整合性制御をおこなうことができるメモリ制御装置およびメモリ制御方法を提供すること。 - 特許庁

To provide a software cache controlling method making it possible to improve the efficiency of write back and to efficiently use an area for a cache by preventing unnecessary writing operation in write back control.例文帳に追加

ライトバックの対象データが記録装置に記録要求されるまでに、ファイル管理情報の変更により未使用領域となった場合であっても、記録装置に対して記録して不必要な書き込み動作が発生してしまうという問題を解決する。 - 特許庁

To provide a storage device using a nonvolatile memory with a data remained even when an electric power source is interrupted as a cache, and a control method therefor.例文帳に追加

電源が遮断されてもデータが残っている不揮発性メモリをキャッシュとして使用した不揮発性メモリをキャッシュとして用いる保存装置及びその管理方法を提供する。 - 特許庁

To provide an information processing device, a control method therefor and a program, appropriately restricting a memory area capacity secured in a RAM by a cache function.例文帳に追加

キャッシュ機能によってＲＡＭに確保される記憶領域の容量を適切に制限する情報処理装置及びその制御方法、並びにプログラムを提供する。 - 特許庁

To provide a semiconductor integrated circuit device which can speed up an operation frequency while deterioration of performance of a processing unit is suppressed and to provide a cache memory control method.例文帳に追加

処理ユニットの性能劣化を抑えつつ動作周波数を高速化することができる半導体集積回路装置およびキャッシュメモリ制御方法の提供を図る。 - 特許庁

To provide a data storage device and a control method therefor that can carry out quick merge processing with the data in a file data block and the latest data in a cache block.例文帳に追加

ファイル・データ・ブロックのデータとキャッシュ・ブロックの最新のデータとのマージ処理を高速化することのできるデータ記憶装置およびその制御方法を提供する。 - 特許庁

To provide an information processor capable of writing dirty data onto an external storage even when abnormal termination due to a power failure or the like occurs, and to provide a cache control method.例文帳に追加

停電等の異常終了が発生した際にも、ダーティデータを外部記憶装置に書き込むことができる情報処理装置及びキャッシュ制御方法を提供すること。 - 特許庁

This method comprises a processor 1; a cache memory 11 arranged therein; a processing execution part 2 contained in the processor 1 and comprising a command decoding part/issuing part 5 a register file 6, a prefetch execution control part 7, an external memory control part 8, a cache memory control part 9 and a data processing part 12; and an external memory 10 arranged out of the processor 1.例文帳に追加

プロセッサー１と、内部に配置されたキャッシュメモリー１１と、プロセッサー１に内蔵され、命令解読部／発行部５、レジスターファイル６、プリフェッチ実行制御部７、外部メモリー制御部８、キャッシュメモリー制御部９及びデータ処理部１２からなる処理実行部２と、及びプロセッサー１の外部に配置された外部メモリー１０とで構成する。 - 特許庁

A normal write instruction (write and storage) 11, corresponding to a conventional cache control method and the write instruction 12 for a cache error are respectively prepared as being different instructions in the instruction set 10 of a general purpose processor 1.例文帳に追加

汎用プロセッサ１の命令セット１０中に従来のキャッシュ制御手法に従う通常のライト命令（書込み、ストア）１１と、本発明の一実施例によるキャッシュ制御手法に従うキャッシュ・ミス用ライト命令１２とが夫々別の命令として用意されている。 - 特許庁

To provide a cache system and a cache control method therefor that, when a fault is detected during the execution of a microcode, achieve the improvement of instruction rewrite success rate by writing data contents executed with a microcode preceding the microcode in execution back into a cache memory, in a processor that unwinds an instruction code into the microcodes to execute it.例文帳に追加

命令コードをマイクロコードに展開して実行するプロセッサにおいて、マイクロコード実行中に障害を検出した場合、当該マイクロコードに先行するマイクロコードにより実行されたデータ内容をキャッシュメモリに書き戻す事により、命令リトライ成功率の向上を実現するキャッシュシステムとそのキャッシュ制御方法を提供する。 - 特許庁

To provide a method for realizing read cache control using the space of a buffer memory divided into segments so as to be managed by exclusive hardware.例文帳に追加

本発明の目的は、セグメントで分割管理したバッファメモリの空間を用いたリードキャッシュ制御を専用のハードウェアによって実現することを可能にする手段を提供する事である。 - 特許庁

To provide an information processing system for improving system performance by suppressing reading of unnecessary instructions from an external memory, a cache memory control method, a program and a compiler.例文帳に追加

外部メモリからの不要な命令のリードを抑止することにより、システムの性能を向上することができる情報処理システム、キャッシュメモリの制御方法、プログラム及びコンパイラを提供すること - 特許庁