例文 (313件) |
s gateの部分一致の例文一覧と使い方
該当件数 : 313件
The 'Toriigata (shrine gate shape)' bonfire on Mt. Mandara-yama, Saga Toriimoto, Ukyo Wardi s ignited at 20:20. 例文帳に追加
「鳥居形」(右京区嵯峨鳥居本・曼陀羅山、20時20分点火) - Wikipedia日英京都関連文書対訳コーパス
A gate processing part 57 P generates a gate-processed baseband signal Sδ_B by gate-processing a baseband signal S_B.例文帳に追加
ゲート処理部57Pは、ベースバンド信号S_Bをゲート処理し、ゲート処理後ベースバンド信号Sδ_Bを生成する。 - 特許庁
The gate is then converted to a tapered gate and is given paths going through the bottom gate input(s) that are not timing critical.例文帳に追加
ゲートは次にテーパ付きゲートに変換され、タイミング・クリティカルでない底部ゲート入力を通る経路を与えられる。 - 特許庁
Data are stored in the capacitor connected to the first gate electrode F-GATE, the second gate electrode S-GATE of the pair of gate electrodes is controlled and the data stored in the capacitor are read.例文帳に追加
第1のゲート電極F−GATEに接続した容量にデータを蓄え、一対のゲート電極のうち第2のゲート電極S−GATEを制御して容量に蓄えたデータを読み出す。 - 特許庁
An S/N ratio minimum value residual covariance matrix computing means 2 uses an S/N ratio minimum value to compute a residual covariance matrix independent of a detection data, while a rough gate inside/outside determining means 3 computes a rough gate according to the residual covariance matrix to determine the detection data and the S/N ratio inside the rough gate.例文帳に追加
S/N比最小値残差共分散行列算出手段2は、S/N比最小値を用いて探知データに依存しない残差共分散行列を算出し、粗ゲート内外判定手段3は、残差共分散行列により粗ゲートを算出し、粗ゲート内に入っている探知データとS/N比を判定する。 - 特許庁
An S/D extension 36 is formed after narrowing a line width of the gate hardmask more than that of the gate electrode.例文帳に追加
ゲートハードマスクの線幅をゲート電極よりも狭くした後、S/Dエクステンション36を形成する。 - 特許庁
The gate 46 is formed in the gate opening and raised source/drain(S/D) blocks 40 and 42 are formed in the source/drain openings.例文帳に追加
ゲート開口部にゲート46を形成し、ソース/ドレーン開口部内に隆起ソース/ドレーン(S/D)ブロック40,42を形成する。 - 特許庁
A capacitor C is laid over between the gate assembly point g leading to each gate and the source assembly point s leading to each source.例文帳に追加
各ゲートへ連なるゲート集合点gと各ソースへ連なるソース集合点sとの間にコンデンサCを渡して設ける。 - 特許庁
Then, the molding material injected into the gate 21 and the cavity 23 is solidified to form a molded article S and a gate G.例文帳に追加
そしてゲート21、キャビティ23に射出された成形材料が固化して成形品S、ゲートGが形成される。 - 特許庁
When the sheet S is pushed by the blade 14, the flexible gate members 20, 22 are displaced, and the nip 16 receives the sheet S.例文帳に追加
シートS等がブレード14により押されると可撓性ゲート部材20,22が変位しニップ16がシートS等を受け取れる状態となる。 - 特許庁
Since there is no bottom plate 3 on the under side of each pellet S coming to each hole 20 position, each pellet S is put into the state of being placed on a gate plate 14.例文帳に追加
孔20の位置に来たペレットSの下側には底板3がないから、ペレットSはゲート板14の上に乗った状態になる。 - 特許庁
It’s the oldest temple in Tokyo, and dates back to the 7th century. Its gate is the famous Kaminari-mon.例文帳に追加
東京で最古のお寺で、起源は7世紀にさかのぼります。その寺の門が、有名な雷門です。 - Weblio英語基本例文集
Source/drain regions S/D are provided on the gate electrode 15 on the substrate 11.例文帳に追加
ゲート電極15の両側の基板11にはソース/ドレイン領域S/Dが形成されている。 - 特許庁
To simultaneously attain to the lowering of S/D diffused layer resis tance and the decrease in gate parasitic capacity.例文帳に追加
S/D拡散層抵抗の低減とゲート寄生容量の低減を動じ実現する。 - 特許庁
The flow velocity of the molten metal at the outlet 63a of a gate 63 is adjusted into a range of 5 to 15 m/s.例文帳に追加
ゲート63の出口63aでの溶湯の流速は、5m/s〜15m/sの範囲に設定される。 - 特許庁
The inner space of the treatment container 2 comprises a treatment space S in which the semiconductor wafer W is arranged and a gate space G extending between the treatment space S and a gate valve 16 in a view from outside.例文帳に追加
処理容器2の内部空間は、半導体ウェハWが配置される処理空間Sと、外部からみて処理空間Sとゲートバルブ16との間に延在するゲート空間Gとを含む。 - 特許庁
The inverter 21 includes i (i is an integer of one or more) PMOS transistor(s) having a gate electrode G1 and j (j is an integer of zero or more) PMOS transistor(s) having a gate electrode G2.例文帳に追加
インバータ21は、ゲート電極G1を有するi(iは1以上の整数)個のPMOSトランジスタ及びゲート電極G2を有するj(jは0以上の整数)個のPMOSトランジスタを有する。 - 特許庁
Besides the aforementioned, the inverter 21 includes m (m is an integer of one or more) NMOS transistor(s) having a gate electrode G3 and n (n is an integer of zero or more) NMOS transistor(s) having a gate electrode G4.例文帳に追加
また、インバータ21は、ゲート電極G3を有するm(mは1以上の整数)個のNMOSトランジスタ及びゲート電極G2を有するn(nは0以上の整数)個のNMOSトランジスタを有する。 - 特許庁
When the voltage of a gate line AG_i is changed from a potential c that is lower than the potential (a) to a potential d that is higher than the potential, an accumulation gate G_S is transferred with a prescribed amount of charge from the data line VD_j and accumulates it.例文帳に追加
蓄積ゲートG_Sは、ゲート線AG_iの電圧が、電位aよりも低い電位cから電位よりも高い電位dに変化した時に、VD_jから一定量の電荷を転送されて蓄積する。 - 特許庁
In each of a source side assist gate line (AGS) and a drain side assist gate line (AGD), contacts for supplying voltage (AGS_D, AGS_S, AGD_D, AGD_S) are provided at the drain side and the source side.例文帳に追加
ソース側アシストゲート線(AGS)およびドレイン側アシストゲート線(AGD)それぞれにおいて、ドレイン側およびソース側に電圧供給用のコンタクト(AGS_D,AGS_S,AGD_D,AGD_S)を設ける。 - 特許庁
When the voltage of a gate line TG_i is changed from a potential e that is lower than the potential c to a potential f that is higher than the potential c, a transfer gate G_T transfers the accumulated charge to retention volume C_S to make the retention volume retain it.例文帳に追加
転送ゲートG_Tは、ゲート線TG_iの電圧が、電位cよりも低い電位eから電位cよりも高い電位fに変化した時に、上記の蓄積電荷を保持容量C_Sに転送して保持させる。 - 特許庁
A control signal /S(0,0) is applied to a gate of the PMOS TR T13 and an inverse of the control signal /S(0,0) is applied to a gate of the NMOS TR T14.例文帳に追加
PMOSトランジスタT13のゲートには制御信号/S(0,0)が、NMOSトランジスタT14のゲートには制御信号/S(0,0)の反転信号が接続される。 - 特許庁
The depth of a p-base region, between R-S which corresponds to the circular-arc section of the gate electrode 38, is shallower than the depth of a p-base region between Q-R which corresponds to the linear section of the gate electrode 38 in cross-section configurations in cutting-plane lines Q-R-S passing the gate electrode 38.例文帳に追加
ゲート電極38を通る切断線Q−R−Sにおける断面構成において、ゲート電極38の弧状部分に対応するR−S間のpベース領域の深さは、ゲート電極38の直線状部分に対応するQ−R間のpベース領域の深さよりも浅い。 - 特許庁
Each S/N ratio residual covariance matrix computing means 4 computes a sampling time, an amount of the detection data, and a residual covariance matrix depending on the number of tracks, while a fine gate inside/outside determining means 5 computes a fine gate to determine the detection data and the S/N ratio within the fine gate.例文帳に追加
各S/N比残差共分散行列算出手段4は、サンプリング時刻、探知データ数、航跡数に依存する残差共分散行列を算出し、精ゲート内外判定手段5は、精ゲートを算出して、精ゲート内に入っている探知データとS/N比を判定する。 - 特許庁
The ion sensor is comprises an ion responsive field effect transistor (ISFET) 10, having a gate electrode for taking out the back gate photocurrent Ibp generated in between a back gate B and a source S and between the back gate B and the drain D, and photocurrents Isp and Idp generated in the source S or the drain D are corrected by using the back gate photocurrent Ibp.例文帳に追加
バックゲートBとソースSとの間、およびバックゲートBとドレインDとの間に発生するバックゲート光電流Ibpを取り出すためのゲート電極Gを持つイオン感応性電界効果トタンジスタ(ISFET)10よりなるイオンセンサであって、バックゲート光電流Ibpを用いて、ソースSやドレインDにおいて発生する光電流Isp,Idpを補正することを特徴とする。 - 特許庁
A gate electrodes GM are formed on a silicon substrate 1 via a gate insulating film 4, and a source region S and a drain region D are provided between the gate electrodes GM.例文帳に追加
シリコン基板1にゲート絶縁膜4を介してゲート電極GMが形成され、ゲート電極GMの間にソース領域S、ドレイン領域Dが設けられる。 - 特許庁
A sub-gate electrode 152 is formed so as to be isolated from the main gate electrode 151 in the extended direction of the main gate electrode 151, and the source/drain area S/D is formed in the same way.例文帳に追加
主ゲート電極151の延長方向に主ゲート電極151から離間した副ゲート電極152が形成され、同様にソース/ドレイン領域S/Dが形成されている。 - 特許庁
The thin film transistor has a semiconductor thin film PSI and a pair of gate electrodes F-GATE and S-GATE for clamping the semiconductor thin film PSI from above and below through insulating films 1GOX and 2GOX.例文帳に追加
薄膜トランジスタは、半導体薄膜PSIと、絶縁膜1GOX,2GOXを介して半導体薄膜PSIを上下から挟む一対のゲート電極F−GATE、S−GATEとを有する。 - 特許庁
The gate oscillator 201 produces an oscillation signal in accordance with a control signal S_ctrl, and arranges an edge of the oscillation signal and an edge of a gate signal SG after receiving the gate signal SG.例文帳に追加
ゲート発振器201は、制御信号S_ctrlに従って発振信号を生成し、ゲート信号SGを受信して、発振信号のエッジとゲート信号SGのエッジを配列させる。 - 特許庁
The gate structure is constructed so that at least part of it consists of silicide films 7 and 12, and the gate wiring 5's silicide film 12 has a film thickness thicker than that of the silicide film 7 of the gate electrode 4.例文帳に追加
ゲート構造は少なくとも一部はシリサイド膜7、12からなり、且つゲート配線5のシリサイド膜12の膜厚がゲート電極4のシリサイド膜7の膜厚より厚く構成されている。 - 特許庁
When the bag-binding part S is inserted in the guide passage 31 and pressed against the gate 35, the affixed adhesive tape 2 is passed through the gate in a tensile state while the gate 35 is displaced in the retracted positional direction.例文帳に追加
袋束ね部Sをガイド通路31に挿入しゲート35に対して押し付けると、貼り付いた粘着テープ2を引っ張りながら、ゲート35を引込位置方向へ変位させて当該ゲートを通過する。 - 特許庁
A start gate, a stop gate and an electric length of the combination are identified, and a time response of only a representative portion of the uniform transmission line wherein the connectivity system is separated from the start gate and the stop gate is selected (1503) and is inversely converted into the s parameter (1504, 1506).例文帳に追加
つぎに該組み合わせの、開始ゲート、停止ゲート、電気長を同定し、開始ゲートと停止ゲートから接続システムを分離した一様伝送線路の代表部分だけの時間応答を選出し(1503)、sパラメータに逆変換する(1504、1506)。 - 特許庁
To provide a gate insulating film suitable to an insulated-gate type transistor, which is represented by a TFT, and the forming method of the gate insulating film and to make it possible to ensure the stability and reliability of the characteristics, such as a Vth and a value S, of the TFT using such the gate insulating film.例文帳に追加
TFTに代表される絶縁ゲート型トランジスタに適したゲート絶縁膜、及びその作製方法を提供し、そのようなゲート絶縁膜を用いTFTのVthやS値などの特性の安定性及び信頼性を確保することを目的とする。 - 特許庁
A light emitting element array chip 1 is configured of switching thyristors S, n light emission inhibition parts D and n gate lateral wires GH which are individually connected to gate electrodes gs of the switching thyristors S and a plurality of light emitting thyristors T wherein the N-th gate gt is connected to any one of the n gate lateral wires GH.例文帳に追加
スイッチ用サイリスタSと、スイッチ用サイリスタSのゲート電極gsに個別に接続されるn個の発光禁止部Dおよびn本のゲート横配線GHと、n本のゲート横配線GHのうちのいずれか1つとNゲートgtが接続される複数の発光用サイリスタTとを含んで発光素子アレイチップ1を構成する。 - 特許庁
This renovation started in the middle of the eleventh century and ended with reconstruction of the Nandai-mon Gate in the 1160's with many temple buildings in the precincts repaired or renovated. 例文帳に追加
この修造は、11世紀中頃から1160年代の南大門再建まで続き、境内の堂宇の多くが修理修造された。 - Wikipedia日英京都関連文書対訳コーパス
About five million euros (about 840 million yen) were donated for the gate’s restoration and top craftsmen and history experts were called in. 例文帳に追加
この門の復元のために約500万ユーロ(約8億4000万円)が寄付され,一流の職人や歴史専門家が呼ばれた。 - 浜島書店 Catch a Wave
Metal oozing from the gate electrode 5 to the drain electrode 1 side along the interface S can be intercepted by the groove 50.例文帳に追加
ゲート電極5から界面Sを伝ってドレイン電極1側へ染み出した金属を、溝50によって、堰き止めることができる。 - 特許庁
A diffusion layer S/D for use as a source or drain region is formed in the semiconductor substrate 11 corresponding to both sides of the floating gate FG.例文帳に追加
浮遊ゲートFGの両側に対応する半導体基板11内にソース又はドレイン領域としての拡散層S/Dが形成されている。 - 特許庁
Ions are injected into the polysilicon layer adjacent to the gate electrode to form a raised S/D area 30.例文帳に追加
ゲート電極に隣接するポリシリコン層にイオン注入し、隆起したS/D領域30を形成する。 - 特許庁
A resistor 42 for discharging is connected between the cathode of the Zener diode 58 and the gate of the power switching element S.例文帳に追加
ツェナーダイオード58のカソード及びパワースイッチング素子Sのゲート間には、放電用抵抗体42が接続されている。 - 特許庁
A source S and a drain D comprising an N type impurity region are provided in the semiconductor region 11 in the vicinity of both sides of the gate electrode 13.例文帳に追加
ゲート電極13両側近傍の半導体領域11にN型の不純物領域で構成されるソースS、ドレインD設けられている。 - 特許庁
Source/drain diffusion layers S, D are formed within the supporting board so as to sandwich a channel region under the first part of the gate electrode.例文帳に追加
ソース/ドレイン拡散層S、Dは、ゲート電極の第1部分の下方のチャネル領域を挟むように支持基板内に形成される。 - 特許庁
A high speed address sequencer can generate all address signals for s short time by reducing the number of gate delay.例文帳に追加
ゲート遅延の数を減少することにより、上記高速アドレス・シーケンサは短い時間内で全てのアドレス信号を生成し得る。 - 特許庁
As a result, the values of the gate voltage V_g and source voltage V_s immediately before beginning of the second Vth correction are suppressed low.例文帳に追加
その結果、2回目のVth補正を始める直前のゲート電圧V_gおよびソース電圧V_sの値が低く抑えられる。 - 特許庁
In a write period Pwrt, the voltage at the gate G0 is set corresponding to a data voltage Vdata by supplying a data signal S[j] to the electrode E2.例文帳に追加
書込期間Pwrtにおいては電極E2に対するデータ信号S[j]の供給によってゲートG0の電圧がデータ電圧Vdataに応じて設定される。 - 特許庁
Plural page buffers P/B are connected to a sense amplifier S/A.0 in a read-out/write-in circuit through a column gate.例文帳に追加
複数個のページバッファP/Bは、カラムゲートを経由して、読み出し/書き込み回路内のセンスアンプS/A・0に接続される。 - 特許庁
The total area S of the region opposed to the gate electrode 74 of the TFT element 7 of each polysilicon layer 71 is 3,000 μm^2 or less.例文帳に追加
各ポリシリコン層71のうちTFT素子7のゲート電極74と対向する領域の合計面積Sは3000μm^2以下である。 - 特許庁
Hence, the total surface area and the total perimeter length of gate electrodes of all transistors which were installed in the standard cell S are expanded.例文帳に追加
これにより、スタンダードセルS内に備える全てのトランジスタのゲート電極の総表面積や総周辺長が拡大する。 - 特許庁
例文 (313件) |
本サービスで使用している「Wikipedia日英京都関連文書対訳コーパス」はWikipediaの日本語文を独立行政法人情報通信研究機構が英訳したものを、Creative Comons Attribution-Share-Alike License 3.0による利用許諾のもと使用しております。詳細はhttp://creativecommons.org/licenses/by-sa/3.0/ および http://alaginrc.nict.go.jp/WikiCorpus/ をご覧下さい。 |
Copyright © Japan Patent office. All Rights Reserved. |
Copyright © 1995-2024 Hamajima Shoten, Publishers. All rights reserved. |
電網聖書はパブリック・ドメインに置かれます。電網聖書は,The World English Bible (WEB)を土台とした新しい日本語訳です。この草稿は2002年3月3日版です。 The World English Bible is dedicated to the Public Domain. |
ログイン |
Weblio会員(無料)になると 検索履歴を保存できる! 語彙力診断の実施回数増加! |
ログイン |
Weblio会員(無料)になると 検索履歴を保存できる! 語彙力診断の実施回数増加! |