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Weblio 辞書 > 英和辞典・和英辞典 > check bitsに関連した英語例文

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check bitsの部分一致の例文一覧と使い方

該当件数 : 73



例文

One ECC block (103) is used to generate check bits and syndrome bits.例文帳に追加

1つのECCブロック(103)が、チェックビットとシンドロームビットを生成するために使用される。 - 特許庁

Parity bits are punctured in order with the small column weight of a parity check matrix corresponding to the individual parity bits.例文帳に追加

個々のパリティビットに対応する、パリティ検査行列の列重みが小さい順にパリティビットをパンクチャする。 - 特許庁

, is superuser),POSIX.1-2001 permits implementation to indicate success for an X_OK check even if none of the execute file permission bits are set. 例文帳に追加

のチェックとして成功を返す実装が認められている。 - JM

Won't you let me check if there aren't bits of plant sticking to your shoes?例文帳に追加

靴に植物片が付着していないかn調べさせてもらえませんか? - 映画・海外ドラマ英語字幕翻訳辞書

例文

An error detection part 3 confirms parity bits and control bits when confirmation of data matching is completed, executes parity check and control bit check based on the bits to detect an error of the instruction signal.例文帳に追加

エラー検出部3は、データ一致の確認が完了すると、パリティビットとコントロールビットを確認し、これらのビットに基づくパリティチェックとコントロールビットチェックを実行して、指令信号のエラーを検出する。 - 特許庁


例文

A right shift by n bits is equivalent to division by pow(2, n) without overflow check.例文帳に追加

n ビットの右シフトは、オーバフローチェックを行わないpow(2, n) による除算と等価です。 - Python

The attribute bits are used to check the memory state of an address used by the program.例文帳に追加

この属性ビットを用いてプログラムが使用するアドレスのメモリ状態をチェックする。 - 特許庁

A left shift by n bits is equivalent to multiplication by pow(2, n) without overflow check.例文帳に追加

n ビットの左シフトは、オーバフローチェックを行わないpow(2, n) による乗算と等価です。 - Python

A total bit check section 220 outputs total bit check data based on exclusive ORs of all the bits of the coded data I.例文帳に追加

全ビット検査部220は、符号化データIの全ビットの排他的論理和に基づく全ビット検査データを出力する。 - 特許庁

例文

To provide an encoding device for cyclic redundancy check that can revise the number of protection object bits for cyclic redundancy check and the number of bits for redundancy check for each transmission frame depending on a transmission line error rate.例文帳に追加

伝送路誤り率に応じて、巡回冗長検査用の保護対象ビットと冗長検査用のビット数を伝送フレーム毎に変更することができる冗長検査用の符号化装置を提供すること。 - 特許庁

例文

A data encoding section 12a adds the check bits having the number of bits determined by the check bit count determining section 14 to transmission data DSD and then encodes the transmission data DSD.例文帳に追加

データ符号化部12aは、チェックビット数決定部14で決定されたビット数を有するチェックビットを送信データDSDに付加して、当該送信データDSDを符号化する。 - 特許庁

A parity check is made to bit data related to the parity bits and type information bits read by a type reading section 4, and the packages are transferred based on the bit data that has passed the parity check.例文帳に追加

品種読取部4で読み取られた品種情報ビットおよびパリティビットに係るビットデータに対してパリティチェックを行い、パリティチェックを通過したビットデータに基づいてパッケージを移載する。 - 特許庁

Higher n+1 bits of the data for A bits inputted to the data storage device 1 are inputted to a continuous bit detecting circuit 13, to check whether bits of the same value are continued.例文帳に追加

データ記憶装置1に入力されたAビットのデータの上位n+1ビットが連続ビット検出回路13に入力され、同じ値のビットが連続しているか否かがチェックされる。 - 特許庁

Higher n+1 bits of the data of A bits inputted to the multiplier 1 are inputted to a continuous bit detecting circuit 13 to check as to whether bits of the same value are continued.例文帳に追加

乗算装置1に入力されたAビットのデータの上位n+1ビットが連続ビット検出回路13に入力され、同じ値のビットが連続しているか否かがチェックされる。 - 特許庁

The lifted parity check matrix H may be used to encode a packet of up to L k_B information bits to obtain a codeword of L n_B code bits.例文帳に追加

そのリフトされたパリティチェック行列Hは、L・n_B個のコードビットを得るために、L・k_B個までの情報ビットのパケットを符号化するために用いられても良い。 - 特許庁

The lifted parity check matrix H may be used to encode a packet of up to L k_B information bits to obtain a code bit of L n_B code bits.例文帳に追加

そのリフトされたパリティチェック行列Hは、L・n_B個のコードビットを得るために、L・k_B個までの情報ビットのパケットを符号化するために用いられても良い。 - 特許庁

Also, this method may include a step to embed check bits for detecting an error in the color palette data.例文帳に追加

また,エラーを検出するためのチェックビットをカラーパレットデータに埋め込む段階をさらに含んでいてもよい。 - 特許庁

The transfer block cyclic redundancy check can also be calculated based on all of the information bits.例文帳に追加

また、転送ブロックサイクリックリダンダンシーチェックは、すべての情報ビットに基づいて計算されることができる。 - 特許庁

Plural composite check bits are used for detecting the bit position of a bit error in the composite sub-block.例文帳に追加

複数の複合チェックビットは、複合サブブロック内のビットエラーのビット位置を検出するために使用される。 - 特許庁

To monitor even the fault of wrong storage address in a FIFO memory simultaneously with a parity check without increasing areas for check bits.例文帳に追加

FIFOメモリに関してパリティ検査と同時にメモリ内の収容アドレスを誤る障害についても、検査ビット用領域を増やさずに監視できるようにする。 - 特許庁

A check sum 15 includes a space of bits of the number correspond to the bits of each data slice and each bit of each of the data slice has a position in the order of the bit.例文帳に追加

チェックサム15は、データスライスそれぞれにおけるビット数に対応するビット数の空間を含み、該各データスライスにおける各ビットはビットの順序における位置を有している。 - 特許庁

No error correction function for correcting the pattern of bit error is required in the check data to reduce the number of bits of the check data C.例文帳に追加

この結果、上記パターンのビットエラーを訂正するためのエラー訂正機能をチェックデータに組み込まなくとも良くなるので、チェックデータCのビット数を少なくすることができる。 - 特許庁

A check bit count determining section 14 determines the number of bits of the check bit for error correction based on the communication quality information CQ acquired by the information acquiring section 13.例文帳に追加

チェックビット数決定部14は、情報取得部13で取得された通信品質情報CQに基づいて、誤り訂正用のチェックビットのビット数を決定する。 - 特許庁

The ECC circuit 103 executes encoding processing and decoding processing in parallel in 8 bits wherein 4224 bits being 8 times 528 bits used for a unit of writing and reading applied to one memory cell area 101j are adopted for an information bit length and one check bit ECC in 40 bits are assigned to the data.例文帳に追加

ECC回路103は、1つのメモリセルエリア101jに対する書き込み及び読み出しの単位となる528ビットの8倍の4224ビットを情報ビット長として1つの40ビットの検査ビットECCを割り当て、符号化処理及び復号処理を8ビットで並列に実行する。 - 特許庁

To reduce delay and power consumption by reducing the size of circuitry generating check bits and syndromes.例文帳に追加

チェックビットの生成および症候群発生のための回路の量を少なくし、遅延及び所要電力をを小さくする。 - 特許庁

To reduce the number of check bits necessary for correcting an error in a data block including plural sub-blocks.例文帳に追加

複数のサブブロックを含んでいるデータ・ブロック内のエラーを訂正するために必要なチェックビットの数を少なくすること。 - 特許庁

To calculate each check bit, a specific subset to the data bits is assigned, and two bits of the data block are transferred through each data bus.例文帳に追加

拡張チェック・ビットを使用せずに、シンドローム・ビット・ベクトルの値を使用して、データ・ブロック内で発生した単一ビットのエラーを検出して訂正し、対になった二重ビットのエラーを検出する。 - 特許庁

A receiver 2 performs CRC detection processing for a bit train obtained by inverting the logic of respective bits corresponding to the CRC bits out of reproduced bit train by a CRC check part 26d.例文帳に追加

受信装置2では、再生されたビット列のうちのCRCビットに相当する各ビットの論理を反転したビット列についてCRCチェック部26dでCRC検出処理を行う。 - 特許庁

Further, each of the bits of the check sum 15 is determined by exclusively ORing all bits at the same positions in the order of the bits of the data slice and then information which is enough to correct the data slice having a multi-bit error is provided for the check sum 15.例文帳に追加

また、チェックサム15の各ビットは、前記データスライスそれぞれのビットの順序において同じ位置にあるすべてのビットに排他的論理和演算を行うことにより決定され、それによって、複数ビット誤りを有するデータスライスの訂正を可能にするのに十分な情報をチェックサム15に提供する。 - 特許庁

The transmitter (10) sorts coded bits generated by using the LDPC (Low Density Parity Check) code according to a degree of a variable node of an inspection matrix of the LDPC codes and groups the sorted coded bits into a plurality of groups according to the modulation system in use.例文帳に追加

本発明の送信装置(10)は、LDPC(Low Density Parity Check)符号を用いて生成された符号化ビットをLDPC符号の検査行列の変数ノードの次数に従ってソートし、ソートされた符号化ビットを、使用する変調方式に従って複数のグループにグループ化する。 - 特許庁

When new data is written to a register circuit 1, noise protection is performed by reading data including redundant bits stored in the register circuit 1, performing parity check based on the redundant bits concerned and permitting write of new data only when the check result is normal.例文帳に追加

レジスタ回路1に対する新しいデータの書き込み時、レジスタ回路1に記憶された冗長ビットを含むデータを読み出し、当該冗長ビットに基づくパリティチェックを行い正常時のみ新しいデータの書き込みを許可することで、ノイズに対するプロテクトを行う。 - 特許庁

The semiconductor memory has a function to divide a page in the memory cell array into a plurality of e segments and to check the presence of fail bits for each segment in block.例文帳に追加

メモリセルアレイ内のページを複数のセグメントに分割し、各セグメント毎にフェイルビットの存否を一括検知する機能を具備する。 - 特許庁

A frame data number adjustment section 42 adjusts the number of parity bits in the input data in accordance with the modified size of the check matrix.例文帳に追加

フレームデータ数調節部42は、変更した検査行列のサイズに応じて、入力したデータのうち、パリティビットの数を調節する。 - 特許庁

The control information, comprising Data 1 of arm position data low 8 bits, Data 2 including arm position data high 1 bit and wiper operation mode 6 bits, Data 3 including motor control sequence 6 bits, and Data 4 of check sum, bi-directionally reduces the communication data to 8 bytes.例文帳に追加

制御情報は、アーム位置データ下位8ビットのData1と、アーム位置データ上位1ビットとワイパ動作モード6ビットを含むData2と、モータ制御シーケンス6ビットを含むData3と、チェックサムのData4からなる4バイトデータからなり、通信データを双方向で8バイトに低減させる。 - 特許庁

Next, the CPU 32 sets 2nd addresses obtained by changing the logical value of each check object bit as many as the number of check object bits and writes 2nd data being different from the 1st data in each of the addresses.例文帳に追加

次に、CPU32は、各チェック対象ビットの論理値を変化させた第2のアドレスをチェック対象ビットの数だけ設定して、それぞれのアドレスに第1のデータとは異なる第2のデータを書き込む。 - 特許庁

In the case of transmitting data from the wireless device, the data with a check sum attached to them are transmitted, where total number of bits of an ID, the data and the check sum gives a prescribed value.例文帳に追加

ワイヤレス機器から送信データを送信する場合、送信データとして、送信すべきデータに、IDと送信すべきデータとチェックサムとの総和が所定の値となる上記チェックサムを付加したものを送信する。 - 特許庁

To eliminate the necessity of a reference check sum value, to simultaneously detect errors up to three bits of stored data and to easily judge the existence of an error.例文帳に追加

基準チェックサム値を不要とし、記憶されているデータの3ビットまでのエラーを同時に検出でき、かつ、エラーの有無の判別を容易にする。 - 特許庁

The information bit storage memory 121 reads bits according to the parity check matrix of an LDPC code out of each bit of the stored input data D121 based on a control signal D125 supplied from a control signal generation section 124 and supplies the bits as information bits D122-1 to D122-7 to a computing unit 122.例文帳に追加

情報ビット格納メモリ121は、制御信号生成部124から供給される制御信号D125に基づいて、格納している入力データD121の各ビットのうちの、LDPC符号の検査行列にしたがったビットを読み出し、情報ビットD122-1乃至D122-7として、演算器122に供給する。 - 特許庁

A base parity check matrix G of dimension m_B×n_B may be used to encode a packet of up to k_B=n_B-m_B information bits to obtain a coded packet or a codeword of n_B code bits.例文帳に追加

ディメンションm_B×n_Bの基本パリティチェック行列Gは、n_B個のコードビットの符号化されたパケット又はコードワードを得るために、k_B=n_B−m_B個までの情報ビットのパケットを符号化するために用いられても良い。 - 特許庁

For a check on the content of the control register 11 in the core part 10, the switching signal TST selects the lower eight bits of the 32-bit data.例文帳に追加

また、コア部10内の制御レジスタ11の内容をチェックする場合は、切替信号TSTによって32ビットのデータの下位8ビットを選択する。 - 特許庁

The check bit is used to make sure that every valid character in a computer that uses even parity will always have an even number of 1 bits 例文帳に追加

検査ビットを使う目的は,(たとえば)偶数パリティ方式のコンピュータの内部で,正当な文字には一つのビットが常に偶数個あることを確認することである - コンピューター用語辞典

The error-correcting code is defined by a parity check matrix in which columns represent variable bits and rows represent parity bit, and represented as a bipartite graph having two parts.例文帳に追加

誤り訂正符号は、列が変数ビットを表わし、行がパリティビットを表わすパリティ検査行列によって定義し、2部グラフとして表わされる。 - 特許庁

A code word 11 for angle measurement expressed by slits arranged in the circumferential direction of the disk includes a code word 18 for angle information consisting of (10, 6) abbreviated hamming code having six angle information bits 12 showing angle information and four check bits 14 for detecting and correcting a reading error of the angle information bits.例文帳に追加

ディスクの周方向に沿って配置されたスリットにより表わされる測角用符号語11は、角度情報を表わす6ビットの角度情報ビット12、角度情報ビットの読み誤りを検出して訂正する4ビットの検査ビット14からなる(10,6)短縮ハミング符号からなる角度情報用符号語18を含む。 - 特許庁

An error code correcting system consisting of 64 bits data bit and 9 bits check bit with respect to a memory array ARY such as a DRAM is introduced, for instance, and an error correction code circuit ECC according to the above arrangement is disposed adjacent to a sense amplifier column SAA.例文帳に追加

例えば、DRAMなどのメモリアレイARYに対して、64ビットのデータビットと9ビットのチェックビットからなる誤り符号訂正方式を導入し、これに伴う誤り訂正符号回路ECCをセンスアンプ列SAAに隣接して配置する。 - 特許庁

Specifically, they are implemented as a subroutine to execute a check processing of each bit of each port of a plurality of input ports and a subroutine to execute data output to each bit or a group of a plurality of bits (8 bits, for example) of a plurality of output ports.例文帳に追加

具体的は、複数ある入力ポートの各ポートの各ビットのチェック処理を行うサブルーチンと、複数ある出力ポートの各ビットまたはまとまった複数ビット(例えば8ビット)に対するデータ出力を行うサブルーチンとして実現される。 - 特許庁

A left shift by n bits is defined as multiplication with pow(2,n); for plain integers there is no overflow check so in that case the operation drops bits and flips the sign if the result is not less than pow(2,31) in absolute value.例文帳に追加

n ビットの左シフトは、pow(2,n) による乗算として定義されています; 整数の場合、桁あふれ (overflow) のチェックはされないので、演算によって末端のビットは捨てられます。 また、結果の絶対値がpow(2, 31) よりも小さくない場合には、符号の反転が起こります。 - Python

To provide a decoding apparatus capable of efficiently decoding at all times by generating a proper update schedule independently of the structure of the parity check matrix and a receiving probability of coded bits.例文帳に追加

適切な更新スケジュールを作成し、パリティ検査行列の構造や符号ビットの受信確率によらず、常に効率良く復号できる復号装置を提供する。 - 特許庁

Then all bits obtained by scanning are inspected for reliability check, allowing one fault identifier (F) to be assigned to each of one bit recognized as unreliable.例文帳に追加

走査によって得られた全てのビットが、信頼性を検査するために検査され、1つの誤り識別子(F)が、信頼できないと認識された1つのビットに割り当てられる。 - 特許庁

The recording and reproducing device of the decreased decoding errors is made possible by repeating the procedures of forming check bits for error correction and recording the same in combination with the result of decoding in recording reproduction data and calculating reliability simultaneously with the result of decoding and correcting the decoding errors in decoding by using the reliability and check bits.例文帳に追加

再生データを記録するに際し、誤り訂正用のチェックビットを生成して、情報データと併せて記録し、復号するに際しては、復号結果と同時に信頼度を算出し、信頼度とチェックビットを用いて復号誤りを訂正するという手順を繰り返すことにより、復号誤りの少ない記録再生装置を可能とした。 - 特許庁

例文

The expansion-contraction bit is constituted in such a manner that the fluid injection paths are secured to each of the bits and the bit body while check valves are set up into each fluid injection path, and the check valves are opened and closed at pilot pressure with fluid injection.例文帳に追加

また、前記ビット及びビットボディのそれぞれに流体噴射路を設けるとともに、それぞれの流体噴射路内に逆止弁を設け、流体噴射に伴うパイロット圧力により前記逆止弁を開閉するよう構成した。 - 特許庁




  
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