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Weblio 辞書 > 英和辞典・和英辞典 > core IPに関連した英語例文

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core IPの部分一致の例文一覧と使い方

該当件数 : 67



例文

IP CORE AND COMPLEX IP CORE例文帳に追加

IPコア及び複合IPコア - 特許庁

The UE is connected to the core network through the FAP and the broadband IP network.例文帳に追加

UEがFAPおよびブロードバンドIPネットワークを介してコアネットワークに接続する。 - 特許庁

Then, at forming of the functional blocks IP 1 and IP 2, the wiring data M4I and M4S of the common IP core IP a are selectively used.例文帳に追加

そして、機能ブロックIP1,IP2を形成する際に、共通IPコアIPaの配線データM4I,M4Sを選択的に用いる。 - 特許庁

The wireless communication system includes a core network, a broadband IP network, an FAP and at least one piece of user equipment (UE).例文帳に追加

無線通信システムがコアネットワークとブロードバンドIPネットワークとFAPと少なく1つのユーザー装備(UE)を含む。 - 特許庁

例文

To surely manage the number of times of use of an IP core for FPGA provided by an IP vender.例文帳に追加

IPベンダーが提供したFPGA向けIPコアの使用回数が確実に管理できるようにする。 - 特許庁


例文

Thus, the common IP core IP a is utilized for forming the two functional blocks IP 1 and IP 2 of different types corresponding to the specifications of a product.例文帳に追加

こうすることで、1つの共通IPコアIPaを、製品の仕様に応じたタイプの異なる2つの機能ブロックIP1,IP2の形成に利用できるようになっている。 - 特許庁

An association of the bearer, the core network IP address and the LAN IP address is stored in an initial table (table 0).例文帳に追加

ベアラと、コアネットワークIPアドレス及びLAN IPアドレスとの関連付けが、初期テーブル(テーブル0)内に格納される。 - 特許庁

A path management server 25 manages path information in the IP core network 20.例文帳に追加

経路管理サーバ25は、IPコア網20における経路情報を管理する。 - 特許庁

REFERENCE VOLTAGE GENERATION CIRCUIT AND IP CORE HAVING THE REFERENCE VOLTAGE GENERATION CIRCUIT例文帳に追加

基準電圧発生回路、該基準電圧発生回路を具備したIPコア - 特許庁

例文

The method for indirectly simulating a semiconductor integrated circuit forms a circle chain by using input pins and output pins to provide an IP core model that substitutes for a real IP core circuit, generates a test bench for the IP core model and simulates the integration of the semiconductor integrated circuit including the IP core model by using the generated test bench.例文帳に追加

半導体集積回路の間接シミュレーション方法は、入力及び出力ピンでサークルチェーンを構成して実際コアIP回路に代わるコアIPモデルを提供し、コアIPモデルに対するテストベンチを生成し、生成されたテストベンチを用いてコアIPモデルが含まれた半導体集積回路のインテグレイションをシミュレーションする。 - 特許庁

例文

In the case of testing the functions of an IP core 34, test signals are supplied for the IP core 34 via a selector 42, and its output signals are transferred to the signal checker 45.例文帳に追加

IPコア34の機能試験を行う場合には、試験信号をセレクタ42を介してIPコア34に供給し、その出力信号を信号チェック器45に転送する。 - 特許庁

A test pattern data is input into a data input of the IP core 12, an output data output from a data output of the IP core 12 is compared with an expected value for the test pattern data, and the power source noise resistance is inspected when testing a function of the IP core 12.例文帳に追加

IPコア12のデータ入力にはテストパターンデータが印加され、IPコア12のデータ出力から出力される出力データとテストパターンデータに対する期待値と比較してIPコア12のファンクションテスト時に電源ノイズ耐性の検査を行う。 - 特許庁

In the case of testing the connection between the IP cores 32 and 33, test signals are supplied for the IP core 32 via the selector 40, and signals of a normal signal input terminal of the IP core 33 are transferred to the signal checker 45.例文帳に追加

IPコア32、33間の接続試験を行う場合には、試験信号をセレクタ40を介してIPコア32に供給し、IPコア33の通常信号入力端子の信号を信号チェック器45に転送する。 - 特許庁

In the case of testing the functions of an IP core 33, test signals are supplied for the IP core 33 via a selector 41, and its output signals are transferred to the signal checker 45.例文帳に追加

IPコア33の機能試験を行う場合には、試験信号をセレクタ41を介してIPコア33に供給し、その出力信号を信号チェック器45に転送する。 - 特許庁

To enable an IP designer to easily design ROM-integrated MPU soft IP, and an MPU core IP user to enter ROM program data of programmed size.例文帳に追加

IP設計者が容易にROM内蔵MPU(Micro Processor Unit)ソフトIPを設計し、MPUコアIP使用者もプログラムされた大きさと同一のROMプログラムデータ(ROM program data)を入れることを可能とすること。 - 特許庁

AWT's standard products include IP Cores, ASICs, and board level products in the fields of demodulation, forward error correction, and encryption decryption. 例文帳に追加

AWTの代表的な製品としては、変調復元、フォワードエラー訂正や暗号の複合などの分野における IP Core、 ASICs, 基板レベルの製品などがある。 - Electronic Frontier Foundation『DESのクラック:暗号研究と盗聴政策、チップ設計の秘密』

METHOD OF SIGNALING QOS INFORMATION AT HAND-OVER BETWEEN ACCESS NETWORKS IN IP-BASED CORE NETWORK例文帳に追加

IP基盤ネットワークにおけるアクセスネットワーク間のハンドオーバー時のQoS情報シグナリング方法 - 特許庁

The individual sub-IPs 302 within the IP core 301 are connected to each other via a local bus 304.例文帳に追加

IPコア301内の各サブIP302は、ローカルバス304を介して相互に接続される。 - 特許庁

To perform estimation of a communication quality deterioration zone with high readiness without being restricted to an IP core network.例文帳に追加

IPコア網に限定されることなく即応性の高い通信品質劣化区間の推定を行う。 - 特許庁

To provide a method and an apparatus for indirectly simulating a semiconductor integrated circuit capable of simulating the integration of the semiconductor integrated circuit including a real IP (intellectual property) core circuit by using an IP core model.例文帳に追加

コアIPモデルを用いて実際コアIP回路を含む半導体集積回路のインテグレイションをシミュレーションすることができる半導体集積回路の間接シミュレーション方法及び間接シミュレーション装置を提供する。 - 特許庁

The 4G access point type communication system is provided with the 4GAP including a communication means with a user equipment 1, and a communication means with an external IP network using servers 21 and the IP, and the external IP network comprises an IMS core network and an application server 4.例文帳に追加

ユーザ端末との通信手段とサーバ及びIPによる外部IPネットワークとの通信手段を備えた4GAPを設け,外部IPネットワークはIMSコアネットワークとアプリケーションサーバとで構成される。 - 特許庁

The IP sec device 1 sets a number 102 of its own core for processing in the first IKE data, and transmits them.例文帳に追加

IPsec装置1は一番目のIKEデータに自身の処理用コアの番号102を設定し送信する。 - 特許庁

A Session Initiation Protocol/Internet Protocol core network is employed including the SIP/IP based PTT network server.例文帳に追加

セッション開始プロトコル/インターネットプロトコルコアネットワークは、SIP/IPベースのPTTネットワークサーバを含み、用いられる。 - 特許庁

To provide a basic module and an IP core such that a plurality of totally independent-type basic modules that function even singly without requiring external control at all are combined to make an IP core that performs other functions.例文帳に追加

外部からの制御を全く必要としないで単体でも機能する完全自立形の基本モジュールを複数組み合わせて別の機能を発揮するIPコアを構成することができる基本モジュール及びIPコアを提供する。 - 特許庁

An apparatus controlling the use right of the bus by the plurality of IP cores 30 includes a main controller 10, and sub controllers 20 each provided correspondingly to each IP core 30.例文帳に追加

複数のIPコア30によるバスの使用権を制御する装置であって、主制御部10と、個々のIPコア30に対応して個別に設けられた副制御部20とを備える。 - 特許庁

In the case of testing the functions of an IP core 32, test signals outputted by a signal generator 44 are supplied for a normal signal input terminal of the IP core 32 via a selector 40, and its output signals are transferred to a signal checker 45.例文帳に追加

IPコア32の機能試験を行う場合は、信号発生器44が出力する試験信号をセレクタ40を介してIPコア32の通常信号入力端子に供給し、その出力信号を信号チェック器45に転送する。 - 特許庁

The sub controller 20 controls the bus use of by the IP core 30 according to the schedule under control of the main controller 10.例文帳に追加

副制御部20は、主制御部10の制御下で、このスケジュールにしたがって、IPコア30によるバスの使用を制御する。 - 特許庁

The each power source noise generation circuit is driven to apply an electric power source noise to the IP core 12 through the electric power source part, in a test mode.例文帳に追加

テストモード時に、電源ノイズ生成回路の各々は駆動されて電源ノイズを電源部を経てIPコアに印加する。 - 特許庁

For instance, in the case of the system LSI (four-layer product) loaded with functional blocks IP 1 and IP 2 for the design, a common IP core IP a to which two wiring data M4I and M4S of different film thicknesses sharing a wiring pitch are allocated corresponding to a metal wiring layer M4 of a top layer are used.例文帳に追加

たとえば、機能ブロックIP1,IP2が搭載されてなるシステムLSI(4層製品)の場合、その設計には、最上層のメタル配線層M4に対応させて、配線ピッチを共有するとともに、膜厚の異なる、2つの配線データM4I,M4Sが割り付けられた共通IPコアIPaを用いる。 - 特許庁

Since a power supply can be supplied to the core chip from the interposer IP straight, a power supply voltage that is supplied to the core chip can be stabilized.例文帳に追加

本発明によれば、インターポーザIPからコアチップへストレートに電源を供給することができることから、コアチップに供給する電源電圧を安定化させることが可能となる。 - 特許庁

The media distribution control section 705 controls the distribution of the media data transmitted from a PoC terminal A via a SIP/IP core server 710 to all the PoC terminals, participating in the group speech via a terminal control section 706 and the SIP/IP core server 710.例文帳に追加

メディア分配制御部705は、PoC端末AからSIP/IPコアサーバ710を介して送られてくるメディアデータを、送信制御部706、SIP/IPコアサーバ710を介してグループ通話に参加する全てのPoC端末に配信されるように制御する。 - 特許庁

A transfer control part 102 distributes IP packets received from a mobile terminal 2 via a wireless I/F 100 between a mobile core network 5 and a private network (LAN) 3 based on destination addresses provided to the IP packets.例文帳に追加

転送制御部102は、無線I/F100を介して移動端末2から受信されるIPパケットを、IPパケットに付与された宛て先アドレスに基づいて、モバイルコア網5とプライベート網(LAN)3の間で振り分ける。 - 特許庁

To enable a mobile communication terminal having no IMS (IP Multimedia Subsystems) function to access a core network of the IMS without establishing a session that the mobile communication terminal transmits/receives an IP packet to/from the network.例文帳に追加

移動通信端末がネットワークに対してIPパケットを送受信するためのセッションを確立することなく、かつIMSの機能を有しない移動通信端末からIMSのコアネットワークへアクセス可能とする。 - 特許庁

An entrance edge node 1, an exit edge node 5 and a function unit of an IP layer of a core node control the order of packet transfer of each communication quality class according to the priority level and the weight of received IP packets.例文帳に追加

入口エッジノード1、出口エッジノード5、およびコアノード3のIPレイヤの機能部で、受信IPパケットについて、各通信品質クラスごとに優先度と重みとに応じてパケット転送順序を制御して転送する。 - 特許庁

A register block 106 registered with the core number and the version number of the used IP is provided in the inspection object LSI 101.例文帳に追加

また、検査対象LSI101には、利用されているIPのコア番号及びバージョン番号を登録したレジスタブロック106が備えられている。 - 特許庁

To achieve a multifunction by using a single function-compatible IP core in a PC card, such as PCI (Peripheral Component Interconnect) (PCI-Express) card.例文帳に追加

PCI(PCI-Express)カード等のPCカードにおいて、シングルファンクション対応IPコアを使用してマルチファンクション機能を実現する。 - 特許庁

To obtain a network control system capable of autonomously determining a transfer path when an edge label switch router in an IP core network receives a stream.例文帳に追加

IPコアネットワーク内のエッジラベルスイッチルータがストリームを受信した時に、転送経路を自律的に判断することが可能なネットワーク制御システムを得ること。 - 特許庁

To improve the efficiency of design in a system LSI designed by using an IP core.例文帳に追加

本発明は、IPコアを用いて設計されるシステムLSIにおいて、設計の効率化を図ることができるようにすることを最も主要な特徴としている。 - 特許庁

To provide a mobile communication method and a priority control node for providing information such as a Cell ID from an Evolved Packet Core (EPC) network to an IP Multimedia Subsystem (IMS) fundamental.例文帳に追加

Cell IDなどの情報をEPC網からIMS基盤に提供する移動通信方法及び優先度制御ノードを提供すること。 - 特許庁

The main controller 10 switches connection between each IP core 30 and the bus according to a schedule predetermined based on predetermined time slices.例文帳に追加

主制御部10は、所定のタイム・スライスに基づいて予め定められたスケジュールにしたがって、各々のIPコア30とバスとの間の接続を切り替える。 - 特許庁

The core switch 10 acquires routine information necessary for setting up the subnet from a routine information DB 11, and determines an IP address assigned to the terminal 30.例文帳に追加

コアスイッチ10は,サブネットの設定に必要なルーティング情報をルーティング情報DB11から取得し,端末30に割り当てるIPアドレスを決定する。 - 特許庁

In a case where authentication is requested to an authentication server 30 when acquiring an IP address and the authentication is successful, a client 10 requests generation of an IP address for accessing a core network 110 to an address generation/management server 1000.例文帳に追加

クライアント10は、IPアドレスの取得に際して認証サーバ30に対し認証を依頼して認証が成功した場合に、コアネットワーク110にアクセスするためのIPアドレスの生成をアドレス生成・管理サーバ1000に依頼する。 - 特許庁

The IP sec device 2 sets a number 104 of its own core for processing and the number 102 of the core for processing of the IPsec device 1 included in the first IKE data in the second IKE data, and transmits them.例文帳に追加

IPsec装置2は二番目のIKEデータに自身の処理用コアの番号104と一番目のIKEデータに含まれたIPsec装置1の処理用コアの番号102を設定して送信する。 - 特許庁

The present invention relates to a bus system in a system-on-chip, and in detail, relates to the bus system for applying an IP core based on an AMBA protocol effectively to the open type core protocol.例文帳に追加

本発明はシステムオンチップにおけるバスシステムに関するものであって、さらに詳細にはAMBAプロトコルを基盤とするIPコアを開放形コアプロトコルに効果的に適用するためのバスシステムに関するのである。 - 特許庁

When the Ch0 transfer rate lower limit assurance value is larger than the Ch1 transfer rate lower limit assurance value, the transfer control part 101 receives a writing command request stacked in the Wr command queue 108, and issues a writing command request packet to a PCIe (PCI express) IP core 71.例文帳に追加

転送制御部101は、Ch0転送レート下限保障値がCh1転送レート下限保障値よりも大きい場合、Wr コマンド キュー108に積まれている書き込みコマンド要求を受け付け、書き込みコマンド要求パケットを、PCIe IPコア71に発行する。 - 特許庁

The semiconductor integrated circuit 50 includes a processor 1, memory 2, analog core 3, IP cores 4 to 6, external bus 7, main bus 8 and interface units 11 to 16.例文帳に追加

半導体集積回路50にはプロセッサ1、メモリ2、アナログコア3、IPコア4乃至6、外部バス7、主バス8、及びインターフェース部11乃至16が設けられる。 - 特許庁

The operating answer mode is indicated in a Session Initiation Protocol message from the push-to-talk communication device to the SIP/IP PTT network server over the Session Initiation Protocol/Internet Protocol core network.例文帳に追加

動作応答モードは、セッション開始プロトコル/インターネットプロトコルコアネットワークを介して、プッシュツートーク通信デバイスからのセッション開始プロトコルメッセージにおいて、SIP/IP PTTネットワークサーバに示される。 - 特許庁

A referring address of a test pattern 114 is registered in a test vector table 115 to be correlated with the core number and the version number of the IP used in the LSI of an inspection object.例文帳に追加

検査対象のLSIに利用されているIPのコア番号及びバージョン番号とに対応付けられたテストパタン114の参照先がテストベクタテーブル115に登録されている。 - 特許庁

A straight volume data forming part 123 subsequently re-constructs the volume data so that the core line data becomes linear to form the straight volume data and an axial periphery IP image data forming part 124 operationally processes the voxel values of the voxels present at an equal distance from a linear core line in a concentric circumferential direction to form axial periphery IP image data.例文帳に追加

次いで、ストレートボリュームデータ生成部123は、この芯線データが直線状になるように前記ボリュームデータを再構築してストレートボリュームデータを生成し、軸周りIP画像データ生成部124は、前記ストレートボリュームデータにおいて、直線状の芯線から等距離に存在するボクセルのボクセル値を同心円方向に演算処理して軸周りIP画像データを生成する。 - 特許庁

例文

An LSI tester 111 acquires the core number and the version number of the used IP, referring to the register block 106, and acquires the test pattern 114, referring to the test vector table 115.例文帳に追加

LSIテスタ111は、レジスタブロック106を参照して、利用されているIPのコア番号及びバージョン番号を獲得し、それによりテストベクタテーブル115を参照してテストパタン114を獲得する。 - 特許庁




  
Copyright © Japan Patent office. All Rights Reserved.
  
この対訳コーパスは独立行政法人情報通信研究機構の集積したものであり、Creative Commons Attribution-Share Alike 3.0 Unportedでライセンスされています。
  
原題:”Cracking DES: Secrets of Encryption Research, Wiretap Politics, and Chip Design ”

邦題:『DESのクラック:暗号研究と盗聴政策、チップ設計の秘密』
This work has been released into the public domain by the copyright holder. This applies worldwide.

日本語版の著作権保持者は ©1999
山形浩生<hiyori13@alum.mit.edu>である。この翻訳は、全体、部分を問わず、使用料の支払いなしに複製が認められる。
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