意味 | 例文 (19件) |
bliとは 意味・読み方・使い方
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遺伝子名称シソーラスでの「bli」の意味 |
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bli
fly | 遺伝子名 | bli |
同義語(エイリアス) | skd; pap/dTRAP240; blind spot; Mediator complex subunit 13; TRAP240; l(3)rK760; l(3)L7062; Pap; Scad78; LD28662; pap; dmMED13; poils aux pattes; Skd/Pap/Bli; flytrap; skuld; SPH203; CG9936; Srb9/AMIB/PAP/TRAP240; MED13; Skd/Med13; Pap/Trap; dTRAP240 | |
SWISS-PROTのID | --- | |
EntrezGeneのID | EntrezGene:43906 | |
その他のDBのID | FlyBase:FBgn0003415 |
本文中に表示されているデータベースの説明
「bli」を含む例文一覧
該当件数 : 19件
Herewith, complementary data corresponding to the data on the data line CLi is obtained on the bitline BLi and bit line /BLi so that the complementary data can be given to a pair of bit lines BLi and /BLi by using a single data line CLi.例文帳に追加
これにより、ビット線BLiとビット線/BLiに、データ線CLi上のデータに対応した相補的なデータが与えられるので、1本のデータ線CLiを使用してビット線対BLi,/BLiに相補的なデータを与えることができる。 - 特許庁
A sense amplifier circuit having a latch function is connected to a bit line BLi.例文帳に追加
ビット線BLiには、ラッチ機能を持つセンスアンプ回路が接続される。 - 特許庁
A potential of the BLI wiring is pulled down quickly by a driver.例文帳に追加
ドライバにより、BLI配線の電位は、高速にプルダウンされる。 - 特許庁
On the other hand, when the operation enable-signal CS is 'L', a specific word line (e.g. WL3) is driven by a pseudo drive circuit 50, and memory cells 11i,3 are connected to the bit lines BLi, /BLi.例文帳に追加
一方、動作可能信号CSが“L”のときは、擬似駆動回路50によって特定のワード線(例えば、WL3)が駆動され、メモリセル11_i,3がビット線BLi,/BLiに接続される。 - 特許庁
Each circuit block BLi is provided with shift register unit circuits Ai1 to Ai4, logical operation unit circuits Bi1 to Bi4, and a control unit circuit Ci.例文帳に追加
回路ブロックBLiはシフトレジスタ単位回路Ai1〜Ai4、論理演算単位回路Bi1〜Bi4、および制御単位回路Ciを備える。 - 特許庁
Since there in no change in the signal BLI while the same block is selected because of this, charge and discharge currents can be reduced.例文帳に追加
これにより、同一ブロックが選択されている間は信号BLIの変化が生じないので、充放電電流を低減することができる。 - 特許庁
An integrated memory has bit lines BLi, word lines WLk, and memory cells MC arranged at intersections of plate electrode lines PLi.例文帳に追加
集積メモリは、ビット線BLi、ワード線WLk、プレート電極線PLiの交点に配置されているメモリセルMCを有している。 - 特許庁
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Weblio例文辞書での「bli」に類似した例文 |
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bli
ギシギシする
まばらにする
しだいにする
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「bli」を含む例文一覧
該当件数 : 19件
In this semiconductor storage device having a shared sense amplifier, a BLI control circuit 22 for outputting a bit line separation signal BLI is configured so as to latch a block selection signal RBS in accordance with a change in a trigger signal RXT.例文帳に追加
シェアードセンスアンプ構成を有する半導体記憶装置において、ビット線分離信号BLIを出力するBLI制御回路22を、トリガ信号RXTの変化に応じてブロック選択信号RBSをラッチするように構成する。 - 特許庁
A transfer section 3A is prepared for connecting a data line CLi with a bit line BLi of a pair of bit lines corresponding to the data line CLi when writing and reading a memory block 1 and giving "L" to the bit line /BLi corresponding to the data line when data on the data line CLi is "H".例文帳に追加
メモリブロック1に対する読み書き時に、データ線CLiとこのデータ線CLiに対応するビット線対のビット線BLiの間を接続すると共に、データ線CLi上のデータが“H”のときには、このデータ線に対応するビット線/BLiに“L”を与える転送部3Aを設ける。 - 特許庁
When an operation enable-signal CS is 'H', corresponding memory cells 11i,j in a memory block 10 are selected based on address signals A0-A3 decoded by a row decoder 20 and a column decoder 30, and connected to bit lines BLi, /BLi.例文帳に追加
動作可能信号CSが“H”のときは、行デコーダ20と列デコーダ30で解読されたアドレス信号A0〜A3に基づいて、メモリブロック10中の該当するメモリセル11_i,jが選択され、ビット線BLi,/BLiに接続される。 - 特許庁
An imaging apparatus 1 has: an imaging element that carries out photoelectric conversion of a light image of a subject to generate an image signal; and a calculation means that calculates each luminance value of a plurality of photometer blocks BLi generated by segmenting a photographing image based on the image signal on the basis of a pixel value of a pixel which belongs to each of the plurality of photometer blocks BLi.例文帳に追加
撮像装置1は、被写体の光像を光電変換して画像信号を生成する撮像素子と、当該画像信号に基づく撮影画像が区分されて生成された複数の測光ブロックBLiの輝度値のそれぞれを、複数の測光ブロックBLiのそれぞれに属する画素の画素値に基づいて算出する算出手段とを備える。 - 特許庁
The present invention includes a cell array 11a, a plurality of word lines WLi, a plurality of bit lines BLi, a plurality of switching circuits SWi for column selection whose end nodes are connected to the corresponding bit lines, respectively, and a leakage current compensating circuit 12 whose output node is connected to other ends of the switching circuits.例文帳に追加
セルアレイ11aと、複数のワード線WLiと、複数のビット線BLiと、各ビット線に対応して設けられ、各一端ノードが対応するビット線へ接続されたカラムセレクト用の複数のスイッチング回路SWiと、スイッチング回路の他端ノードに共通に出力ノードが接続されたリーク電流補償回路12とを具備する。 - 特許庁
The bit line potential control circuit 7 controls the reference bit line /RBL to a voltage level different from the voltage level of the bit line /BLi during the operation of reading data from the memory cell 21.例文帳に追加
ビット線電位制御回路7は、メモリセル21からデータを読み出す読み出し動作時に、リファレンスビット線/RBLをビット線/BLiの電圧レベルと異なる電圧レベルに制御する。 - 特許庁
The P channel MOS TR 1 is connected across a bit line BLi and node N1 and receives the voltage on a word line WLj at its gate terminal.例文帳に追加
PチャネルMOSトランジスタ1は、ビット線BLiとノードN1との間に接続され、ワード線WLj上の電圧をゲート端子に受ける。 - 特許庁
The other reference bit line/BLi is connected to the main bit line/BL0 through a balance adjusting switch element TA for electric charges balance adjustment between parasitic capacitance of each reference bit line.例文帳に追加
別の参照ビット線/BLiが、各参照ビット線の寄生容量間での電荷平衡調整のため平衡調整スイッチ素子TAを介して主参照ビット線/BL0と接続されている。 - 特許庁
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