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Data Bitの部分一致の例文一覧と使い方
該当件数 : 6360件
When the switch element S1 is opened to start a sense amplifier 6, the data read from the memory cell M02 to be stored in the bit line BL102 of the bottom array block is output to the outside of a flash memory.例文帳に追加
スイッチ素子S1を開いてセンスアンプ6を起動すれば、メモリセルM02から読み出されてボトムアレイブロックのビット線BL102に保持されているデータを、フラッシュメモリの外部に出力することができる。 - 特許庁
To cope with even a short loop section by managing each of loop start frames and loop end frames by a one-bit flag in a sound source adopting a system of compressing and storing waveform data in the unit of a frame.例文帳に追加
フレーム単位に波形データを圧縮し記憶する方式の音源において、ループスタートフレームおよびループエンドフレームを各フレーム毎に1ビットのフラグで管理し、短いループ区間にも対応可能にする。 - 特許庁
Said processing is performed while changing a size of the block, so that compressed data contain the compressed code of the minimum bit rate and a code relating to the size of the block used for generating such a compressed code.例文帳に追加
以上の処理がブロックのサイズを変更して行われ、ビットレートが最小の圧縮符号と、かかる圧縮符号の生成に用いられたブロックのサイズに関する符号とが圧縮データに含められる。 - 特許庁
To provide a residual arithmetic processor capable of processing residual arithmetic of a data which exceeds bit length which can be processed by a residual processing unit, by using the residual arithmetic unit based on Montgomery multiplication.例文帳に追加
モンゴメリ乗算に基づく剰余演算器を用い、剰余演算器が処理可能なビット長を超えるデータの剰余演算を処理することができる剰余演算処理装置を提供する。 - 特許庁
Each average value of the bit rate and the frame rate in the motion picture data acquired from motion picture imaging by a camera function unit 20 and time information in every imaging are to be recorded into an imaging information storing area 152.例文帳に追加
撮像情報格納領域152には、カメラ機能部20による動画撮像で得られた動画像データにおけるビットレートとフレームレートの平均値や撮像毎の時間情報が記録される。 - 特許庁
Alternatively, a word unit constituted of only a 4channel bits data part (having a predetermined value in which a mark duty ratio to the channel bit is less than 100% in this case) is formed.例文帳に追加
あるいは、4チャネルビットのデータ部のみから成るワード単位(但し、この場合には、チャネルビットに対するマークデューティ比が100%未満の所定値を有するものとされる)を形成することとする。 - 特許庁
The digital data for inspection are outputted from each output port so that two outputs have a high level and the other output has a low level, in each of the three output terminals of the same bit, when the voltage is measured.例文帳に追加
この電圧測定時には、同一ビットの3つの出力端子毎に、2つの出力がハイレベルとなり、他の出力がローレベルとなるように、各出力ポートから検査用デジタルデータを出力させる。 - 特許庁
Each of transmitters T_1-T_n multiplies a data signal by an n-bit diffusion code and transmits n pieces of obtained multiplication results, through respective bus lines, to the other electronic circuit.例文帳に追加
送信器T_1〜T_nは、データ信号にnビットの拡散符号をそれぞれ乗算し、これによって得られるn個の乗算結果をそれぞれ対応するバスラインを通じて他の電子回路に送信する。 - 特許庁
A VBL generating circuit 130 normally outputting an equalizing potential outputs potential corresponding to written data in a test mode, and this potential is supplied en bloc to a bit line by an equalizing circuit.例文帳に追加
通常はイコライズ電位を出力するVBL発生回路130は、テストモードでは書込データに対応する電位を出力し、イコライズ回路によってビット線に一括してこの電位が供給される。 - 特許庁
An error correction coding circuit 1 and an error correction decoding circuit 2 generate an error correction code and perform error correction to data of a 32-bit (the number of unit bits for error correction) unit.例文帳に追加
誤り訂正符号化回路1、および誤り訂正復号化回路2は、32ビット(誤り訂正の単位ビット数)単位のデータに対して、誤り訂正符号の生成、および誤り訂正を行う。 - 特許庁
A bit string consecutively processed in this manner is already a data string after interleave/deinterleave processing, and thus complicated logical operation processing is avoided, and the circuit scale is reduced, and the number of processing steps is reduced.例文帳に追加
このようにして連続的に処理されたビット列は、既にインターリーブ/デインターリーブ処理後のデータ列になっており、複雑な論理演算処理を回避し、回路規模を削減し、処理ステップ数を削減できる。 - 特許庁
To provide a data transmitting and receiving method for realizing small capacity of a server side while avoiding cases wherein contents can not be distributed because of differences in compression method and specifications of a bit rate between transmission and reception.例文帳に追加
送受信間で圧縮方法やビットレートの仕様が異なるために、コンテンツ配信ができない場合を回避しつつ、サーバ側の小容量化も実現し得るデータ送受信方法を提供する。 - 特許庁
To provide a material recording apparatus which is capable of shortening the time required for recording frame data of a bit rate being one severalth of a maximum write performance of a memory circuit, into the memory circuit.例文帳に追加
メモリ回路への最大書き込み性能の数分の1のビットレートのフレームデータをメモリ回路に収録する場合に、収録に要する時間を短縮し得る素材収録装置を提供する。 - 特許庁
A sense amplifier includes a detection unit for detecting data and a capacitor coupled between a sense node and a reference potential, and is provided so as to be aligned from one ends of the bit lines in the second direction.例文帳に追加
センスアンプは、データを検出する検出部、および、センスノードと基準電位との間に接続されたキャパシタを含み、ビット線の一端から第2の方向に配列するように設けられている。 - 特許庁
To reduce power consumption by reducing the total amount of a writing current supplied to a bit line to magnetize a magnetic layer of a memory cell in a desired magnetizing direction when data is written in the memory cell.例文帳に追加
メモリセルにデータを書き込む際に、メモリセルの磁性層を所望の磁化方向に磁化させるようにビット線に流す書き込み電流の総量を低減し、もって消費電力を低減することができる。 - 特許庁
To prevent any bit column which is the same as a frame synchronizing code (m bits) from being generated, even when performing XOR arithmetic operations with a scramble code, when the frame synchronizing code is used from the scramble code, and to obtain secrecy of data by sharing the scramble code by a transmitter and a receiver.例文帳に追加
スクランブル符号にフレーム同期符号(mビット)を使用するとき、スクランブル符号でXOR演算してもフレーム同期符号と同じビット列が発生しないようにすること。 - 特許庁
A second exclusive OR circuit 41 exclusively ORs the check bit read out of the memory 10 and a collate pattern related to the storage address in the memory at the time of reading data out of the memory 10.例文帳に追加
第2のエクスクルーシブオア回路41は、メモリからのデータ読み出し時に、メモリから読み出した検査ビットとメモリ内での収容アドレスに関連する照合パターンの排他的論理和を生成する。 - 特許庁
To provide an apparatus and a method to transmit a transmission format association display bit used when transmitting data for a downlink shared channel out of channels used in an asynchronous mobile communication system.例文帳に追加
非同期移動通信方式において、使用するチャンネルのうちダウンリンク共有チャンネルのデータを伝送するときに使用される伝送形式組合表示ビットを伝送する装置及び方法を提供すること。 - 特許庁
The modulation is a bi-phase modulation in which a data bit of the record carrier information is encoded by a first predetermined number of variations of a first phase followed by the same number of variations of a second phase inverse to the first phase.例文帳に追加
変調は、記録担体情報のデータビットは、第1の位相の第1の所定数の変化に続いて、第1の位相の逆の第2の位相の同数の変化により符号化されるバイ−フェーズ変調である。 - 特許庁
In the sequential verification operation, the data input/output circuit selectively precharges each bit line depending on the result of the previously executed selective verification operation or the previously executed sequential verification operation.例文帳に追加
順次検証動作において、データ入出力回路は先に実行された選択検証動作、又は先に実行された順次検証動作結果によって、各々のビットラインを選択的にプリチャージする。 - 特許庁
To suppress crosstalk, jitter, spike in a switching mode electric circuit, to make a matching termination circuit, a snubber, a partial resonance circuit unnecessary, and to allow bit parallel high speed transmission of data and high speed power conversion.例文帳に追加
スイッチングモード電気回路におけるクロストーク、ジッタ、スパイクを抑圧し、整合終端回路、スナバ、部分共振回路を不要とし、データのビット並列高速伝送や、高速電力変換を可能とする。 - 特許庁
When they do not match, the adjustment value change circuit 23 outputs shift control signals to the right shifters 18 and 19 and shifts the fixed decimal point data stored in the buffers 14 and 15 to the right by 1 bit.例文帳に追加
それらが一致していない場合、調整値変更回路23は、右シフタ18,19にシフト制御信号を出力し、バッファ14,15に格納された固定小数点データを1ビット右シフトさせる。 - 特許庁
To provide a device with satisfactory error resistance and for preventing remarkable degradation of image quality of a decoded image against a bit error and a packet loss of moving image compression encoded data on a transmission line.例文帳に追加
良好な誤り耐性を有し、動画像圧縮符号化データの伝送路でのビット誤りおよびパケットロスに対して復号画像の画質の著しい劣化を防ぐことができる装置の提供。 - 特許庁
An adaptive motion compensator 132 communicates with the encoder for predicting whether a decoded version of the intermediate bit-rate macroblock data has accumulated predicted error frame energy exceeding a maximum threshold (228).例文帳に追加
適応型動き補償器(132)は、符号化器と交信して、中間ビットレート・マクロブロック・データの復号バージョンが、最大閾値を超える累積された予測エラー・フレーム・エネルギを有するかどうか(228)を予測する。 - 特許庁
The secondary PLL circuit 102 outputs 14-bit data controlling the phase and/or frequency of its own clock signal in response to the phase and/or frequency of the extracted timing component.例文帳に追加
2次PLL回路102は、抽出されたタイミング成分の位相及び/又は周波数に応じて自身のクロック信号の位相及び/又は周波数を制御する14ビットのデータを出力する。 - 特許庁
A packet group comprising a plurality of valid packets and invalid packets composing the data stream is stored in a frame having a fixed bit length along its time series, and a time stamp is given to the frame as a whole.例文帳に追加
データストリームを構成する複数の有効パケットと無効パケットとからなるパケット群を、その時系列に沿って固定ビット長のフレームに格納し、そのフレーム全体に対してタイムスタンプを付与する。 - 特許庁
First, second and third voltages are selected by gradation voltage selection circuits 7-10 from a plurality of gradation voltages generated in a gradation voltage generation circuit according to the high order bit of the image data.例文帳に追加
映像データの上位ビットに応じて、階調電圧発生回路6で発生した複数の階調電圧から階調電圧選択回路7〜10により第1電圧、第2電圧が選択される。 - 特許庁
In the magnetic memory, a plurality of magnetic domains are formed, there is a memory track in which a data bit comprising the magnetic domain can be stored in an array, and the memory track is made of an amorphous soft magnetic substance.例文帳に追加
複数のマグネチックドメインが形成され、該マグネチックドメインからなるデータビットがアレイに保存されうるメモリトラックを具備し、該メモリトラックは、非晶質軟磁性物質からなることを特徴とする磁気メモリである。 - 特許庁
In a branch metric calculation section 11, word split circuits 2a-2c split metric data 1-3 from latch circuits 1a-1c into 1-bit code and a metric in (k-1) bits that are respectively least values.例文帳に追加
ブランチメトリック算出部11において、ラッチ回路1a〜1cからのメトリックデータ1〜3を、それぞれ最も少ない1ビットの符号及びk−1ビットのメトリックに、ワードスプリット回路2a〜2cで分割する。 - 特許庁
While reading an ADIP1 word, by making a comparison between information whose detection is expected and information which is actually detected, detection failures of a data bit and the synchronization mark are monitored.例文帳に追加
ADIP1ワードの読み出し中において、検出が期待される情報と、実際に検出される情報との対比が行われることで、データビットおよび同期マークの検出失敗が監視される。 - 特許庁
To vanish probability of occurring pseudo synchronization in a receiver having a backward synchronization protection circuit when transmitting a bit stream by adding a header in which control information is stored to digital data having a synchronous pattern.例文帳に追加
同期パターンを持つデジタルデータに、制御情報を格納したヘッダを付加してビットストリームを伝送する場合に、後方同期保護回路を備えた受信装置にて疑似同期が発生する確率を0にする。 - 特許庁
A CAM cell comprises a pair of SRAM cell, each of them comprises a pair of intersection-coupled inverter for storing data values and a pair of access device for accessing a pair of complementary bit line.例文帳に追加
CAMセルは1対のSRAMセルを含み、これらは各々、データ値を記憶するための1対の交差結合されたインバータと、相補ビット線対にアクセスするための1対のアクセスデバイスとを含む。 - 特許庁
An image processing unit 31 compares an average value of pixel values of the region of the image object and standard deviation with predetermined values, of the bit map data, to determine the presence of distribution of noise.例文帳に追加
画像処理部31は、ビットマップデータのの中から、イメージオブジェクトの領域を対象として、その画素値の平均値と標準偏差とを一定の値を比較して、ノイズの分布の有無を判定する。 - 特許庁
To realize synchronous pattern removal processing for performing conversion so as not to be a synchronous pattern by inserting delimiter data into a bit string coinciding with a synchronous pattern in an encoded signal with a small amount of processing.例文帳に追加
符号化信号中から同期パターンに一致するビット列に区切りデータを挿入し同期パターンにならならいように変換する同期パターン除去処理を、少ない処理量で実現すること。 - 特許庁
A semiconductor memory device MEM performs an operation of disconnecting the sense amplifier SA from the bit lines BL and /BL during a data read operation when a temperature in the semiconductor memory device MEM is at a first temperature.例文帳に追加
半導体記憶装置MEMは、データ読み出し時において半導体記憶装置MEM内の温度が第1の温度であるときに、センスアンプSAとビット線BL、/BLとの切り離し動作を行う。 - 特許庁
When the logical levels of two continuous data bits are equal, an equalizer 154 equalizes the incapsulated signal for decreasing the transmitting level of the second bit to a prescribed level.例文帳に追加
等化器154は連続する2つのデータビットの論理的レベルが同一な場合、二番目のビットの送信レベルの大きさを所定のレベルに減少させるためにインキャプシュレーションされた信号を等化する。 - 特許庁
To prevent communication at a fully high bit rate from becoming difficult since electric waves discharged from each base station interfere each other at the boundary region of cells and sectors in an HDR(high data rate) system.例文帳に追加
HDRシステムにおいてセルやセクタの境界領域で、各基地局から発射される電波が互いに干渉しあって十分に高いビットレートでの通信が困難になることを防止する。 - 特許庁
The section 12 applies one-bit ADRC processing to pixel data of 3×3 pixels around it including a target pixel, thereby generating an ADRC code of 9 bits as a feature amount of the target pixel.例文帳に追加
クラスコード生成部12は、注目画素を含むその周囲の3×3画素の画素データを1ビットADRC処理することで、注目画素の特徴量としての9ビットのADRCコードを生成する。 - 特許庁
Further, when a signal is inputted from a timer 40 in each specific period, the rasterizer 10 prepares and outputs the bit map data to the display means 70 in the specific period.例文帳に追加
また、ラスタライザ10は、タイマ40から所定期間毎に信号が入力されると、メモリ50に登録した内容に基づいて所定期間毎に上記のビットマップデータし、これを表示手段70へ出力する。 - 特許庁
In this preventing method for illegal copy of a CD-ROM, bit scramble is eliminated or a SYNC pattern, a header, EDC, and ECC information are destroyed, in an arbitrary data sector of the CD-ROM.例文帳に追加
本発明のCD−ROMの不正コピー防止方法は、CD−ROMの任意のデータセクターに、ビットスクランブルの除去或いはSYNCパターンとヘッダとEDCとECC情報を破壊する。 - 特許庁
Metallic ink is discharged to a second code plotting area D2 from the liquid droplet discharge head 5 and the ink droplet of the metallic ink is stuck onto the rear surface 10b of the substrate 10 on the basis of the same bit map data.例文帳に追加
続いて、同一のビットマップデータに基づいて、金属インクを液滴吐出ヘッド5から第2コード描画領域D2に吐出し、インク滴を基板10の裏面10bに付着させた。 - 特許庁
Also, the row post decode-signal 15 generated last is fed back to a row pre-decoder 16, and a sense amplifier circuit is activated after data is completely read out to a pair of bit lines BL, /BL.例文帳に追加
また、最後に発生したロウポストデコード信号RPD15はロウプリデコーダ16にフィードバックされて、ビット線対BL、/BLにデータが完全に読み出された後に、センスアンプ回路が活性化される。 - 特許庁
In the overall image quality adjustment of encoded video images, parameter conversion data, defining encoding bit rate and encoding frame rate applicable to every image format are pre-stored in a storage section 13.例文帳に追加
符号化映像の総合的な画質調整において、画像フォーマットごとに適用可能な符号化ビットレート、符号化フレームレートを定めたパラメータ変換データを予め記憶部13に記憶しておく。 - 特許庁
At this time, window information on respective frames calculated from the compressed bit stream data is held in a RAM 15 and when the loop reproduction is performed, information in the RAM 15 is referred to in processing of a start frame.例文帳に追加
その際、圧縮ビットストリームデータから算出された各フレームのウインドウ情報をRAM15に保持しておき、ループ再生の場合に、開始フレームの処理においてRAM15の情報が参照される。 - 特許庁
To read out data stably without reducing access speed and increasing circuit area by performing simultaneously bit line reset operation in a read-out cycle of a flash memory of a NOR type and read-out operation.例文帳に追加
ノアタイプのフラッシュメモリの読み出しサイクルにおけるビット線リセット動作を読み出し動作と並行して行い、アクセス速度の低下や回路面積の増大を招くことなく安定にデータを読み出す。 - 特許庁
Connection control sections S0, S1 perform control so that write data are supplied to the first or second bit line after the word line is activated and then the first and second sense amplifiers are operated.例文帳に追加
接続制御部S0、S1は、ワード線が活性化された後で且つ第1、第2センスアンプの動作の前に第1ビット線または第2ビット線に書き込みデータが供給されるように制御する。 - 特許庁
An n-bit bus data output buffer is classified into four groups, and control signals #1 to #4 outputted from the flip-flop circuits 41 to 44 are fed to output buffers 11 to 14 by each group with distribution.例文帳に追加
nビットバスデータの出力バッファを4グループに分割し、各フリップフロップ回路41〜44から出力される各制御信号#1〜#4を、それぞれ、各グループ別に出力バッファ11〜14に分散して加える。 - 特許庁
A seamless reproduction condition in which a delay time, a variable bit rate (VBR), or the like, which is caused by decode processing of video data that is compressed using a compression method, is reflected, is determined.例文帳に追加
本発明によれば、圧縮方式を用いて圧縮されたビデオデータの復号化処理によって生じる遅延時間や可変ビットレート(VBR)などを考慮したシームレス再生条件を決定する。 - 特許庁
According to the converted bit map data BMD, the liquid droplets are discharged on a substrate from the nozzle in use of the discharge head, and metal particulates in the liquid droplets are fixed on the substrate to plot the identification code.例文帳に追加
そして、変換したビットマップデータBMDに基づき、吐出ヘッドの使用ノズルから液滴を基板に吐出し、液滴内の金属微粒子を基板に定着させて識別コードを描画する。 - 特許庁
The record decodes '11110011' after '1100' and a decoding data stream '11, 3, 0' indicating values provided by decoding codes 11001, 111, and 001 as well as next state 10 where a remaining bit streams is '1' are stored.例文帳に追加
該当レコードは「1100」に続いて「11110011」を復号するものであり、符号11001、111、001を復号して得られる値を示す復号データ列「11,3,0」と、余りのビット列が「1」である次の状態10とが格納されている。 - 特許庁
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