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Weblio 辞書 > 英和辞典・和英辞典 > parallel decodingに関連した英語例文

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parallel decodingの部分一致の例文一覧と使い方

該当件数 : 151



例文

To achieve high rate processing in decoding a code having a parallel path while reducing the burden of processing without sacrifice of performance.例文帳に追加

パラレルパスが存在する符号を復号する際に、処理の負担を軽減し、性能を劣化することなく処理の高速化を図る。 - 特許庁

To provide a data decoding device which decodes serial data to parallel data without using an analog circuit such as a PLL(phase-locked loop) circuit.例文帳に追加

PLL回路などのアナログ回路を用いずに、直列データを並列データに復号するデータ復号装置を提供する。 - 特許庁

Two turbo decoders 101A, 101B repeatedly perform error correction decoding to input data (code blocks #1, #2) in parallel.例文帳に追加

2つのターボ復号器101A、101Bは、並行して入力データ(コードブロック#1、#2)に対して誤り訂正復号を繰り返し行う。 - 特許庁

Then, regular operational processing is performed by the dedicated hardware and irregular processing is performed by the software, and parallel control of both is facilitated by making them operate in parallel for decoding.例文帳に追加

そして、規則的な演算処理は専用ハードウェア、不規則な処理はソフトウェアによって行い、両者を並列に動作させて復号化することにより、両者の並列制御が容易になる。 - 特許庁

例文

The video decoding apparatus further comprises a reconstruction unit configured to retrieve in parallel a plurality of input streams of the intermediate representation and to perform a decoding operation on the plurality of input streams in parallel to generate decoded output video data.例文帳に追加

ビデオ復号化装置は、中間表現の複数の入力ストリームを並列に検索し、そして、復号化出力ビデオデータを生成するために、復号化動作を複数の入力ストリームに並列に実行するように構成される、再構成ユニットをさらに備える。 - 特許庁


例文

Decoding the code word can recognize the arrangement of the blocks without the encoded data so as to attain application of parallel processing to DMA transfer control or the like for the information reproduction with respect to the blocks without the encoded data in parallel with decoding the block data with the encoded data.例文帳に追加

この符号語を復号すれば、符号化データの無いブロックの配置が認識可能になり、符号化データのあるブロックデータの復号に並行して、符号化データの無いブロックに対する情報再生のためのDMA転送制御等を並列処理可能になる。 - 特許庁

METHOD FOR ENCODING DIGITAL DATA, METHOD FOR ENCODING STREAM OF DATA SEGMENT, ENCODER, PARALLEL ENCODER FOR ENCODING SOURCE OF DATA, PARALLEL DECODER FOR DECODING SOURCE OF CODED DATA, METHOD FOR DECODING CODED DATA, MAGNETIC TAPE DRIVE, AND METHOD FOR ENCODING STREAM OF DATA例文帳に追加

デジタルデータを符号化する方法、データセグメントのストリームを符号化する方法、エンコーダ、データのソースを符号化するためのパラレルエンコーダ、符号化データのソースを復号するためのパラレルデコーダ、コード化データを復号する方法、磁気テープドライブ、およびデータのストリームを符号化する方法 - 特許庁

In a decoding apparatus which decodes a picture stream including image data carried out bidirectional predictive coding, N units of decoding parts 21 to 2N (N: two or more natural number) which process a picture stream in parallel are installed.例文帳に追加

双方向予測符号化された画像データを含む画像ストリームを復号する復号化装置内に、画像ストリームを並列に処理するN個(Nは、2以上の自然数)の復号化部21〜2Nを設ける。 - 特許庁

The receiver 2 includes: a plurality of MC-DS/CDMA reception means 22; a spatiotemporal transmission diversity decoding means 25; a parallel/serial conversion means 23; and a decoding de-interleave means 24.例文帳に追加

受信装置2は、複数のMC−DS/CDMA受信手段22と、時空間送信ダイバーシチデコーディング手段25と、パラレル/シリアル変換手段23と、デコーディングデインタリーブ手段24とを有する。 - 特許庁

例文

Inter macro blocks included in an input moving image stream are detected, and a sub-processor 90 being two or more decoding processing means executes decoding processing of the detected inter macro blocks in parallel.例文帳に追加

入力された動画像ストリームに含まれるインターマクロブロックを検出し、検出されたインターマクロブロックのデコード処理を2つ以上のデコード処理手段である副プロセッサ90により並列実行させる。 - 特許庁

例文

A multiple stage pipeline comprising a level decoding section 203, a DPCM decoding section, a serial parallel decoding section 205 decodes the significant factors of each symbol and FFs 211, 212, 213 transmit a factor identification signal for representing types of the factors processed by each stage of the multiple stage pipeline synchronously with the multiple stage pipeline.例文帳に追加

シンボルの有意係数をレベル復号化部203,DPCM復号化部,シリアルパラレル復号化部205からなる多段パイプラインによって復号化し、多段パイプラインの各段で処理される係数の種類を表す係数識別信号を多段パイプラインに同期してFF211,212,213で伝送する。 - 特許庁

A data decoding part 18 converts a serial data signal to a parallel data signal on the basis of the signal F generated in this way.例文帳に追加

データ復号部18は、このように生成された復号用信号Fに基づき、直列データ信号を並列データ信号に変換する。 - 特許庁

The Iγ distribution circuit 157 comprises a parallel path processing circuit 2251 for Iβ0 bundling the logarithmic likelihoodcorresponding to a parallel path, a parallel path processing circuit 2252 for Iβ1 and a parallel path processing circuit 2253 for Iα which are used at the time of decoding a code having a parallel path where the origin of transition has the same state the destination of transition has the same state.例文帳に追加

Iγ分配回路157は、遷移元のステートが同一であり且つ遷移先のステートが同一であるパラレルパスが存在する符号を復号する場合には、パラレルパスに対応する対数尤度Iγを束ねるIβ0用パラレルパス処理回路225_1、Iβ1用パラレルパス処理回路225_2及びIα用パラレルパス処理回路225_3を有する。 - 特許庁

The local soft-input, soft-output decoding means 500 and 501 are operated in parallel, and the local soft-input, soft-output decoding means 500 reads and decodes external information which corresponds to another element code and is updated, as required, in the local soft-input, soft-output decoding means 501.例文帳に追加

局所的な軟入力軟出力復号手段500,501は並列に動作し、局所的な軟入力軟出力復号手段500は他の要素符号に対応する局所的な軟入力軟出力復号手段501で随時更新された外部情報を読み込み復号処理を行う。 - 特許庁

To provide a coding and decoding apparatus and method capable of carrying out parallel processing of coding or decoding of macro blocks in a coding system such as the H.264/MPEG-4AVC wherein the macro blocks on a left side, a diagonally upper left, an upside and a diagonally upper right have a dependency relation.例文帳に追加

左横、左斜上、上及び右斜上のマクロブロックに依存関係があるH.264/MPEG-4AVC等の符号化方式において、マクロブロックの符号化又は復号を並列処理する。 - 特許庁

To assure display quality of a stream needing assurance of quality, and to efficiently use a decoding process resource when executing decoding processes of a plurality of streams in parallel to one anther in a time-sharing manner.例文帳に追加

複数のストリームの復号処理を時分割して並列に行う際に、品質の保証を必要とするストリームの表示品質を保証するとともに、復号処理リソースを効率良く利用できるようにする。 - 特許庁

To provide an encryption communication method that attains parallel encryption processing that takes packet sequence warrant of packets at a decoding node side into account.例文帳に追加

復号化ノード側におけるパケットの順序保証を考慮した暗号処理の並列化を可能とする暗号通信方法を提供すること。 - 特許庁

To provide a data receiver in which the scale of a serial-to-parallel conversion circuit for transmitting a Viterbi decode signal to a Leed-Solomon decoding circuit is reduced.例文帳に追加

ビタビ復号出力をリードソロモン復号部に伝達する、シリアルパラレル変換回路部の規模が削減されたデータ受信装置を提供する。 - 特許庁

On a transmission side, an error correcting encoder 11 of an error correcting encoding and decoding device 10 rearranges transmit data laterally in parallel.例文帳に追加

送信側では、誤り訂正符号化・復号化装置10の誤り訂正符号器11で、送信データを横方向で並列状態に並べ替える。 - 特許庁

At least part of decoding processing for 3B/4B is performed in parallel to the acquisition of the disparity signal RD1 in 5B/6B.例文帳に追加

3B/4Bについての復号処理の少なくとも一部が、5B/6Bにおけるディスパリティ信号RD1の取得と並行して行われる。 - 特許庁

To obtain parallel decoders at a lower cost with a smaller size than those of a conventional decoder by efficiently utilizing one decoding means.例文帳に追加

1つの復号化手段を効率よく利用することにより、従来に比べて小規模で低コストな並列復号化装置を提供すること。 - 特許庁

A comparison object bit string generation part 112 generates a comparison object bit string from the data string 101 and inputs it to a character and match length decoding part 113 and a plurality of match position decoding parts 114-0 to 114-15 to cause them to execute decoding of Huffman codes representing character codes and match lengths and decoding of Huffman codes representing match position appearing following match lengths, in parallel.例文帳に追加

比較対象ビット列生成部112は、データ列101から比較対象ビット列を生成して文字&一致長復号化部113と複数の一致位置復号化部114-0〜114-15に入力し、文字コード及び一致長を示すハフマン符号の復号化と、一致長に続いて現れる一致位置を示すハフマン符号の復号化とを並列に行わせる。 - 特許庁

An internal clock is given to serial/parallel conversion circuits 18, 20 serial/parallel-converting data given by a packet form and an interface circuit 22 decoding an output of the serial/parallel conversion circuits 18, 20 and outputting commands of ACT and the like to a DRAM core 26.例文帳に追加

内部クロックは、パケット形式で与えられるデータをシリアル−パラレル変換するシリアルパラレル変換回路18、20と、シリアルパラレル変換回路18、20の出力をデコードし、DRAMコア26に対してACT等のコマンドを出力するインターフェイス回路22とに与えられる。 - 特許庁

A signal-processor comprises an instruction-parallel processor 100, a first data-parallel processor 101, a second data-parallel processor 102, and a motion detection unit 103, a de-blocking filtering unit 104 and a variable-length coding/decoding unit (105) which are dedicated hardware.例文帳に追加

信号処理装置は、命令並列プロセッサ100、第1データ並列プロセッサ101、第2データ並列プロセッサ102、及び、専用ハードウェアである動き検出ユニット103とデブロックフィルタ処理ユニット104と可変長符号化/復号処理ユニット105とを備える。 - 特許庁

In parallel with this reproduction, reproduction of content in which processing performance requested for reproduction is higher is performed using a communication means and a decoding mean with higher processing performance.例文帳に追加

並行して、処理性能がより高い通信手段と復号化手段を用い、再生に要求される処理性能が高いコンテンツの再生を行なう。 - 特許庁

The CPU1 11 executes the decoder program stored in the ROM 16 to perform parallel decoding for a plurality of stream data.例文帳に追加

CPU1(11)は、ROM16に記憶されるデコーダプログラムを実行することによって、複数のストリームデータに対応するデコード処理を並列に行なう。 - 特許庁

To solve the problem of having to hold a large amount of memories for storing estimated posteriori probability data in parallel in order to increase a transfer speed in an LDPC (low density parity check code) decoding circuit.例文帳に追加

LDPCの復号回路において転送速度を上げるためには、推定事後確率データを格納するメモリを並列して多量に保有しなくてはならい。 - 特許庁

The microprocessor of a bar code handy terminal, when decoding a read bar code, performs the exposure processing and the fetch processing for the next read in parallel.例文帳に追加

バーコードハンディターミナルのマイクロプロセッサは、読取ったバーコードをデコードする際は、次の読取りのための露光処理及び取込み処理を並列に実行する。 - 特許庁

To reduce bus loading, operating frequency and power consumption by conducting encoding and decoding operations of audio data in parallel.例文帳に追加

オーディオデータの符号化処理、および復号化処理を並行して行うことにより、バス負荷を軽減し、動作周波数の低減、および低消費電力化を実現する。 - 特許庁

To accelerate turbo decoding, by performing training processing, backward probability calculation processings, and forward probability calculation processings in parallel, without using a multiport memory.例文帳に追加

マルチポートメモリを使用することなく、トレーニング処理、後方確率計算処理及び前方確率計算処理を並列処理してターボ復号の高速化を図ること。 - 特許庁

CODING METHOD AND APPARATUS WITH AT LEAST TWO PARALLEL CODING STEPS AND IMPROVED PERMUTATION, AND CORRESPONDING DECODING METHOD AND APPARATUS例文帳に追加

少なくとも2つの並列編集方法及び改良された置換方法を備えたコーディング方法及び装置、並びに対応するディコーディング方法及び装置 - 特許庁

A code synchronous and serial/parallel conversion circuit 1 synchronizes codes and converts a receiving system Y into information systems I1 to IK and a testing system P in serial and parallel, and outputs them to a first stage decoding circuit 2.例文帳に追加

符号同期及び直列/並列変換回路1は符号同期をとり、受信系列Yを情報系列I1〜IKと検査系列Pとに直列/並列変換し、第1段復号回路2に出力する。 - 特許庁

To provide a decoder capable of completing decoding processing in a short time without increasing the scaling of a circuit too high, even when packets of code data are inputted continuously by configuring two decoding circuits in parallel.例文帳に追加

2つの復号回路を並列に構成することにより、符号データのパケットが連続して入力されるような場合でも、回路規模をあまり大きくすることなく、短時間で復号処理を終了できる復号装置を提供する。 - 特許庁

To provide an image information transmission apparatus for dividing encoded stream data at any optional position, transmitting or decoding them in parallel, and accelerating processing of image transmission and image decoding as a result.例文帳に追加

符号化ストリームデータを任意の位置で分割して並列伝送したり並列復号処理でき、結果として画像伝送及び画像復号の処理の高速化することが可能な画像情報伝送装置を提供することである。 - 特許庁

A decoding device performing the entropy decoding of a bit stream to be inputted for outputting has shifters 102, 105 that are provided in parallel to the input of the bit stream and successively shift the inputted bit stream for holding.例文帳に追加

入力されるビットストリームをエントロピー復号化して出力する復号化装置は、ビットストリームの入力に対して並列に設けられ、入力されたビットストリームを順次にシフトさせて保持するシフタ102、105を有する。 - 特許庁

A parallel processing pattern decision unit 24 decides one of a plurality of parallel processing patterns for decoding, based on resource information from a decoding resource management unit 21, information on a bit rate and a picture type deblocking flag from a bit stream information analysis unit 22, and information on a CPU core obtained from a CPU status analyzing unit 23.例文帳に追加

並列処理パターン決定部24は、復号リソース管理部21からのリソースの情報、ビットストリーム情報解析部22からのビットレート、ピクチャタイプDeblockigフラグの情報、およびCPU状況解析部23から得られたCPUコアの情報に基づき、複数の並列処理パターンからどのパターンを使用して、復号処理を行うかを決定する。 - 特許庁

A high-speed operation can be realized by utilizing a circuit configuration arranging serial bit strings into parallel that is characterized in a configuration to realize the encoding and decoding processing for each of parallel bits within one time clock at the same time.例文帳に追加

従って、シリアルなビット列をパラレルに配置する回路構成を用いることによって、各ビットをパラレルに同時に1タイムクロックで符号化処理、復号化処理を実現する構成を特徴とし、高速動作が実現される。 - 特許庁

The latch parts are set to two stages and then the input processing of the video signal by the 1st latch part 43 and the decoding process by the decoding part 44 can be performed in parallel, so those processing operations are made fast to reduce the power consumption.例文帳に追加

ラッチ部を2段階に設定することにより、第1ラッチ部43による映像信号の取込処理と、デコード部44によるデコード処理とを並行に処理できるので、これらの処理動作を低速化して低消費電力化を図ることができる。 - 特許庁

Thus, the pipeline process of command queue encrypted command is sequentially executed by the command fetch part 11, the command decoding part 12 and the calculation executing part 13 in parallel.例文帳に追加

これにより、暗号化された命令の命令列のパイプライン処理が、命令フェッチ部11、命令デコード部12、演算実行部13で、順次、並列に実行される。 - 特許庁

A parallel processing controller 15 divides a time into a plurality of time slots and allows the decoder 14 to perform decoding processing upon the channels while switching the time slots.例文帳に追加

並列処理制御部15は、時間を複数のタイムスロットに分割し、タイムスロットを切り換えながら、復号化部14による各チャネルの復号化処理を実行させる。 - 特許庁

To encode a numerical data string composed of fixed-length bits by using a variable-length bit string, and to decode the numerical data string by parallel processing using a plurality of decoding processing units.例文帳に追加

固定長ビットからなる数値データ列を、可変長のビット列を用いて符号化し、複数台の復号処理ユニットを用いた並列処理によって復号化する。 - 特許庁

The first and second decoders operate in parallel in each frame processing of the GOP, and the first decoder performs the decoding prior to the second decoder.例文帳に追加

GOPの各フレーム処理において、第1および第2のデコーダは並行して動作し、かつ、第1のデコードの方が第2のデコーダよりも先行して復号化を行う。 - 特許庁

The block parallel decoding algorithm and the decoder architecture corresponding to the algorithm employ a set of interconnected processing nodes configured in the form of a probability dependent graph.例文帳に追加

ブロック並列復号化アルゴリズムおよび対応する復号化器アーキテクチャは、確率依存グラフの形で構成される1組の相互接続される処理ノードを用いる。 - 特許庁

To enable decoding of video stream to be executed in parallel based only on type information of each macro block acquired by analyzing slice data included in the video stream.例文帳に追加

動画像ストリームに含まれるスライスデータを解析して得られる各マクロブロックの種別情報のみに基づき、動画像ストリームのデコード処理を並列実行可能とする。 - 特許庁

A parallel stream transmission section 202 divides the stream data output from the stream transmission section 201 and side information, required for decoding in the middle of stream, extracted on the basis of the stream data at the dividing point indicated by the dividing point information into a predetermined number of items, and transmits them in parallel to receiving-side stream decoding sections 204a-204c.例文帳に追加

並列ストリーム送信部202は、ストリーム送信部201より出力されるストリームデータ及び該ストリームデータに基づいて抽出される、ストリーム途中からの復号に必要なサイド情報を、分割ポイント情報にて指示された分割ポイントで所定数に分割し、並列化して、受信側のストリーム復号部204a〜204cへ送信する。 - 特許庁

The arithmetic processor includes: an image reproduction function part for performing decoding processing and image output processing; and a parallel operation function part being the function part to be operated in parallel with the image reproduction function part so as to perform at least image output processing.例文帳に追加

演算処理装置は、デコード処理と画像出力処理とを実行する画像再生機能部と、画像再生機能部と並行して動作可能な機能部であり少なくとも画像出力処理を実行する並行動作機能部とを備える。 - 特許庁

Since the boundary of the unit code data U1, U2, ... as shown in Fig.(c) is surely an N-bit integer multiple from the head, the unit code data are divided into a plurality of data at the boundary to perform decoding by parallel processing.例文帳に追加

図(c) に示す単位符号データU1,U2,...の境界は、必ず先頭からNビットの整数倍目になるので、当該境界で複数に分割し、並列処理による復号化を行う。 - 特許庁

To create an EPG(electric program guide) by transmitting program information of all TSs including other stations by an exclusive TS, providing a receiver with exclusive channel selecting, demodulating and decoding parts and processing the program information in parallel with reception of the program.例文帳に追加

他局を含む全TSの番組情報を専用TSで送出し、受信機に専用の選局・復調・デコード部を設けて番組受信と平行して処理し、EPG(Electric ProgramGuide) を作成する。 - 特許庁

To provide a means to perform encoding/decoding processing of a high-definition video without needing a high-speed arithmetic processor by subjecting one frame to parallel processing without degrading encoding efficiency.例文帳に追加

符号化効率を落とさずに、1フレームを並列処理することにより、高速演算処理装置を要さずとも高精細映像の符号化・復号処理を行う手段を提供する。 - 特許庁

例文

The encryption side node 1 selects one of a plurality of encryption processing units 7 that can be executed in parallel on the basis of the identifier and encrypts a packet and sends the result to a decoding side node 2.例文帳に追加

暗号側ノード1は、該識別子に基づいて並列実行可能な複数の暗号処理装置7の一つを選択し、パケットを暗号化して復号側ノード2に向けて送信する。 - 特許庁




  
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