「cache controller」に関連した英語例文の一覧と使い方(6ページ目) - Weblio英語例文検索

To suppress a defect while maintaining a cache coherence domain by performing address inspection before data intercepted by a memory controller are processed.例文帳に追加

欠陥抑制キャッシュ・コヒーレンス・ドメイン及びキャッシュ・コヒーレントな区画間メモリ領域を可能としながら、キャッシュ・コヒーレントな対称型共有メモリ・マルチプロセッサ・システムにおける欠陥抑制メモリ区画化を達成する。 - 特許庁

Concerning the information processor of a multiprocessor system connecting plural processors and plural main memories through a switch type main memory controller, while adopting a control system for performing the coherence control of a cache by holding the copy of the tag of the cache and while relaxing performance reduction caused by false sharing, barrier synchronism between processors is performed at a high speed.例文帳に追加

複数のプロセッサと複数の主記憶をスイッチ型主記憶制御装置で接続したマルチプロセッサ方式の情報処理装置で、キャッシュのコヒーレンス制御をキャッシュのタグのコピーを保持することにより行う制御方式をとりながら、フォールスシェアリングによる性能低下を緩和しつつ、プロセッサ間のバリア同期を高速に行う。 - 特許庁

This device has dedicated magnetic disk devices 7f and 7g for temporarily holding data which are read into a cache memory 31 or data to be directly recorded in a logic unit 6 without being held in the cache memory 31 when recording data in the logic unit 6 and a controller 8 for controlling the dedicated magnetic disk devices 7f and 7g.例文帳に追加

論理ユニット６へデータ記録時に、キャッシュメモリ３１に読み込まれたデータ或いはキャッシュメモリ３１に保持されることなく直接論理ユニット６へ記録されるデータを一旦保持するための専用磁気ディスク装置７ｆ、７ｇと、専用磁気ディスク装置７ｆ、７ｇを制御するコントローラ８とを有することを特徴とする。 - 特許庁

A memory controller controls an access to the memory unit, reads out the first cache line from a first memory module via the data bus and the first information bus and, by parallel operation, writes a pair of updated information bits of the second cache line which has been read out first into the second memory module via the second information bus.例文帳に追加

メモリコントローラは、メモリユニットへのアクセスを制御し、第１のメモリモジュールからデータバスおよび第１の情報バスを介して第１のキャッシュラインを読み出し、かつ、並列動作で、先に読み出された第２のキャッシュラインの一組の更新された情報ビットを第２の情報バスを介して第２のメモリモジュールに書き込む。 - 特許庁

An electronic device has a CPU 1, a nonvolatile memory 4, which is set with a rewrite frequency limitation, a RAM 3 as a cache memory, and a controller 2 which controls data transfer between the nonvolatile memory 4 and the RAM 3.例文帳に追加

ＣＰＵ１と、書き換え回数制限が設定された不揮発性メモリ４と、キャッシュメモリとしてのＲＡＭ３と、不揮発性メモリ４とＲＡＭ３との間でのデータの転送を制御するコントローラ２とを備える。 - 特許庁

The optical disk read controller reads data from an optical disk while look-ahead processing based on an instruction from a host computer, stores the read date in a cache memory and makes them read by the host computer.例文帳に追加

本光ディスク読み取り制御装置は、ホストコンピュータからの命令に基づいて、先読み処理を行いつつ、光ディスクからデータを読み取り、読み取られたデータを、キャッシュメモリに格納しホストコンピュータに読み出させる。 - 特許庁

The instruction controller 10 decides whether or not there is free space in an instruction buffer storing instruction fetch data received from an L1 cache memory storing frequently used data that are stored in a main memory.例文帳に追加

開示する命令制御装置は、メインメモリに記憶されるデータのうち利用頻度の高いデータを記憶するＬ１キャッシュメモリから受信した命令フェッチデータを保存する命令バッファに空きがあるか否かを判定する。 - 特許庁

The controller circuit is configured to store a single block of data from a subset of the overlapping tracks in the non-volatile cache memory circuit, while at least a portion of the data in the shingle block of data is updated.例文帳に追加

コントローラ回路は、重なり合うトラックの部分集合から１個のデータシングルブロックを、当該データシングルブロック内のデータの少なくとも一部が更新される間に、不揮発性キャッシュメモリ回路に格納すべく構成されている。 - 特許庁

The host IF 121 performs CRC check based on the data and the CRC code, and when there is no error, the data and the CRC code are respectively transferred to a cache controller 122 respectively through a data transfer bus 14 and a CRC bus 15.例文帳に追加

ホストＩＦ１２１は、データとＣＲＣ符号に基づくＣＲＣチェックを行い、エラーがなければデータはデータ転送用バス１４により、ＣＲＣ符号はＣＲＣバス１５によりキャッシュコントローラ１２２に転送する。 - 特許庁

The mobile terminal 3 comprises: an entry section 31; an interrupt controller 32; a management section 33; a cache 34; an IC card interface 36; a ROM 37; a RAM 38; a transmission reception section 39; and a display section 40.例文帳に追加

携帯端末装置３は、入力部３１と、割り込みコントローラ３２と、管理部３３と、キャッシュ３４と、ＩＣカードインターフェース３６と、ＲＯＭ３７と、ＲＡＭ３８と、送受信部３９と、表示部４０とから構成される。 - 特許庁

To provide a disk controller having a cache memory part and a shared memory part capable of making it unnecessary to increase the number of the shared memory part, and preventing access performance form being deteriorated.例文帳に追加

キュッシュメモリ部と共有メモリ部の二種類のメモリを有するディスク制御装置において、キュッシュメモリ部を増設に応じて、共有メモリ部を増設する必要をなくし、しかも、アクセス性能を低下させないようにする。 - 特許庁

When executing a command from a host device, the controller reads address information to be used for executing the command from the NAND memory 30 to the address information cache 461 and performs read/write on the NAND memory 30.例文帳に追加

コントローラは、ホスト装置からコマンドの実行時に、コマンドの実行に使用するアドレス管理情報をＮＡＮＤメモリ３０からアドレス情報キャッシュ４６１に読み出して、ＮＡＮＤメモリ３０に対してリード／ライトを実行する。 - 特許庁

A setting of masking interruption with lower priority is set to an interrup controller 17, so that data having been written in the instruction cache 13 will not be rewritten due to exception processing resulting from other interruption at this point of time.例文帳に追加

この時点で他の割りこみによる例外処理で命令キャッシュ１３に格納したデータが書き換えられることがないように、割りこみコントローラ１７に優先順位の低い割りこみはマスクするように設定する。 - 特許庁

After wiping out all lines in a dirty state existing on a cache memory 2 to a memory module 4a, a processor 1 switches a main memory controller 3 to a copy mode, and issues write invalidating byte enable to one word in all the lines of a copy area, and stores all the lines of the copy area in the dirty state in the cache memory 2.例文帳に追加

キャッシュメモリ２上に存在するダーティ状態のラインをすべてメモリモジュール４ａへ掃き出した後、プロセッサ１はメインメモリ制御装置３を複写モードに切り替えて、バイトイネーブルを無効化したライトを複写領域の全ライン内の１ワードに対して発行し、キャッシュメモリ２に複写領域の全ラインをダーティ状態で格納する。 - 特許庁

The controller 25 receives one or a plurality of MAC addresses from the one or a plurality of devices 17 to be controlled through the LAN 1, stores the one or a plurality of MAC addresses thus received in a cache memory 22, and controls the one or a plurality of devices 17 to be controlled using the one or a plurality of MAC addresses stored in the cache memory 22.例文帳に追加

制御装置２５が、１又は複数の被制御装置１７からそれぞれ１又は複数のＭＡＣアドレスをＬＡＮ１を介して受信し、受信した１又は複数のＭＡＣアドレスをキャッシュメモリ２２に格納し、キャッシュメモリ２２に格納された１又は複数のＭＡＣアドレスをそれぞれ用いて１又は複数の被制御装置１７を制御する。 - 特許庁

The fixed number of controllers constitutes a group, only one controller of the one group or two controllers including its standby controller are provided with the SPM for storing software of the entire controllers in the system, and the controller provided with the SPM in a plurality of groups and one or two controllers in each of the other groups are provided with a cache memory holding a portion of copy of the SPM.例文帳に追加

一定個数の制御装置により群を構成し，一つの群の１つまたはその予備を含む２つの制御装置にだけシステム内制御装置全体のソフトウェアを格納するＳＰＭを設け，複数群の中のＳＰＭを設けた制御装置及び他の各群のそれぞれの中の１つまたは２つの制御装置にＳＰＭの一部のコピーを保持するキャッシュメモリを設ける。 - 特許庁

The server part of a host computer for control repeats the successive reading of the registered data of a refresh table, and inquires the state of a device in an address range indicated by each registered data to a programmable logical controller(PLC), and stores it in a cache memory.例文帳に追加

制御用ホストコンピュータのサーバ部は、リフレッシュテーブルの登録データの順次読み出しを繰り返すと共に、各登録データが示すアドレス範囲のデバイスの状態をプログラマブル・ロジック・コントローラ（ＰＬＣ）に問い合わせ、キャッシュメモリに格納する。 - 特許庁

To provide a disk array device that improves response performance while maintaining data consistency even when a write request is received from a host device by a controller that has no master authority, and to provide a disk array system and a cache control method.例文帳に追加

マスター権限を有しないコントローラ側にホスト装置からのライト要求があった場合にも、データの一貫性を維持しつつ、応答性能の向上を図るディスクアレイ装置、ディスクアレイシステム、及びキャッシュ制御方法を提案する。 - 特許庁

This chatbot system controller is provided with a channel-categorized queuing part which divides channel-categorized response messages assigned to each user into elements with proper length in a cache buffer for storing response messages, and performs the queuing and stores the response messages.例文帳に追加

チャットボットシステム制御装置は、応答メッセージを格納するためのキャッシュバッファにユーザ毎に割り当てられたチャンネル別の応答メッセージを適切な長さの要素に分割して、キューングして格納するチャンネル別キューイング部を備える。 - 特許庁

A lookahead DRAM controller 24 of the logic element 14 monitors the bus 36, predicts the contents of the next cycle, loads data for one column in a bank including a predicted address to a corresponding cache 18 and thus performs acceleration.例文帳に追加

ロジック・エレメント１４のルックアヘッドＤＲＡＭコントローラ２４は、バス３６を監視して次のサイクルの内容を予測し、予測されたアドレスを含むバンク中の１列分のデータを対応するキャッシュ１８にロードし、それにより高速化を図る。 - 特許庁

Apex coordinates 112 outputted from a polygon cache 104 and picture coordinates 119 outputted from a display controller 107 are given to an internally divided value generator 105, and this generator 105 outputs an internally divided value 113 to a renderer 106.例文帳に追加

内分値発生器１０５は、ポリゴン・キャシュ１０４から出力された頂点座標１１２およびディスプレイ・コントローラ１０７から出力された画面座標１１９を与えられ、内分値１１３をレンダラ１０６に対し出力する。 - 特許庁

In a disk drive 1 having a cache controller 11 that performs cache control using a buffer memory 20 divided into segments and managed, sequential hit test is executed on each segment in accordance with the requested access range designated by a read or write command coming from a host system 30, and the hit upper-limit LBA set for each segment is updated when a mishit occurs.例文帳に追加

セグメントに分割して管理するバッファメモリ２０を使用したキャッシュ制御を実行するキャッシュコントローラ１１を有するディスクドライブ１において、ホストシステム３０からのリード又はライトのコマンドによる要求アクセス範囲に応じて、セグメント毎にシーケンシャルヒット判定を実行し、ミスヒットの場合にセグメント毎に設定されたヒット上限ＬＢＡを更新する構成である。 - 特許庁

This disk array controller provided with a channel IF part, a disk IF part, a cache memory part and a shared memory part and plural disk array control units to read/write data, has a mutual coupling network to connect the shared memories in the plural disk array control units and a mutual coupling network to connect the cache memory parts in the plural disk array control units are provided.例文帳に追加

チャネルＩＦ部と、ディスクＩＦ部と、キャッシュメモリ部と、共有メモリ部とを有し、データのリード／ライトを行うディスクアレイ制御ユニットを、複数ユニット有するディスクアレイ制御装置において、複数のディスクアレイ制御ユニット内の共有メモリ部間を接続する相互結合網と、複数のディスクアレイ制御ユニット内のキャッシュメモリ部間を接続する相互結合網を有する。 - 特許庁

This access controller controlling access to a data memory has: a means storing a plurality of attributes (ATi) for defining a right of the access to the data memory (DMEM); cache memories (CMEM, CMC) storing a prescribed number of attributes; and a synchronous attribute retrieval circuit (ASC2) retrieving the attribute inside the storage means (DMEM, ATMEM) when the attribute is absent inside the cache memory.例文帳に追加

データメモリ（ＤＭＥＭ）へのアクセスの権利を定義する複数の属性（ＡＴｉ）を保存する手段と、所定の数の属性を保存する本発明に係るキャッシュメモリ（ＣＭＥＭ、ＣＭＣ）と、キャッシュメモリ内に属性がない場合は属性を保存手段（ＤＭＥＭ、ＡＴＭＥＭ）内で検索する同期属性検索回路（ＡＳＣ２）とを備えたデータメモリへのアクセスを制御するアクセス制御装置。 - 特許庁

On a micro computer 10 which contains a CPU core 11 and a cache device 12, when a caching miss occurs in the cache device 12, a signal for stop supplying clock is generated which stops a movement of a standard clock by the number of the clock according to the number of waiting which is set for the accessed address area on a programmable waiting controller 14 for accessing a memory device which is connected outside.例文帳に追加

ＣＰＵコア１１及びキャッシュ装置１２を含むマイクロコンピュータ１０において、キャッシュ装置１２でキャッシュミスが発生したとき、外部に接続されたメモリ装置にアクセスするためのプログラマブル・ウェイト・コントローラ１４において、アクセスされるアドレス領域に対応して設定されるウェイト数に応じたクロック数だけ基準クロックの動作を停止させるクロック供給停止信号を生成する。 - 特許庁

A controller 100 of a video recording/reproducing device 1 obtains advanced data 42 from an optical disk 4 based on the HD DVD specifications through a read section 101 to store in a file cache cryptogram 108 provided in advance to a memory 106.例文帳に追加

録画再生装置１の制御部１００は、ＨＤ ＤＶＤ規格に準拠した光ディスク４から読出部１０１を介してアドバンスドデータ４２を取得し、記憶部１０６に予め設けていたファイルキャッシュ暗号文１０８に記憶させる。 - 特許庁

To provide a cache memory controller capable of performing invalidation processing, copy-back processing of only a data block in an area specified by a single request from a CPU, reducing processing time required for invalidation and copy-back and enhancing use efficiency.例文帳に追加

ＣＰＵからの１回の要求により指定した領域内のデータブロックのみをインバリデート処理、コピーバック処理することができ、インバリデートやコピーバックに要する処理時間を削減し、使用効率を高めることができるキャッシュメモリ制御装置を得る。 - 特許庁

To provide a disk array device capable of using a memory area other than one in which failure has occurred in a failed I/O process controller and minimizing the influence of performance degradation, without taking over all I/O processes to an I/O controller of the other system, when a part of a cache memory is failed.例文帳に追加

キャッシュメモリの一部に障害が発生した場合に、Ｉ／Ｏ処理を全て他系のＩ／Ｏ処理コントローラへ引き継ぐことなく、障害が発生したＩ／Ｏ処理コントローラの障害が発生したメモリ領域以外のメモリ領域を活用するとともに、性能劣化の影響を極小化させることが可能なディスクアレイ装置を提供する。 - 特許庁

In the storage system, the master disk controller 100 overwrites update data stored in a second area of a cache memory 103 so as to be transferred to the sub disk controller 200, with update data of the same records, for a prescribed time between first and second preset base points, and the sub disk controller 200 handles the update data between the first and second base points as consistent actual data.例文帳に追加

ストレージ装置において、正ディスク制御装置１００では、キャッシュメモリ１０３の第２の領域に格納された副ディスク制御装置２００に転送すべき更新データに対して、予め設定された第１の基点と第２の基点間の規定時間の間は同一レコードの更新データを上書きし、副ディスク制御装置２００では、第１の基点と前記第２の基点間の更新データを一貫性の取れた実データとして扱うものである。 - 特許庁

Also, the transfer of data in the HDD 101 is directly controlled by performing the setting of the term of validity of data in the cache memory 106, the notification of a time when any access from the controller is not generated at the minimum, and the destination of an interface to be used.例文帳に追加

あわせて、キャッシュメモリ１０６におけるデータの有効期間の設定、最低限コントローラからのアクセスが発生しない時間の通知、用いるインターフェイスの指定を行えるようにすることで、ＨＤＤ１０１内のデータの移動を直接制御可能にする。 - 特許庁

To provide a memory controller and a memory control method for shortening the execution time of a storage operation in a storage medium even when a series of write data having relationship to specific write data are discontinuously temporarily stored in a cache memory.例文帳に追加

特定の書込データとの間に関連性を有する一連の書込データがキャッシュメモリに不連続に一時記憶された場合であっても、記憶媒体への記憶動作の実行時間を短縮させることが可能なメモリ制御装置及びメモリ制御方法を提供する。 - 特許庁

A disk array device includes: a controller; a first disk that stores original data; a second disk that forms a mirror configuration with the first disk and stores the original data while eliminating multiplicity; and a cache memory that temporarily stores the original data subjected to writing or reading.例文帳に追加

ディスクアレイ装置は、コントローラと、オリジナルデータを格納する第１ディスクと、第１ディスクとミラー構成であり、且つ、オリジナルデータを重複を排除して格納する第２ディスクと、ライト又はリード対象となったオリジナルデータを一時的に格納するキャッシュメモリと、を有する。 - 特許庁

The controller programming device is constituted of the PLC 102 provided with a symbol data base 123 for storing symbolic variables corresponding to variables indicating respective memory addresses and a programming device 101 for storing the same cache data 115 as data stored in the data base 123.例文帳に追加

シンボリックな変数がメモリアドレスを示す変数に対応して、そのシンボリックな変数を格納するシンボルデータベース１２３を備えたＰＬＣ１０２と、シンボルデータベース１２３に格納されたデータと同じキャッシュデータ１１５を保持するプログラミング装置１０１とから構成する。 - 特許庁

If it is determined that an access from a master meets a condition of an invalidation range setting unit 121, a cache controller 110 forcibly resets a VALID flag 113 of a corresponding address in a tag memory 111 through an invalidation determination circuit 120 and a tag memory modification unit 122.例文帳に追加

マスタからのアクセスが無効化範囲設定部１２１の条件に合致すると判定された場合、キャッシュコントローラ１１０は、無効化判定回路１２０及びタグメモリ改変部１２２により、タグメモリ１１１内の該当するアドレスのＶＡＬＩＤフラグ１１３を強制的にリセットする。 - 特許庁

When a reading request designating the area address (a) matched with the area address (a) in the entry information is given from the host device 20, a controller 123 operates prefetch from an HDD 11 to a disk cache 121 according to the predicted address (b) in the entry information.例文帳に追加

その後、当該エントリ情報中の領域アドレスａに一致する領域アドレスａを指定する読み出し要求がホスト装置２０から与えられた場合、コントローラ１２３は当該エントリ情報中の予測アドレスｂに従ってＨＤＤ１１からディスクキャッシュ１２１へのプリフェッチを行う。 - 特許庁

A part (Write block) which is frequently overwritten and a part (Read block) which is frequently read without being overwritten coexist in a storage area, so that Read-Write frequency information with respect to a specific block address of the disk drive is held by a cache memory a controller managing the RAID group has.例文帳に追加

記憶領域には、頻繁に書換えが行われる部分（Writeブロック）と、書換えが行われずに読出しされる機会が多い部分（Readブロック）が存在するため、ＲＡＩＤグループを管理するコントローラが持つキャッシュメモリに、ディスクドライブの特定ブロックアドレスに対するRead-Write頻度情報を保持する。 - 特許庁

A state information notice part 47 acquires the measured values of throughput from a throughtput measurement part 46 when a response time monitored in a response time monitoring part 45 exceeds a prescribed time, and informs the cache controller 70 of information on a response time delay and information on bus states.例文帳に追加

状態情報通知部４７は、応答時間監視部４５において監視される応答時間が所定時間を超過すると、スループット計測部４６からスループットの計測値を取得し、応答時間遅延の情報およびバスの状態情報をキャッシュコントローラ７０へ通知する。 - 特許庁

A reference picture controller FMCtr uses an analysis result of the picture reference structure to write a reference picture, having a high possibility of referring to a picture to be written the multi-frame memory FrmMem, as well as, to store the reference picture in the cache memory CacheMem.例文帳に追加

参照ピクチャ管理器ＦＭＣｔｒは、前記ピクチャの参照構造の解析結果を用いて、復号化対象ピクチャの参照可能性の高い参照ピクチャを前記マルチフレームメモリＦｒｍＭｅｍに書き出すと共に、前記キャッシュメモリＣａｃｈｅＭｅｍにも格納する。 - 特許庁

The memory controller including a cache memory for temporarily storing signals transmitted/received between a microprocessor and a main storage device includes an access analysis device for analyzing the existing rate of each of access system signals transmitted/received between the microprocessor and the main storage device, and a memory reconfiguring device for reconfiguring the rate of the cache memory area based on signals output from the access analysis device.例文帳に追加

マイクロプロセッサと主記憶装置の間で送受信される信号を一時的に記憶するキャッシュ・メモリを備えたメモリ・コントローラにおいて、 前記マイクロプロセッサと前記主記憶装置の間で送受信される各アクセス方式の信号がそれぞれどのような割合で存在するか解析するアクセス解析装置と、 このアクセス解析装置から出力された信号に基づいて、前記キャッシュ・メモリの領域の割合を再構成するメモリ再構成装置と を備える。 - 特許庁

A controller 20 issues instruction for collecting trace by an instruction from a host 10 or a service processor 30 and temporarily holds trace data in the cache memory 23 or stores it in the designated storage device 50 as permanent data, until trace data are absorbed from the host 10 or PC.例文帳に追加

制御装置２０は、ホスト１０あるいはサービスプロセッサ３０からの指示により、トレース採取の指示を発行し、ホスト１０あるいはＰＣからトレースデータを吸い上げるまではトレースデータを一時的にキャッシュメモリ２３に保持するか、あるいは、恒久的データとして指定された記憶装置５０にデータを格納する。 - 特許庁

The controller 100 manages, based on final reference time information of a corresponding table, the time when the thumbnail images to be kept in the cache memory 101 are finally displayed, deletes a thumbnail image that is least used when a new thumbnail image is created, and keeps the new thumbnail image instead.例文帳に追加

また制御部１００は、キャッシュメモリ１０１に保持しておくサムネイルイメージを最後に表示した時刻について、対応テーブルの最終参照時刻情報で管理し、新規のサムネイルイメージを作成した場合に、最も用いられないサムネイルイメージを削除して、代わりに新規のサムネイルイメージを保持するようにしたものである。 - 特許庁

This disk controller 10 for controlling the writing of data from a host computer 17 into the disk 15 is provided with a nonvolatile cache memory 12 for storing the data from the host computer to be written in the disk, a nonvolatile storage area 11 for storing the data from the host computer and a data transferring means 31.例文帳に追加

本発明は、ホスト計算機１７からのデータの、ディスク１５への書き込みを制御するディスクコントローラ１０であって、ディスクへ書き込まれるホスト計算機からのデータを記憶する不揮発性のキャッシュメモリ１２と、ホスト計算機からのデータを記憶する不揮発性の記憶領域１１と、データ転送手段３１とを備えている。 - 特許庁

To provide a disk array system, a disk array device and a configuration restoration method for storing RAID information, resource information such as a controller state or an HDD state and various setting information or the like, while having control information in an internal cache memory, and for using the control information for the control of the disk array device.例文帳に追加

内部のキャッシュメモリに制御情報を有し、制御情報にはＲＡＩＤ情報、コントローラ状態やＨＤＤ状態などのリソース情報、各種設定情報などを保持し、ディスクアレイ装置の制御に使用するディスクアレイシステム、ディスクアレイ装置および構成情報復帰方法を提供する。 - 特許庁

When the accelerator device is electrically connected to the host computer and the removable storage device is electrically connected to the accelerator device, the controller caches data transmitted from the host computer to the removable storage device into the cache memory prior to the data being transmitted from the accelerator device to the removable storage device.例文帳に追加

アクセラレータ装置がホストコンピュータに電気的に接続され、かつ取り外し可能な記憶装置がアクセラレータ装置に電気的に接続されるとき、コントローラは、ホストコンピュータから取り外し可能な記憶装置に送信されたデータをキャッシュメモリにキャッシュし、その後、データは、アクセラレータ装置から取り外し可能な記憶装置に送信される。 - 特許庁

In communication with the mobile terminal using a Mobile IP, the router (MAG) performs proxy processing of the Mobile IP, and even if the mobile terminal moves to another link, the controller informs the router of an instruction to transfer binding cache, header compression information, and data addressed to the mobile terminal and stored in a buffer.例文帳に追加

Ｍｏｂｉｌｅ ＩＰを利用する移動端末と通信する場合において、ルータ（ＭＡＧ）が、Ｍｏｂｉｌｅ ＩＰの代理処理を行ない、移動端末が他のリンクに移動した場合でも、制御装置がルータに、バインディング・キャッシュ、ヘッダ圧縮情報及び移動端末宛のバッファに溜まったデータを転送するよう指示通知を送信する。 - 特許庁