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connected referenceの部分一致の例文一覧と使い方

該当件数 : 1398



例文

The first substrate 1 has pixel electrodes 16 which are arranged in a matrix shape in a first direction and a second direction, reference signal lines 12 extending in the first direction, switching elements 15 which are connected to the pixel electrodes 16 and the reference signal lines 12, and first light shielding parts 13 each of which shields the gap of pixels 16 being adjacent with each other in the first direction.例文帳に追加

第1基板は、第1方向および第2方向に沿ってマトリクス状に配列された画素電極16と、第1方向に延びる基準信号線12と、画素電極16と基準信号線12とに接続されたスイッチング素子15と、第1方向に沿って互いに隣接する画素電極16の間隙を遮光する第1遮光部13を有する。 - 特許庁

The first digital-to-analog conversion circuit section 26 and the second digital-to-analog conversion circuit section 27 are cascade connected and the output current of the first digital-to-analog conversion circuit section 26 is inputted as the reference current of the second digital-to-analog conversion circuit section 27.例文帳に追加

第1のデジタル・アナログ変換回路部26と第2のデジタル・アナログ変換回路部27とは縦列接続されており、第1のデジタル・アナログ変換回路部26の出力電流が第2のデジタル・アナログ変換回路部27の基準電流として入力されている。 - 特許庁

An output signal of an oscillator 21 used for generating a reference signal inputted into a PLL circuit 20 connected to a local oscillator 13 is divided by a frequency divider 24, thereby generating a test signal included in the receiving band of an AM broadcast.例文帳に追加

局部発振器13に接続されたPLL回路20に入力される基準信号を生成するために用いられる発振器21の出力信号を分周器24で分周することにより、AM放送の受信帯域に含まれる試験信号が生成される。 - 特許庁

After receiving a pulse of an external clock signal CLK, for example, a reference pulse signal RPUL with a narrower pulse width than the external clock signal is generated, and the RPUL is circulated in a delay ring part DLYRG to which a unit delay block DLYBK is connected in a ring shape.例文帳に追加

例えば、外部クロック信号CLKのパルスを受けて、これよりも細いパルス幅を備えた基準パルス信号RPULを発生し、単位遅延ブロックDLYBKがリング状に接続されたディレイリング部DLYRG内でこのRPULを巡回させる。 - 特許庁

例文

The A/D conversion circuit includes an input terminal IN, a current mirror circuit constituted of a transistor N10 and transistors N20 to N23, and constant-current sources 320 to 323 connected to the respective transistors N20 to N23 to supply reference currents I20 to I23.例文帳に追加

A/D変換回路は、入力端子INと、トランジスタN10と各トランジスタN20〜N23とによって構成されるカレントミラー回路と、各トランジスタN20〜N23に接続されて基準電流I20〜I23を流す定電流源320〜323とを備えている。 - 特許庁


例文

Meanwhile, when the detected voltage value is equal to or lower than the operation reference voltage, some of the LEDs connected in series out of the plurality of the LEDs are lighted by the DC power supplied by voltage control in conformity with the voltage value of the DC power (Step S5).例文帳に追加

一方、検出電圧値が動作基準電圧以下である場合には、複数のLEDの中の直列接続された一部のLEDを、直流電力の電圧値に応じた電圧制御により直流電力を供給して点灯させる(ステップS5)。 - 特許庁

A comparison device 42, to which a signal connected to feeding voltage VB and a reference signal VREF, is fed and generates a differential signal VDIFF and controllers 43,..., 48 control the amplitude of a power stage, dependent on the differential signal.例文帳に追加

給電電圧VBに結合されている信号並びに基準信号VREFが供給されかつ差信号VDIFFを発生する比較装置42を備え、電力段の増幅度を該差信号に依存して制御するための制御装置43,…,48を備えている。 - 特許庁

A second comparator CMP2 is so constructed that an input transistor is formed by an N-type MOS transistor, +side input terminal is connected to the signal input terminal T40A through a P-type MOS transistor 62P, and a second reference signal Sref2 is supplied to -side input terminal.例文帳に追加

第2のコンパレータCMP2は、入力トランジスタがN型MOSトランジスタで構成され、+側入力端子がP型MOSトランジスタ62Pを介して信号入力端子T40Aに接続され、−側入力端子には第2の基準信号Sref2が供給される。 - 特許庁

The battery pack capacity adjuster 1 uniformly adjusts charging rates among cells by discharging the cells when voltages of any cells in a battery pack 11 in which a plurality of the unit cells are connected, exceed a reference voltage, and is provided with a CPU 23.例文帳に追加

組電池容量調整装置1は、複数個の単位セルを接続してなる組電池11の各セルのうち、いずれかの電圧が基準となる電圧を超えた場合に、そのセルについて放電させることで各セル間の充電率を均一に調整するものである。 - 特許庁

例文

In resolvers 35, 37, and 44, while the other end of each resolver coils 82a to 82c evenly arranged to the rotating center of a resolver rotor is electrically connected to one connection point 83, the voltage of the connection point 83 is maintained at a predetermined reference voltage.例文帳に追加

レゾルバ35,37,44では、レゾルバ回転子の回転中心に対し均等に配置される各レゾルバコイル82a〜82cの他端が1つの接続点83にて電気的に接続されるとともに、この接続点83の電圧が所定の基準電圧に維持されている。 - 特許庁

例文

The variable matching circuit 118 includes a circuit corresponding to a degree (state) of deviation of the amplitude and the phase of the feedback signal to the reference signal, and the circuit is switched according to the control information outputted from the comparison part 116 to be connected with a matching circuit 111.例文帳に追加

可変整合回路118は、基準信号に対する帰還信号の振幅及び位相のずれの度合い(状態)に応じた回路を備えており、比較部116から出力された制御情報に従って、回路を切り替えて整合回路111と接続する。 - 特許庁

A first selector 31 is connected with the first input/output section 34 and the second input/output section 35, selects either the first input/output section 34 or the second input/output section 35, and outputs a reference signal received via the selected input/output section.例文帳に追加

第1選択器31は、第1入出力部34および第2入出力部35と接続し、第1入出力部34または第2入出力部35のいずれかを選択し、選択した方の入出力部で受信した基準信号を出力する。 - 特許庁

This reference voltage generating circuit is characterized by that the dense resistor groups 12, 13, 15, and 16 are provided by the groups of the switches SA1 to SA4 and SB1 to SB4 and the respective dense resistor groups 12, 13, 15, and 16 are connected to the resistors R1 constituting the coarse resistor group 11 in parallel.例文帳に追加

この基準電圧発生回路は、密の抵抗群12,13,15,16がスイッチSA1〜SA4,SB1〜SB4の各組毎に設けられ、各密の抵抗群12,13,15,16を粗の抵抗群11を構成する抵抗R1に並列に接続される。 - 特許庁

Further, the tap changing circuit 72 is provided with a reference lead-out line T0 of the primary winding 711, plural taps T1, T2, T3 and T4 led out at the different positions of the primary winding 711 and solid-state relays 77, 78, 79 and 80 connected to the taps T1, T2, T3 and T4.例文帳に追加

また、タップ切換回路72は、一次巻線711の基準引出線T_0と、一次巻線711の互いに異なる位置から引き出された複数のタップT_1,T_2,T_3,T_4と、各タップT_1,T_2,T_3,T_4に接続されたソリッドステートリレー77,78,79,80を備える。 - 特許庁

A correction capacitor 14 whose static capacitance is C/2^x (wherein x is 2 or 3) is connected via a switch 15 between an internal node N and a line of a reference voltage VL, and charged up to a voltage VL-VT (wherein VT is a threshold voltage of an inverter 21) in a hold operation state.例文帳に追加

内部ノードNとゼロスケール基準電圧VLの間に、スイッチ15を介して静電容量がC/2^x(但し、xは2または3)の補正キャパシタ14を接続し、ホールド動作時にVL−VT(但し、VTはインバータ21の閾値電圧)に充電する。 - 特許庁

A command line LC is connected to changeover terminals of the tristate buffers 36c and 36d, and the output of either the reference voltage generation part 36a or the sensing part 36b is applied to the output line LC by applying an instruction signal C to the command line LC.例文帳に追加

トライステートバッファ36c、36dの切替端子には、コマンドラインLCが接続されており、コマンドラインLCに指示信号Cを印加することで、出力ラインLCに、基準電圧発生部36a及びセンシング部36bのいずれか一方の出力を印加する。 - 特許庁

A second thyristor 16 is connected between the battery 10 and a charging terminal 10d, and the device preferably includes a second reverse voltage applying circuit 19 for applying the reverse voltage to the thyristor 16 when the charging voltage of the reference voltage or higher is detected.例文帳に追加

二次電池10と充電用端子10dの間に第2サイリスタ16を接続し、充電基準電圧以上の充電電圧を検出したとき第2サイリスタ16に逆電圧を印加する第2逆電圧印加回路19とを備えることが好ましい。 - 特許庁

The present invention relates to a SAW device 1 in which reference potential wiring 24 having a first area 24a connected to a plurality of parallel resonators 21 in common and a second area 24b extending from the first area 24a is formed on a piezoelectric substrate 3.例文帳に追加

圧電基板3に、複数の並列共振子21に共通に接続された第1領域24aおよび第1領域24aから延出された第2領域24bを有する基準電位配線24が形成された弾性表面波装置1である。 - 特許庁

According to an embodiment, a semiconductor device includes a low-side switching element having a second switching element and a third switching element connected in parallel between an inductive load and a reference voltage line, and a control circuit that turns ON/OFF the third switching element.例文帳に追加

実施形態によれば、半導体装置は、誘導性負荷と基準電圧ラインとの間に並列接続される第2のスイッチング素子と第3のスイッチング素子とを有するローサイドスイッチング素子と、第3のスイッチング素子をオンオフする制御回路とを備えている。 - 特許庁

The alternative route connected to the whole of the piezoelectric elements 111 via an analog switch 114b and diodes 112-1 to 112-n is excited when the waveform signal COM is not larger than a reference voltage, and supplements potentials of discharging piezoelectric elements.例文帳に追加

アナログスイッチ114b及びダイオード112の1〜112のnを介して全圧電素子111に接続されている、この迂回経路は、波形信号COMが基準電圧以下であるときに導通され、放電を起こしている圧電素子の電位を補充させる。 - 特許庁

At the connection point of the diode D1 and the second capacitor C2, one end of a resistor R3 is connected, and bias current Ib of continuous current passes through the connection point via the resistor R3 by applying a predetermined reference voltage Vbias to the other end of the resistor R3.例文帳に追加

更に、ダイオードD1と第2コンデンサC2との接続点には、抵抗R3の一端が接続され、この他端に所定の基準電圧Vbiasを印加して、抵抗R3を介して上記接続点に直流のバイアス電流Ibを流すようにしている。 - 特許庁

A reset circuit 10 constituted of a P type MOS transistor 16, a resistance 18, an N type MOS transistor 20, a capacitor 22, a comparator 24 and a reference voltage source 26 is connected with an MCU 14 for outputting a switching signal for switching a CRT 12.例文帳に追加

CRT12をスイッチングするスイッチング信号を出力するMCU14には、P型MOSトランジスタ16、抵抗18、N型MOSトランジスタ20、コンデンサ22、コンパレータ24及び基準電圧源26を含んで構成されるリセット回路10が接続されている。 - 特許庁

A four-phase input-output transconductance amplifier 13 is connected between the first or fourth input terminals 11a, 11b, 11c, and 11d and a reference potential GND in order to pass signals of phase differences of 0° and 180° through the four-phase input-output RC polyphase filter 11.例文帳に追加

4相入出力トランスコンダンタンスアンプ13は、第1乃至第4入力端子11a、11b、11c、11dと基準電位GNDの間に接続され、4相入出力RCポリフェイズフィルタ11に位相差が0°および180°の信号を通過させる。 - 特許庁

A positive input terminal of an operational amplifier 17 is applied with a reference potential, while a negative input terminal is applied with a detection potential of a load sensor 13, with an output terminal connected to a first power supply line 14, which becomes a high level via a resistor R2.例文帳に追加

オペレーションアンプ17は、プラス入力端子に基準電位が印加されるとともにマイナス入力端子に荷重センサ13の検出電位が印加され、出力端子が抵抗R2を介してハイレベルとなる第1電源線14に接続されている。 - 特許庁

The initial group of genes using a tree structure expressing an unit arrangement is generated (step 301), unit positions are confirmed from genetic information (step 302), units are connected (step 303), and adaptivity is calculated for each individual on the basis of an evaluation reference (step 304).例文帳に追加

ユニット配置を表す木構造を用いた遺伝子の初期集団を生成し(ステップ301)、遺伝子情報からユニット位置を確認し(ステップ302)、ユニット間の結線を行い(ステップ303)、各固体に評価基準に基づいた適応度計算を行う(ステップ304)。 - 特許庁

This circuit is provided with a logic circuit for impressing reference clock to the respective flip-flops in the first stage and for calculating the logical product of a clock signal and the coincidence signal of the comparator, and the logical product signal is impressed to the serially connected respective flip flops in the second stage as the clock signal.例文帳に追加

基準クロックを1段目の各フリップフロップに印加し、かつ、クロック信号と比較器の一致信号との論理積をとる論理回路を設け、この論理積信号を直列接続された2段目の各フリップフロップにクロック信号として印加する。 - 特許庁

The voltage detection circuit 3 with a detection switch 12 being changed over to OFF and being connected to a voltage detecting wire 10, and the detection switch 12 detects the voltages of the voltage detection point 7, and detects the breaking of reference connecting wire 9 from the detected voltages.例文帳に追加

電圧検出回路3は、電圧検出ライン10に検出スイッチ12を接続しており、この検出スイッチ12をオフに切り換える状態で、電圧検出点7の電圧を検出して、検出電圧から基準接続ライン9の断線を検出する。 - 特許庁

When it is judged that the printer is connected, group information corresponding to the printer is generated, and reference environmental setting data stored in a prescribed storage means are stored so as to be associated with the group information as the environmental setting data in the storage means.例文帳に追加

本発明では、プリンタが接続されたと判定された場合、該プリンタに対応するグループ情報を生成し、所定の記憶手段に記憶される基準環境設定データを、上記環境設定データとして、該グループ情報に関連づけて保持手段に保持させる。 - 特許庁

An X-ray image recognizing and automatic position measuring system, connected with the X-ray imaging equipment and the NC control X-Y table is then operated, and an inner layer reference hole mark 4, as shown in Fig. 1 (a) and Fig. 1 (b) of the working board of printed wiring board is read by X-rays.例文帳に追加

次いで、X線画像装置とNC制御X−Yテーブルとに接続されたX線像認識ならびに位置自動計測システムを稼動し、前記プリント配線板作業ボードの図1(a)、図1(b)に示す内層基準孔マーク4をX線で読取る。 - 特許庁

Further, an internal pixel capacitor Cs1 and the external pixel capacitor Cs1' where the signal voltage Vcs1 and reference voltage Vcs1' are sampled are connected to each other and the difference is obtained and held as a control voltage Vcs1'' in the internal pixel capacitor Cs1.例文帳に追加

更に信号電圧Vcs1と基準電圧Vcs1´をサンプリングした内部画素容量Cs1と外部画素容量Cs1´を相互に接続して差分を求め且つ求めた差分を制御電圧Vcs1´´として内部画素容量Cs1に保持する。 - 特許庁

A comparator 6 compares a voltage drop of a shunt current flowing to a sense resistance 5 connected to the sense TFT 4 with a reference voltage VR corresponding to a voltage drop across the sense resistance 5 needed to supply a specified current to the driving TFT 3.例文帳に追加

センスTFT4に接続したセンス抵抗5を流れる分流電流の電圧降下と駆動用TFT3に所定の電流を流すのに必要なセンス抵抗5での電圧降下に対応した基準電圧VRとをコンパレータ6により比較する。 - 特許庁

A database reference device is installed in such a way that an operated value, a worked value and a measured value from the plant operation start of a plant apparatus and a measuring device which is connected to the apparatus are input from an abnormality data storage device 5, a working-record storage device 10 and a related apparatus database 11.例文帳に追加

プラントの機器とこの機器に接続された測定器のプラント稼動開始からの操作値,動作値と測定値を異常データ記憶装置5と動作記録記憶装置10及び関連機器データベース11から入力するデータベース参照装置12を設ける。 - 特許庁

Because only one set of the PMOS and the NMOS are connected between a power supply potential VCC and a ground potential GND, the constant reference voltage VREF not depending on an ambient temperature and the power supply potential VCC can be obtained even if a power supply voltage is the low power supply voltage of about 1.5 V.例文帳に追加

電源電位VCCと接地電位GND間には、1組のPMOSとNMOSだけが接続されるので、1.5V程度の低電源電圧でも、電源電位VCCと周囲温度に依存しない一定の基準電圧VREFが得られる。 - 特許庁

Thus, the reference position of the thermal expansion in the injection direction can be set near the connected part between the accumulator and the injection barrel; a position of the accumulator is fixed; a machine can be assembled on the basis of the position of the accumulator; and maintenance work is facilitated.例文帳に追加

したがって、射出方向における熱膨張の基準位置をアキュムレータと射出バレルとの結合部近傍に設けることが可能であり、アキュムレータの位置を固定し、これを基準にして機械の組み付けが可能となり、メンテナンス作業も容易になる。 - 特許庁

Half- blanking machined parts 36 (36a and 36s) are provided at locations offset from reference lines M, which connect inner corners 34 (34a and 34s) to their opposite outer corners 33, and the core pieces 32 are connected to one another by the half-blanking machined parts 36.例文帳に追加

内側コーナー34(34a,34s)と、これに対向する外側コーナー33とを結ぶ基準線Mに対してオフセットした位置には半抜き加工部36(36a,36s)が設けられ、これによりの半抜き加工部36により各コア断片32が連結されている。 - 特許庁

To provide a semiconductor temperature detecting circuit capable of automatically compensating for variations at manufacturing in reference voltages for comparing the output of temperature sensors in the semiconductor temperature detecting circuit to use semiconductor temperature sensors comprised of a Darlington-connected bipolar transistor.例文帳に追加

ダーリントン接続されたバイポーラトランジスタからなる半導体温度センサーを用いた半導体温度検出回路において、温度センサーの出力を比較する基準電圧の製造時のバラツキを自動的に補償できる半導体温度検出回路を提供する。 - 特許庁

In this case, the other amplifier stage V2 is connected with the reference potential connecting part GND with the lower ohmic characteristics when input current U1 to be generated in an amplifier input terminal IN1 of the amplifier stage V1 is provided with a DC operating point to activate the amplifier stage V1.例文帳に追加

その際、他方の増幅器段V2は、増幅器段V1の増幅器入力端子IN1に生じる入力電圧U1が増幅器段V1を活性化する直流動作点を有するときに、基準電位接続部GNDに低オーム性に接続されている。 - 特許庁

Client computers 12 and a server machine 20 are connected on a network and this system has a commerce data storage means, a foreign exchange dealing data storage means, an account reference currency converting function, a commerce data output function, and a foreign exchange dealing data output function.例文帳に追加

複数のクライアント計算機12とサーバ計算機20がネットワーク上で接続され、商取引データ記憶機能、外国為替取引データ記憶機能、会計基準通貨換算機能、商取引データ出力機能、外国為替取引データ出力機能を有する。 - 特許庁

A current control transistor 316a and a current driver transistor 315 are serially connected between an external power supply node 300a and an internal power supply node 300c, and the conducted states thereof are controlled in accordance with a difference between a reference potential Vref independent of the external power supply potential and a potential of the internal power supply node.例文帳に追加

外部電源ノード300aと内部電源ノード300cとの間に直列に電流制御トランジスタ316aと電流ドライバトランジスタ315とを接続し、これらの導通状態を、外部電源電位と独立な基準電位Vrefと内部電源ノードの電位との差に応じて制御する。 - 特許庁

The updated history of condition information is stored for a preliminarily designated arbitrary period in a server 31, and accessed from an arbitrary condition history reference terminal 41 connected to an arbitrary network 01 to provide information used for statistics, analysis, and management or the like.例文帳に追加

サーバ31にて状態情報の更新履歴を予め指定される任意の期間蓄積し、任意のネットワーク01に接続された任意の状態履歴参照用端末41からアクセスすることで、統計、分析、管理等に利用される情報の提供を行う。 - 特許庁

The detector circuit is connected to a common connection point, thereby to detect a high frequency signal which has been output from the drain terminal of the field effect transistor 131 and to apply detection voltage with the potential at the common connection point as reference to the gate terminals of the field effect transistors 131, 132.例文帳に追加

検波回路は共通接続点に接続され、電界効果トランジスタ131のドレイン端子から出力された高周波信号を検波し、共通接続点の電位を基準とした検波電圧を電界効果トランジスタ131、132のゲート端子に印加する。 - 特許庁

When the reply this time has a reply with the highest signal level, the repeater 5 discriminates that the called terminal 4 is connected to a bank from which the call signal is sent and registers the cross-reference between the terminal and the bank to the memory 16 (step 104).例文帳に追加

今回の応答が最大の信号レベルを有する応答であれば、中継器5は、呼び出した端末器が呼び出し信号を送出したバンクに接続されているものと判断し、その端末器とバンクとの関係をメモリ16に登録する(ステップ104)。 - 特許庁

To solve such a problem that it is required for a dummy cell to gener ate a reference potential for every read-out of each data cell connected to the same cell array, deterioration of dummy cells of which the number of times of read-out is more than that of data cells is aggravated, and an intermediate potential cannot be generated correctly.例文帳に追加

同一のセルアレイに接続された各データセルを読み出す毎にダミーセルは参照電位を発生させる必要があり、データセルと比較して読み出し回数の多いダミーセルのみ劣化が進み、正しく中間電位を発生させることができなくなる。 - 特許庁

This semiconductor device is provided with a switching circuit 9 having a plurality of switches SW1-SW6 connected in parallel to built-in bias resistors R1-R5 directly connected between a reference voltage application terminal 2 for driving and a ground part 8.例文帳に追加

駆動用の基準電圧印加端子2と接地部8の間に直列接続した内蔵バイアス抵抗R1〜R5に対して並列に接続した複数のスイッチSW1〜SW6を有するスイッチング回路9を備え、スイッチング回路9の各々のスイッチSW1〜SW6を、スイッチング制御部10の制御レジスタにより個別にON、OFFさせることにより、内蔵バイアス抵抗R1〜R5の抵抗値を測定する。 - 特許庁

Applications present on a plurality of computers connected to the Internet and data bases present in a plurality of data servers connected to the Internet are linked by using XML and execute tagging by using a reference tag set which is common to a tag included in input/output data of the application and a tag included the data on the data server that become the same tag for the same kind of the data.例文帳に追加

XMLを用いて、アプリケーションの入出力データに含まれるタグとデータサーバ上のデータに含まれるタグとが同じ種類のデータには同じタグとなるように構成された両者の共通のタグであるレファレンスタグセットを用いてタグ付けし、インターネットに接続された複数の計算機上にあるアプリケーションと、インターネットに接続された複数のデータサーバにあるデータベースとを連携する。 - 特許庁

To stabilize the potential of a gate drive circuit by making the same potentials of the reference-potential side output terminal of the gate drive circuit and each emitter side of a plurality of parallel-connected switching elements, while suppressing current imbalances or unstable phenomena of the plurality of parallel-connected switching elements, and to prevent an abnormal voltage from being applied to the gate drive circuit.例文帳に追加

本発明は、並列接続した複数のスイッチング素子の電流不平衡あるいは不安定現象を抑制した上で、ゲート駆動回路の基準電位側出力端子と並列接続した複数のスイッチング素子の各エミッタ側とを同電位にしてゲート駆動回路の電位を安定にし、ゲート駆動回路に異常な電圧が印加されるのを防止することを目的とする。 - 特許庁

In the CR phase shifter adopting the connection above, a local signal is given to an upper electrode C1 via a coupling capacitor Cin, an upper electrode C2 is connected to a point to which a reference level is set, and the CR phase shifter is connected to an external circuit so that output signals 56, 57 of the CR phase shifter are extracted respectively from lower electrodes D1, D2.例文帳に追加

このように接続されたCR移相器に対して、上部電極C1に結合容量Cinを通してLOCAL信号を入力し、上部電極C2を基準電位に接続し、下部電極D1と下部電極D2からCR移相器出力信号56、57をそれぞれ取り出すように、このCR移相器を外部の回路と接続する。 - 特許庁

A base terminal of the pnp bipolar transistor is connected to a reference power supply terminal connected to the circuit to be protected, and a Zener diode caused to be conductive when a voltage to be applied to both ends is not less than a predetermined voltage and interrupted when the voltage is less than the predetermined voltage is provided between the base terminal of the pnp bipolar transistor and a collector terminal of the npn bipolar transistor.例文帳に追加

そして、pnpバイポーラトランジスタのベース端子を、被保護回路に接続する基準電源端子に接続させると共に、pnpバイポーラトランジスタのベース端子とnpnバイポーラトランジスタのコレクタ端子との間に、両端に印加される電圧が所定電圧以上である場合に導通し、一方、所定電圧未満である場合に遮断するツェナーダイオードを設ける。 - 特許庁

The displacement detection device is composed of a circuit connected with an electric source and a reference impedance element of a known impedance in serial and arranged so as to generates a complementary impedance variation depending on the relative positional relation between the fixed member and the movable member, and the circuit comprises the 1st impedance element and the 2nd impedance element connected in parallel, respectively.例文帳に追加

この変位検出装置は、電源と既知のインピーダンス値を有する基準インピーダンス素子とが直列に接続される回路と、該固定部材と該可動部材との相対的な位置関係によって互いに相補的なインピーダンスの変化を生じるように配置され、該回路にそれぞれが並列に接続される第一インピーダンス素子および第二インピーダンス素子とを備える。 - 特許庁

例文

A delay time measuring apparatus for indirectly measuring a delay time between IP telephone terminals connected to an unspecified network, a jitter resistance measuring apparatus for calculating the jitter resistance of the IP telephone terminals connected to the unspecified network, and a conversation quality evaluating apparatus for calculating a jitter amount from the calculated delay time and evaluating conversation quality with reference to the jitter resistance, are employed.例文帳に追加

不特定のネットワークに接続されたIP電話端末間の遅延時間を間接的に算出する遅延時間測定装置と、不特定のネットワークに接続されたIP電話端末のジッター耐性を算出するジッター耐性測定装置と、算出した遅延時間からジッター量を算出し、ジッター耐性を基準として通話品質を評価する通話品質評価装置を用いる。 - 特許庁




  
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