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Integrated Controlの部分一致の例文一覧と使い方

該当件数 : 2675



例文

To provide a variable wavelength laser light generating device equipped with an integrated variable wavelength laser device where TDA-DFB elements (Tunable Distributed Amplification-Distributed Feedback Laser) are arranged in an array, the device being characterized in that the TDA-DFB elements can be preheated, system constitution is simple, and control is easy.例文帳に追加

アレイ状にTDA−DFB素子(Tunable Distributed Amplification−Distributed Feedback Laser)が配置された集積波長可変レーザ装置を備えた波長可変レーザ光発生装置であって、TDA−DFB素子の予備加熱が可能で、しかも、システム構成が簡単で且つ制御が容易な装置を提供すること。 - 特許庁

The engine controller 107 is provided with integrated circuits 200, 112 and 113 inputted with various types of sensor signals via input terminals 20-0 to 20-n to carry out arithmetic processes necessary for control, and an output voltage regulating circuit 250 for selectively setting a rated voltage used in normal operation and a rated voltage for screening.例文帳に追加

エンジン制御装置107は、各種のセンサ信号を入力端子20−0〜20−nを介し入力して、制御に必要な演算処理を行なう集積回路200、112,113と、通常動作に用いる定格電圧とスクリーニングするための定格電圧とを選択的に設定し得る出力電圧調整回路250とを備える。 - 特許庁

Each controller integrated circuit (IC) is provided with a controller IC, a memory control logic controlling communication between the data memories connected to the controller IC, a parity logic calculating the parity information of the data communicated to or from the data memories, a logic communicating with IC accompanying the parity information to or from a companion IC and a logic communicating the data to or from the companion IC.例文帳に追加

各コントローラ集積回路(IC)は、コントローラICと、コントローラICに接続されたデータメモリとの間の通信を制御するメモリ制御ロジックと、データメモリに/から通信されるデータのパリティ情報を計算するパリティロジックと、パリティ情報を随伴するICに/から通信するロジックと、随伴ICに/からデータを通信するロジックとを備える。 - 特許庁

In the light-emitting device 1 wherein the light-emitting element 6 and a lighting control circuit 7 are arranged on a metal base FPC 5 formed by making a flexible printed (FPC) board 8 formed by integrating copper foil patterns 9 (conductors) with a film integrated with a flexible metal base 12, an end of the metal base FPC 5 is formed as a thick-walled terminal.例文帳に追加

銅箔パターン9(導電体)をフィルムに一体化して形成したフレキシブルプリント(FPC)基板8を可撓性を有する金属製ベース12に更に一体化することによって形成したメタルベースFPC5に発光素子6と点灯制御回路7を設けた照明装置1であって、メタルベースFPC5の端部を厚肉状の端子部として形成した。 - 特許庁

例文

(i) To push forward the development of practical applications of Japan’s outstanding innovative medical technologies, establish control tower functions (Japanese version of NIH) which will create arrangements to ensure integrated research management, the linking of research and clinical practice, and high quality clinical research and clinical trials that meet international standards. (Submit bill to establish new independent administrative agency to Diet during next ordinary session) 例文帳に追加

(ⅰ)我が国の優れた医療分野の革新的技術の実用化を強力に後押しするため、一元的な研究管理、研究から臨床への橋渡し、国際水準の質の高い臨床研究・治験が確実に実施される仕組みの構築等を行う司令塔機能(日本版NIH)を創設する。 【次期通常国会に新独法設立法案提出】 - 経済産業省


例文

The apparatus of designing the semiconductor integrated circuit having a boundary scan function includes a distance calculation means for calculating a distance between the plurality of timing adjustment buffers and an insertion means for inserting a plurality of boundary scan registers to the poststage of the supply source of control signals so as to drive the plurality of timing adjustment buffers by the control signals within a prescribed period on the basis of the distance calculated by the distance calculation means.例文帳に追加

上記課題は、バウンダリスキャン機能を有する半導体集積回路の設計装置であって、複数のタイミング調整用バッファ間の距離を算出する距離算出手段と、前記距離算出手段により算出された距離に基づき、所定期間内にコントロール信号により前記複数のタイミング調整用バッファが駆動するように、複数のバウンダリスキャンレジスタを前記コントロール信号の供給元の後段に挿入する挿入手段と、を有する半導体集積回路の設計装置により達成される。 - 特許庁

An integrated circuit 101 having an internal CPU 102 and an internal SRAM 103 is mounted with the external interface having a parallel communication SRAM 104 accessible to both internal CPU 102 and external CPU 110 and a bus control circuit 105 having an arbitration function 105a of arbitrating access from the internal CPU 102 and access from the external CPU 110 and for executing access control denying access from the external CPU 110 to the internal SRAM 103.例文帳に追加

内部CPU102と内部SRAM103とを備えた集積回路101に、上記内部CPU102と上記外部CPU110の双方からアクセス可能なパラレル通信用SRAM104と、上記内部CPU102からのアクセスと上記外部CPU110からのアクセスを調停する調停機能105aを有し、上記外部CPU110から上記内部SRAM103へのアクセスを受け付けないようにアクセス制御を行うバスコントロール回路105とを備えた外部インターフェースを搭載した。 - 特許庁

The content sales terminal 11 comprises a content capsulation execution part 25 for checking, in receipt of permission of capsulation from the terminal 15, a content use condition in the use of a content, adding a capsule control program enabling the use of the content concerned only when it satisfies the condition, and capsulating them as an integrated inseparable capsule.例文帳に追加

コンテンツ販売端末11には、著作権保護管理端末15からカプセル化の許諾があった場合に、指定されたコンテンツに、コンテンツ利用時にコンテンツ利用条件のチェックを行って条件を満たす場合にのみ当該コンテンツを利用可能にするカプセル制御プログラムを付加し、これらを一体不可分のカプセルとしてカプセル化するコンテンツカプセル化実行部25を設ける。 - 特許庁

The semiconductor integrated circuit having a plurality of internal registers connected by a scanning chain and capable of setting initializing data in these internal registers comprises a decompression part for decompressing the initializing data inputted in a compressed state and a control part for setting the initializing data decompressed by the decompression part in the internal registers.例文帳に追加

スキャンチェーンで接続された複数の内部レジスタを有し、初期設定データを前記内部レジスタに設定する半導体集積回路であって、圧縮された状態で入力される初期設定データを解凍する解凍部と、スキャンチェーンに従って、前記解凍部により解凍された前記初期設定データを前記内部レジスタに設定する制御部とを有することとした。 - 特許庁

例文

This personal computer(PC) cluster configured by connecting a plurality of slave PC 21, 22, to 2n in parallel is integrated with software for distribution control which divides calculation processing in a batch applied by application software into a plurality of unit processing by the number of division in accordance with the complicatedness, and distributes each unit processing to the number of slave PC corresponding to the number of division.例文帳に追加

複数台のスレーブPC21、22、……2nが並列に接続されてなるPCクラスタについて、アプリケーションソフトウエアで与えられる一まとまりの計算処理をその複雑さに応じた分割数で複数の単位処理に分割し、この各単位処理を分割数に対応する台数のスレーブPCに分配する分配制御用のソフトウエアを組み込むようにしている。 - 特許庁

例文

Part 8a of a pinion on a pressure release lever 8 turnable via cam 10 meshes with a rack 2a integrated with the leading end of an intermediate plate 2 to thereby control the lowering position of the intermediate plate 2 such that an uppermost sheet S on the intermediate plate 2 is maintained at the same height while a sheet feed roller 3 is in a standby position away from the uppermost sheet S.例文帳に追加

カム10により回動する圧解除レバー8の歯車の一部8aが中板2の先端部に一体的に設けたラックギア2aに噛合し、給送ローラ3が中板2上の最上位のシートSに接触しない待機状態での該最上位のシートSの高さを一定にするように中板2の下降位置を制御するように構成したことを特徴とする。 - 特許庁

The controller receives communication quality information which is measured result of whether or not communication quality of data communication transmitted through a plurality of radio access bearers is good, integrates it to one, calculates a quality target value which is a target value of the communication quality for instructing power control from the integrated communication quality information, and controls the quality target value established in the base station device.例文帳に追加

複数の無線アクセスベアラを介して送出された、データ通信の通信品質が良好であるかの測定結果である通信品質情報を受信して1つに集約し、集約した通信品質情報から電力制御指示を行うための通信品質の目標値である品質目標値を算出して、基地局装置に設定されている品質目標値を制御する。 - 特許庁

Even in the case of receiving the variation pattern command, when an under continuous reproduction end flag is OFF (S122:NO) and the variation pattern command of complete losing is received (S129:YES), a sub integrated control board 280 does not instruct the output of the normal variable BGM without newly setting a command for outputting the normal variable BGM.例文帳に追加

サブ統合制御基板280は、変動パターンコマンドを受信した場合であっても、連続再生終了中フラグがOFFとなっている場合であって(S122:NO)、完全ハズレの変動パターンコマンドを受信した場合(S129:YES)であっては、新たに通常変動BGMを出力する指令コマンドをセットすることなく、通常変動BGMの出力指示を行うことが無いように構成する。 - 特許庁

A processor 100 comprises an integrated circuit mounted with an SIMD type arithmetic device 16 and an arithmetic device 14 thereon, each capable of executing arithmetic operation in parallel, and in order to minimize arithmetic operation time of predetermined instructions, a schedule control device 11 distributes the arithmetic operation initiated by the instructions to the SIMD type arithmetic device 16 and the arithmetic device 14.例文帳に追加

互いに並列に演算を実行可能なSIMD型演算装置16及び演算装置14を1つの集積回路に搭載したプロセッサ100であって、所定の命令の演算時間が最小になるように、前記命令に伴う演算をSIMD型演算装置16と前記演算装置14に配分するスケジュール制御装置11、を有することを特徴とする。 - 特許庁

The hybrid integrated circuit device 10 mainly includes a circuit board 18 made of a metal, a power substrate 13 formed on an upper surface of the circuit board 18, a control substrate 11 disposed on the upper surface of the circuit board 18 in adjacent to the power substrate 13, and a case material 12 defining a space for sealing with a resin in contact with an upper peripheral surface of the circuit board 18.例文帳に追加

本発明の混成集積回路装置10は、金属から成る回路基板18と、回路基板18の上面に配置されたパワー基板13と、パワー基板13に隣接するように回路基板18の上面に配置される制御基板11と、回路基板18の周辺部上面に接触して樹脂封止の為の空間を形成するケース材12とを主要に備えている。 - 特許庁

An IrDA system communication function is added to electronic equipment by such manners that a data transmission path connecting a Main CPU 21 and a level conversion driver 22 formed in the existing electronic equipment is branched, connected to an IrDA transceiver 24 which transmits and receives an infrared signal and connected to a semiconductor integrated circuit 1 having an IrDA system communication control function.例文帳に追加

既存の電子機器内に構成されるMainCPU21とレベル変換ドライバ22とを接続するデータ伝送路を分岐して、赤外線信号を送受信するIrDAトランシーバ24が接続されるとともにIrDA方式の通信制御機能を有する半導体集積回路装置1を接続することによって、該電子機器にIrDA方式の通信機能を付加する。 - 特許庁

When the fuel feed by a nozzle 30 is started, a control circuit 36 integrates the flow rate pulse output from a flow meter 42, displays the numerical value of the integrated fuel feed on a display 27 of a measuring machine body 28, and also transmits the same flow rate display data to a nozzle display unit 90 mounted on the nozzle 30 via a radio transmitter 92.例文帳に追加

制御回路36は、ノズル30による燃料供給が開始されると、流量計42から出力された流量パルスを積算し、その積算された燃料供給量の数値を計量機本体28の表示器27に表示させると共に、無線送信機92を介してノズル30に搭載されたノズル表示ユニット90にも同じ流量表示データを送信する。 - 特許庁

The integrated circuit device includes a scanning driver block SB for generating a control signal for driving a scanning line; a pad PDt electrically connected with the scanning line; and transistors pDTrt and nDTrt of which a connection node DNDt is electrically connected with the pad PDt and which are push-pull connected between a high-potential-side power source and a low-potential-side power source.例文帳に追加

集積回路装置は、走査線を駆動するための制御信号を生成する走査ドライバブロックSBと、走査線と電気的に接続するためのパッドPDtと、その接続ノードDNDtがPDtパッドと電気的に接続され、高電位側電源及び低電位側電源の間にプッシュプル接続されるトランジスタpDTrt、nDTrtとを含む。 - 特許庁

The integrated circuit device 10 comprises a sampling clock CLK 90 delaying from a reference clock DQS by a predetermined phase, a DLL circuit for generating a CLK 270, an input circuit S/P for taking in data inputted synchronously with the reference clock DQS, and a function macro 30 consisting of a plurality of function blocks for performing access control to an external memory 20 and applying predetermined processing to the data.例文帳に追加

集積回路装置10は,基準クロックDQSから所定の位相遅れたサンプリングクロックCLK90,CLK270を生成するDLL回路,基準クロックDQSに同期して入力されるデータを取り込む入力回路S/P,外部メモリ20へのアクセス制御を行い当該データに対して所定の処理を行う複数の機能ブロックからなる機能マクロ30を有する。 - 特許庁

The semiconductor integrated circuit has a main circuit 10 consisting of a plurality of circuit blocks 11 including a CMOS transistor having a substrate terminal, and substrate bias control circuits 9 each connected with a corresponding circuit block 11 among the plurality of circuit blocks 11 for determining a substrate bias voltage of the circuit block 11 depending on a quantity of noise occurring on the block 11.例文帳に追加

半導体集積回路は、基板端子を有するCMOSトランジスタを含む複数の回路ブロック11からなる主回路10と、それぞれが、複数の回路ブロック11のうちの対応する回路ブロック11と接続され、回路ブロック11に発生したノイズの量に応じて回路ブロック11の基板バイアス電圧を決定する基板バイアス制御回路9とを備えている。 - 特許庁

In the optical member, an optical sheet 10 having a light path control function and a sheet having light diffusivity and independence are integrated with each other and a light diffusing sheet 17 having higher total beam transmissivity than the sheet having the light diffusivity and independence is bonded to the light emission surface of the optical sheet with any means of cohesive material, adhesive material, or welding.例文帳に追加

光路制御機能を有する光学シート10と、光拡散性及び自立性を有するシートとが一体化した構造を有し、且つ光学シートの光出射面に光拡散性及び自立性を有するシートよりも全光線透過率の高い光拡散シート17とが粘着材、接着材、溶着の何れかの手段で接合されている光学部材。 - 特許庁

Further, the rectifier system includes power supply control means 8 of actuating an additional rectifier unit when a time integrated value of the storage battery currents exceeds predetermined set capacity or when a storage battery current exceeds the predetermined current capacity so as to supply a load request current requested by the load as the total of the storage battery currents and rectifier currents.例文帳に追加

さらに蓄電池電流と整流器電流との合計によって負荷から要求された負荷要求電流を供給できるように、蓄電池電流の時間積分値が所定の設定容量を超えた場合又は蓄電池電流が所定の電流容量を超えた場合に追加の整流器ユニットを起動する給電制御手段8を備えたことを特徴とする。 - 特許庁

An exclusive software interpreting the conditions such as a stand alone, or an integrated software to an existing software or a software in interlocking with the existing software is prepared, and the system adopts a method where the actual transmission of information or information to a receiver is conducted when the respective conditions hold so as to control separately the actual transmission of information and disclosure of the information to the receiver.例文帳に追加

この条件を解釈する専用のソフトをスタンドアロン、もしくは既存のソフトへの組込み形式、もしくは既存ソフトとの携作動形式のものを準備し、情報の実際の発信や受け手への通知はそれぞれの条件が成立した時点で行う方式を取る事により、実際の情報の伝送と受け手への情報の開示とを分離して制御する。 - 特許庁

The apparatus is provided with a light irradiation structure and integrated and joined to the end of a lens tube for giving an optically focusing adjustment of an optical energy irradiated from an emitting part being a semiconductor laser and with a power supply control circuit capable of variably adjusting supplied power by a command from a computer controlling the stereo lithography apparatus to a power supply circuit for emitting a laser.例文帳に追加

半導体レーザであり発光部が照射する光エネルギーを光学的に焦点調整を施すためのレンズ鏡筒端へ接合一体化されている光照射部構造を持ち、レーザが発光するための電源供給回路に光造形装置を制御するコンピュータからの指令により供給電力を可変的に加減できる電カボリューム制御回路を備えている。 - 特許庁

Does the Board of Directors or organization equivalent to the Board of Directors have the Manager (hereinafter simply referred to as the “Managerin this checklist) of the division in charge of overseeing matters related to legal compliance in an integrated manner (hereinafter referred to as the “Compliance Control Division”) develop internal rules that clearly specify the arrangements on legal compliance (hereinafter referred to as the “Legal Compliance Rules”) and disseminate them throughout the institution in accordance with the Legal Compliance Policy? 例文帳に追加

取締役会等は、法令等遵守方針に則り、法令等遵守に関する取決めを明確に定めた内部規程(以下「法令等遵守規程」という。)を、法令等遵守に関する事項を一元的に管理する部門(以下「コンプライアンス統括部門」という。)の管理者(以下本チェックリストにおいて単に「管理者」という。)に策定させ、組織内に周知させているか。 - 金融庁

This ceramic joining part is joined to the whole face of ceramic and integrated with the ceramic by brazing and comprises titanium as a main material and at least one or more kinds of metals which are different in coefficient of linear expansion from titanium and enables the coefficient of linear expansion to control into an arbitrary value between linear expansion coefficient of titanium and that of other metal by adjusting compounding ratio of each component.例文帳に追加

セラミックにろう付け等により全面接合し一体化する接合部品であって、チタンを主材とし、少なくとも1種類以上のチタンと線膨張係数の異なる金属とを含有し、各成分の配合比率を調整する事により、チタン単体の場合と他の金属単体の場合との間の任意の線膨張係数値に制御が可能なこととした。 - 特許庁

The integrated circuit device comprises a digital power supply regulation circuit 30, an analog power supply regulation circuit 32, a control logic circuit 110, an analog circuit 120, and a power supply wiring region PWRG connected with a digital power supply line for supplying a digital power supply VDD3 and an analog power supply line for supplying an analog power supply VD45A.例文帳に追加

集積回路装置はデジタル電源調整回路30、アナログ電源調整回路32、制御ロジック回路110、アナログ回路120、電源配線領域PWRGを含む、電源配線領域PWRGには、デジタル電源VDD3を供給するためのデジタル電源線とアナログ電源VD45Aを供給するためのアナログ電源線が配線される。 - 特許庁

To propose an integrated circuit that active devices formed at respective pixels control a plurality of the pixels in a so-called active matrix display for controlling the on/off/density of the respective pixels by the active devices in a liquid crystal display and organic EL display and further to provide a method for assigning the specific one pixel from a plurality of the pixels without increasing the number of wiring and a display using the same.例文帳に追加

液晶ディスプレイや有機ELディスプレイの中で、各画素のオン・オフ・濃淡をそこに形成された能動デバイスで制御するいわゆる能動マトリクス・ディスプレイにおいて、その能動デバイスが複数の画素を制御する集積回路とすることを提案し、さらに、複数の画素の中から特定の1画素を、配線数を増やさずに指定する方法とそれを用いたディスプレイを提供する。 - 特許庁

In the tractor 10 provided with a front wheel suspension and a mechanical front wheel driving device, a front wheel driving differential case 26 includes an oil reservoir 30 of an engine oil replacing the necessity of respective oil sumps and suspension control arms 42 and 62 are mounted on the differential case 26 by a mounting structure integrated and formed within the differential case 26.例文帳に追加

前ホイールサスペンションと機械的な前ホイール駆動装置とを備えたトラクタ10であって、前ホイール駆動ディファレンシャルケース26が、別個のオイルの油溜めの必要性に取って代わるエンジンオイルの油溜め30を含み、サスペンション制御アーム42、62が、前記ディファレンシャルケース内に一体化されて形成された取り付け構造によって同ディファレンシャルケースに取り付けられているトラクタ。 - 特許庁

To easily and efficiently perform encoding processing appropriately for an imaging device under XY address control of a CMOS solid-state imaging device or the like by application to a video camera, electronic still camera or monitoring device for recording a result of imaging using a motion picture, for example, in an encoding apparatus, imaging apparatus, integrated circuit for an imaging device, decoding apparatus and image data processing method.例文帳に追加

本発明は、符号化装置、撮像装置、撮像素子の集積回路、復号化装置及び画像データの処理方法に関し、例えば動画による撮像結果を記録するビデオカメラ、電子スチルカメラ、監視装置等に適用して、CMOS固体撮像素子等のXYアドレス制御による撮像素子に好適に、簡易かつ効率良く符号化処理することができるようにする。 - 特許庁

A semiconductor integrated circuit 1 can be loaded on a drive recorder DRS capable of recording data from an on-vehicle camera 2, a microphone 3 and an acceleration sensor 4 in a storage medium device 5, and includes: a moving image encoder 10, a sound compression encoder 11, an acceleration analyzer 12; a multiplexer 14 for generating multiplex information, and a control part 15 for generating a file 50 including the multiplex information.例文帳に追加

車載のカメラ2、マイクロフォン3、加速度センサ4からのデータを記憶媒体装置5に記録可能な運転記録装置DRSに搭載可能な半導体集積回路1は、動画像エンコーダ10、音声圧縮エンコーダ11、加速度解析器12、多重化情報を生成するマルチプレクサ14、多重化情報を含むファイル50を生成する制御部15を具備する。 - 特許庁

A monitoring point deviation integrating means 15 integrates the deviation from an upper limit value and a lower limit value of a bus-bar voltage and a reactive power current which are monitoring object, from a system state obtained by a voltage system information obtaining means 11, and a deviation decision means 13 actuates a control amount calculating means 12 when the integrated value of the deviation amount exceeds a preset deviation threshold.例文帳に追加

監視点偏差量積分手段15は、電圧系統情報把握手段11で求められた系統状態から監視対象となる母線電圧及び無効電力潮流の上限値及び下限値からの偏差量を積分し、逸脱判定手段13はその偏差量積分値が予め設定された逸脱閾値を超えたときに制御量算出手段12を起動する。 - 特許庁

To provide an imaging apparatus and an integrated circuit for an imaging element that are applied to, for example, video cameras for recording moving picture imaging results, electronic still cameras, and monitoring devices or the like so as to effectively utilize a high degree of freedom of reading imaging results being features of CMOS solid-state imaging elements or the like thereby simplifying the entire configuration and surely attaining rate control.例文帳に追加

本発明は、撮像装置及び撮像素子の集積回路に関し、例えば動画による撮像結果を記録するビデオカメラ、電子スチルカメラ、監視装置等に適用して、CMOS固体撮像素子等の特徴である撮像結果の読み出しに係る高い自由度を有効に利用して、全体構成を簡略化して確実にレート制御することができるようにする。 - 特許庁

In the installation system, the installation device includes an acquisition means for acquiring installation environment information from installers of respective modules, a UI (User Interface) generation means for preparing the UI integrated based on the acquired information and a control means for sending the information selected from the UI by the user to the installers of respective modules and executing the installation of the information in order.例文帳に追加

このインストーラーシステムは、インストール装置が各モジュールのインストーラーからインストール環境情報を取得する取得手段と、その情報に基づいて統一したユーザーインターフェース(UI)を作成するUI生成手段と、そして、前記UIからユーザーによって選択された情報を各モジュールのインストーラーに送付して、順番にインストールを実施する制御手段を備えることを特徴とする。 - 特許庁

The integrated circuit 12 used for a computer system having a host computer 11 and at least mass storage peripheral devices includes a control circuit for the mass storage peripheral devices 12 for receiving the information from the devices and an interface circuit for interfacing the information from the devices to the host computer 11 via a bus mastering bus of the host computer 11, for example, a PCI bus, 1394 bus or similar buses.例文帳に追加

ホスト・コンピュータと少なくとも1つのマスストレージ周辺装置を有するコンピュータ・システムに用いる集積回路であって、装置から情報を受取るためのマスストレージ周辺装置に対する制御回路と、ホスト・コンピュータのバス・マスタリング・バス、例えば、PCIバス、1394バス、又は類似のものを介して、装置からホスト・コンピュータへ情報をインタフェースするためのインタフェース回路とを含む。 - 特許庁

(iii) Whether the Financial Instruments Business Operator has established an integrated and centralized internal control environment for judging whether to implement “the reporting of suspicious transactions,” by comprehensively taking account of basic customer information obtained through appropriate implementation of customer identification, the specific characteristics of transactions and other matters based on the full recognition of the co-relation between customer identification and the “reporting of suspicious transactions.” 例文帳に追加

本人確認と「疑わしい取引の届出」が相互に関連性を有していることを十分に認識し、本人確認の的確な実施により顧客の基礎的な情報を把握し、その上で当該情報及び顧客の取引態様等を総合的に勘案のうえ判断し、「疑わしい取引の届出」が行われるよう、一体的、一元的な社内態勢等が構築されているか。 - 金融庁

The semiconductor integrated circuit comprises an input and output terminals 110, 120, an output buffer circuit 1000 for outputting a voltage to the output terminal based on the level of an input signal to the input terminal, and a current control circuit 160 for feeding the output buffer circuit with a current according to the output voltage on the output terminal.例文帳に追加

本発明による半導体集積回路は、入力端子110と、出力端子120と、入力端子に供給された入力信号のレベルに基づいて電圧を出力端子へ出力する出力バッファ回路1000と、出力端子から出力される出力電圧に応じて電流を出力バッファ回路に供給する電流制御回路160とを備える。 - 特許庁

The plasma display device includes; a Plasma Display Panel (PDP); a chassis base adapted to support the PDP attached to one surface thereof; a plurality of Integrated Circuit (IC) modules respectively included on driving circuit boards attached to another surface of the chassis base and adapted to control the PDP, and one side surface of each IC modules comes into contact with a reinforcing member which is arranged on the chassis base.例文帳に追加

本発明によるプラズマディスプレイ装置は、プラズマディスプレイパネルと、前記プラズマディスプレイパネルがその一端に付着され、プラズマディスプレイパネルを支持するシャーシベースと、前記シャーシベースに装着される駆動回路基板に形成されて、プラズマディスプレイパネルを制御する集積回路モジュールと、を含み、前記集積回路モジュールの一側面が前記シャーシベースに形成される補強部材に接触する。 - 特許庁

An arithmetic circuit 10 integrates a distance in the radial direction from the center of an optical 1 to a track on which an optical pickup 4 scans which is detected by a potentiometer 11 and the rotational frequency of the disk 1 which is detected by a rotational frequency detecting circuit 9 and multipies a prescribed coefficient by the integrated result and the circuit 10 outputs the result as the control voltage of an equalizer circuit 6.例文帳に追加

演算回路10で、ポテンシオメータ11で検出された光ディスク1のディスク中心から光ピックアップ4が走査するトラックまでの半径方向の距離と回転周波数検出回路9で検出した光ディスク1の回転周波数とを積算し、その結果に所定の係数を掛け、演算回路10は、その結果をイコライザ6の制御電圧として出力する。 - 特許庁

The semiconductor integrated circuit device includes a first switch element 102 provided between an analog input terminal AIN of an analog circuit 10 and an analog power supply terminal AVDD, a second switch element 103 provided between the analog input terminal AIN and an analog ground terminal AVSS, and a switch element switching control circuit 104 for controlling ON/OFF operation of the first switch element 102 and the second switch element 103.例文帳に追加

アナログ回路101のアナログ入力端子AINとアナログ電源端子AVDDとの間に第1のスイッチ素子102を設け、アナログ入力端子AINとアナロググランド端子AVSSとの間に第2のスイッチ素子103を設け、さらに第1のスイッチ素子102及び第2のスイッチ素子103のオン、オフ動作を制御するスイッチ素子切り替え制御回路104を設ける。 - 特許庁

Systems from a digital control system composed of a pulse-width modulation/intensity modulation signal generator 11 that generates a light emission instruction signal to perform pulse-width modulation and intensity modulation simultaneously to input data based on the input data, to an analog drive system such as an error amplifier 8 and current driver 7 are all mounted on a single chip IC 9 in a highly integrated structure.例文帳に追加

入力データに基づいて、入力データに対してパルス幅変調と強度変調とを同時に行う発光指令信号を生成するパルス幅変調・強度変調信号生成部11なるデジタル制御系から、誤差増幅部8や電流駆動部7のようなアナログ駆動系まで、全てを1チップの集積回路9として高集積化して構成した。 - 特許庁

A burn-in test control and pattern generating circuit 503 is provided at periphery of a memory circuit as an exclusive test circuit at the reliability test such as burn-in inside a semiconductor integrated circuit including a memory circuit, the circuit supplies a pattern being able to apply appropriate stress, and it is confirmed whether the stress is applied correctly or not by providing an output discriminating circuit 505 inside the circuit.例文帳に追加

メモリ回路を含む半導体集積回路内部にバーンイン等の信頼性テスト時にメモリ回路周辺に専用のテスト回路としてバーンインテスト制御およびパターン発生回路503を設け適切なストレス印加が可能なパターンを供給し、この出力を回路内部に出力判定回路505を設けストレスが正しく印加されているか確認する。 - 特許庁

The integrated system 40 generally uses the same credit card or smart card reader 48 for both the ATM and Internet Kiosk functions, for example, in a combination of an ATM and an Internet Kiosk for avoiding overlapping of hardware or the function when providing the providing commodity or service, and the same control screens 42 and 44 operate the ATM function and the Internet function.例文帳に追加

前記統合一体化システム40は、一般に、提供される商品またはサービスを提供する際にハードウェアまたは機能が重複するのを避けるため、例えば、ATMおよびインターネットキオスクの組み合わせにおいて、ATMおよびインターネットキオスク機能の両方に同一クレジットカードまたはスマートカードリーダ48が使用され、同一コントロールスクリーン42,44がATM機能およびインターネット機能等を作動させる。 - 特許庁

This semiconductor integrated circuit device is provided with a photodetecting circuit 1 for outputting a detection signal 4 including a photosensor and an operation control circuit 2 comprising an AND-gate for controlling the supply and stop of supply of a clock signal 5 to a CPU 3 according to the output signal from the photodetecting circuit 1.例文帳に追加

フォトセンサを含み、検出信号4(外部よりの入射光が検出されたときは、ハイレベルの光検出信号、外部よりの入射光が検出されないときは、ロウレベルの光非検出信号)を出力する光検出回路1と、該光検出回路1よりの出力信号に応じて、CPU3へのクロック信号5の供給・供給停止を制御するアンドゲートから成る動作制御回路2とを含んで構成される。 - 特許庁

In this case, each of the two or more license number detectors are arranged at a prescribed point of a road network, detects license number information of a target vehicle from the target vehicle travelling through the point, and transmits vehicle information containing the license number information, point information showing the point and time information showing time when the license number is detected to the integrated control device.例文帳に追加

ここで、前記複数の車両番号検出装置の各々は、道路網の所定の地点に配置され、前記地点を通行する対象車両から前記対象車両の車両番号情報を検出し、前記車両番号情報と、前記地点を示す地点情報と、前記車両番号を検出した時刻を示す時刻情報とを含む車両情報を前記統合管理装置に対して送信する。 - 特許庁

A high efficient and inexpensive waste treatment device provided which has a simple processing tank 7 integrated with a compact crushing mechanism 11 and a stirring mechanism, and facilitating handling operation control, and installation and use anywhere and by anyone, while efficiently performing treatment during travel by effectively fully using a necessary collecting time for wastes dispersed in a vast range, by a mobile waste treatment device loading the former device.例文帳に追加

簡潔な破砕機構と攪拌機構を一体化した単純な処理槽を持ち、取扱い運転管理が容易で、どこでも誰でも容易に設置使用できる高能率で安価な廃棄物処理装置を提供する一方、この装置を搭載した自走式廃棄物処理装置により、広範囲に分散した廃棄物の収集所要時間を有効に活用して走行中にも能率的に処理する。 - 特許庁

The field sequential system drive circuit, that consists of an analog/digital converter circuit that converts at least a video signal consisting of R, G, B signals into digital signals, of a field memory to which the converted digital signal is written by each field, and of a field sequential control circuit controlling a color decoder, the analog/digital converter circuit and the field memory, is integrated into one chip.例文帳に追加

少なくとも、ビデオ信号からR、G、Bの映像信号に分割された映像信号をデジタル信号に変換するA/D変換回路と、変換されたデジタル信号を1フィールド毎書込むフィールドメモリと、カラーデコーダ、A/D変換回路、フィールドメモリを制御するフィールドシーケンシャル制御回路で構成されるフィールドシーケンシャル方式駆動回路を1チップに集積したフィールドシーケンシャル方式駆動回路用集積回路とする。 - 特許庁

A graphic logic of an integrated LSI includes a command decoding part 20 for decoding a command of a host CPU 10, and an image decoding part 22 for executing decoding processing, and the image decoding part 22 includes a plurality of image decoders 30 for decompressing compressed image data as the decoding processing, a plurality of α-decoders 31 for blending transparent and translucent image data, and a bus control part 32.例文帳に追加

統合化LSIのグラフィックス用ロジックは、上位CPU10の命令を解読する命令解読部20と、デコード処理を行う画像デコード部22とを備え、画像デコード部22は、前記デコード処理として、圧縮された画素データの伸長処理を行う複数の画素デコーダ30と、透明、半透明の画像データをブレンドするブレンド処理を行う複数のαデコーダ31と、バス制御部32とを備える。 - 特許庁

A semiconductor integrated circuit 20 includes: the functional blocks 24 to be reset by the supply of a clock signal 35 and a reset signal 36; a reset signal output part 21 for outputting the reset signal 36 to reset the functional block 24; a clock mask circuit 23 for stopping the clock signal 35 to be supplied to the functional block 24; and a clock mask control circuit 22 for controlling the clock mask circuit 23.例文帳に追加

本発明にかかる半導体集積回路20は、クロック信号35及びリセット信号36が供給されることでリセットされる機能ブロック24と、機能ブロック24をリセットするリセット信号36を出力するリセット信号出力部21と、機能ブロック24に供給するクロック信号35を停止するクロックマスク回路23と、クロックマスク回路23を制御するクロックマスク制御回路22を有する。 - 特許庁

例文

The semiconductor integrated circuit includes an address control circuit that generates a carry on activation of a test mode signal according to a column instruction word when the least significant bit of an external address is fixed, latches an initial internal address to the external address, combines the latched initial internal address and the carry to output the address successively increasing from the initial internal address by the carry.例文帳に追加

本発明の半導体集積回路は、外部アドレスの最下位ビットが固定にされる場合に、コラム命令語に応じて、テストモード信号が活性化すればキャリーを生成し、前記外部アドレスを初期内部アドレスにラッチして、ラッチされた前記初期内部アドレスと前記キャリーとを組み合わせることで、前記キャリーにより前記初期内部アドレスから順次増加するアドレスを出力するアドレス制御回路を含む。 - 特許庁




  
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